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SN74AUP1G08

활성

1채널, 2입력, 0.8V~3.6V 저전력(< 1uA) AND 게이트

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SN74AUP1G08

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제품 상세 정보

Technology family AUP Supply voltage (min) (V) 0.8 Supply voltage (max) (V) 3.6 Number of channels 1 Inputs per channel 2 IOL (max) (mA) 4 IOH (max) (mA) -4 Input type Standard CMOS Output type Push-Pull Features Over-voltage tolerant inputs, Partial power down (Ioff), Very high speed (tpd 5-10ns) Data rate (max) (Mbps) 100 Rating Catalog Operating temperature range (°C) -40 to 85
Technology family AUP Supply voltage (min) (V) 0.8 Supply voltage (max) (V) 3.6 Number of channels 1 Inputs per channel 2 IOL (max) (mA) 4 IOH (max) (mA) -4 Input type Standard CMOS Output type Push-Pull Features Over-voltage tolerant inputs, Partial power down (Ioff), Very high speed (tpd 5-10ns) Data rate (max) (Mbps) 100 Rating Catalog Operating temperature range (°C) -40 to 85
DSBGA (YFP) 6 1.4000000000000001 mm² 1 x 1.4000000000000001 DSBGA (YZP) 5 2.1875 mm² 1.75 x 1.25 SOT-23 (DBV) 5 8.12 mm² 2.9 x 2.8 SOT-5X3 (DRL) 5 2.56 mm² 1.6 x 1.6 SOT-SC70 (DCK) 5 4.2 mm² 2 x 2.1 USON (DRY) 6 1.45 mm² 1.45 x 1 X2SON (DPW) 5 0.64 mm² 0.8 x 0.8 X2SON (DSF) 6 1 mm² 1 x 1
  • Available in the Ultra Small 0.64mm2 Package (DPW) With 0.5mm Pitch
  • Low Static-Power Consumption: ICC = 0.9µA Maximum
  • Low Dynamic-Power Consumption: Cpd = 4.3pF Typical at 3.3V
  • Low Input Capacitance: Ci = 1.5pF Typical
  • Low Noise: Overshoot and Undershoot <10% of VCC
  • Ioff Supports Live Insertion, Partial-Power-Down Mode, and Back Drive Protection
  • Schmitt-Trigger Action Allows Slow Input Transition and Better Switching Noise Immunity at the Input (Vhys = 250 mV Typical at 3.3V)
  • Wide Operating VCC Range of 0.8V to 3.6V
  • Optimized for 3.3V Operation
  • 3.6V I/O Tolerant to Support Mixed-Mode Signal Operation
  • tpd = 4.3ns Maximum at 3.3V
  • Suitable for Point-to-Point Applications
  • Latch-Up Performance Exceeds 100mA Per JESD 78, Class II
  • ESD Performance Tested Per JESD 22
    • 2000V Human-Body Model (A114-B, Class II)
    • 1000V Charged-Device Model (C101)
  • Available in the Ultra Small 0.64mm2 Package (DPW) With 0.5mm Pitch
  • Low Static-Power Consumption: ICC = 0.9µA Maximum
  • Low Dynamic-Power Consumption: Cpd = 4.3pF Typical at 3.3V
  • Low Input Capacitance: Ci = 1.5pF Typical
  • Low Noise: Overshoot and Undershoot <10% of VCC
  • Ioff Supports Live Insertion, Partial-Power-Down Mode, and Back Drive Protection
  • Schmitt-Trigger Action Allows Slow Input Transition and Better Switching Noise Immunity at the Input (Vhys = 250 mV Typical at 3.3V)
  • Wide Operating VCC Range of 0.8V to 3.6V
  • Optimized for 3.3V Operation
  • 3.6V I/O Tolerant to Support Mixed-Mode Signal Operation
  • tpd = 4.3ns Maximum at 3.3V
  • Suitable for Point-to-Point Applications
  • Latch-Up Performance Exceeds 100mA Per JESD 78, Class II
  • ESD Performance Tested Per JESD 22
    • 2000V Human-Body Model (A114-B, Class II)
    • 1000V Charged-Device Model (C101)

This single 2-input positive-AND gate is designed for 0.8V to 3.6V VCC operation and performs the Boolean function Y = A • B or Y = /A + /B in positive logic.

This single 2-input positive-AND gate is designed for 0.8V to 3.6V VCC operation and performs the Boolean function Y = A • B or Y = /A + /B in positive logic.
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SN74LVC1G10 활성 단일 3입력, 1.65V~5.5V NAND 게이트 Voltage range 1.65V to 5.5V, average propagation delay 5.5ns, average drive strength 24mA
SN74LVC1G11 활성 1채널 3입력 1.65V~5.5V 32mA 드라이브 강도 AND 게이트 Voltage range 1.65V to 5.5V, average propagation delay 5.5ns, average drive strength 24mA
SN74LVC1G18 활성 3상 비선택 출력을 지원하는 두 비인버팅 디멀티플렉서 중 하나 Voltage range 1.65V to 5.5V, average propagation delay 5.5ns, average drive strength 24mA
SN74LVC1G27 활성 단일 3입력, 1.65V~5.5V NOR 게이트 Voltage range 1.65V to 5.5V, average propagation delay 5.5ns, average drive strength 24mA
SN74LVC1G332 활성 1채널, 3입력 1.65V~5.5V 32mA 드라이브 강도 OR 게이트 Voltage range 1.65V to 5.5V, average propagation delay 5.5ns, average drive strength 24mA
SN74LVC1G373 활성 3상 출력을 지원하는 단일 D형 래치 Voltage range 1.65V to 5.5V, average propagation delay 5.5ns, average drive strength 24mA
SN74LVC1G374 활성 3상 출력을 지원하는 단일 D유형 플립플롭 Voltage range 1.65V to 5.5V, average propagation delay 5.5ns, average drive strength 24mA
SN74LVC1G386 활성 단일 3입력 1.65V~5.5V XOR(배타적 OR) 게이트 Voltage range 1.65V to 5.5V, average propagation delay 5.5ns, average drive strength 24mA

기술 자료

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* Data sheet SN74AUP1G08 Low-Power Single 2-Input Positive-AND Gate datasheet (Rev. Q) PDF | HTML 2024/03/01
Selection guide Logic Guide (Rev. AC) PDF | HTML 2025/11/13
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Selection guide Little Logic Guide 2018 (Rev. G) 2018/07/06
Application note Designing and Manufacturing with TI's X2SON Packages 2017/08/23
Application note How to Select Little Logic (Rev. A) 2016/07/26
Application note Semiconductor Packing Material Electrostatic Discharge (ESD) Protection 2004/07/08

설계 및 개발

추가 조건 또는 필수 리소스는 사용 가능한 경우 아래 제목을 클릭하여 세부 정보 페이지를 확인하세요.

평가 보드

5-8-LOGIC-EVM — 5핀~8핀 DCK, DCT, DCU, DRL 및 DBV 패키지용 일반 논리 평가 모듈

5~8핀 수의 DCK, DCT, DCU, DRL 또는 DBV 패키지가 있는 모든 디바이스를 지원하도록 설계된 유연한 EVM.
사용 설명서: PDF
TI.com에서 구매할 수 없음
평가 보드

5-8-NL-LOGIC-EVM — 5-8핀 DPW, DQE, DRY, DSF, DTM, DTQ 및 DTT 패키지를 지원하는 일반 로직 및 변환 EVM

DTT, DRY, DPW, DTM, DQE, DQM, DSF 또는 DTQ 패키지가 있는 로직 또는 변환 디바이스를 지원하도록 설계된 일반 EVM. 보드 설계는 유연한 평가가 가능합니다.

사용 설명서: PDF | HTML
TI.com에서 구매할 수 없음
시뮬레이션 모델

SN74AUP1G08 Behavioral SPICE Model

SCEM690.ZIP (7 KB) - PSpice Model
다운로드
시뮬레이션 모델

SN74AUP1G08 IBIS Model (Rev. A)

SCEM405A.ZIP (65 KB) - IBIS Model
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패키지 핀 CAD 기호, 풋프린트 및 3D 모델
DSBGA (YFP) 6 Ultra Librarian
DSBGA (YZP) 5 Ultra Librarian
SOT-23 (DBV) 5 Ultra Librarian
SOT-5X3 (DRL) 5 Ultra Librarian
SOT-SC70 (DCK) 5 Ultra Librarian
USON (DRY) 6 Ultra Librarian
X2SON (DPW) 5 Ultra Librarian
X2SON (DSF) 6 Ultra Librarian
TI의 평가 항목에 대한 표준 약관이 적용됩니다.

주문 및 품질

포함된 정보:
  • RoHS
  • REACH
  • 디바이스 마킹
  • 납 마감/볼 재질
  • MSL 등급/피크 리플로우
  • MTBF/FIT 예측
  • 물질 성분
  • 인증 요약
  • 지속적인 신뢰성 모니터링
포함된 정보:
  • 팹 위치
  • 조립 위치

지원 및 교육

TI 엔지니어의 기술 지원을 받을 수 있는 TI E2E™ 포럼

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