計算工具
TPS3430
- Factory-programmed precision watchdog timers:
- ±2.5% Accurate watchdog timeout and watchdog reset delays typical at 25°C
- Watchdog disable feature
- User-programmable watchdog timeout
- User-programmable watchdog reset delay
- Input voltage range: VDD = 1.6 V to 6.5 V
- Low supply current: IDD = 10 µA (typical)
- Open-drain output
- Small 3-mm × 3-mm, 10-Pin VSON package
- Junction operating temperature range: –40°C to +125°C
The TPS3430 is a standalone window watchdog timer with programmable watchdog window and programmable watchdog reset delay for a wide variety of applications. The TPS3430 window watchdog achieves 2.5% timing accuracy (typical at 25°C) and the watchdog output ( WDO) reset delay can be set by factory-programmed default delay settings, or programmed by an external capacitor. The watchdog can be disabled via the SET pins to avoid undesired watchdog timeouts during the development process or during power on.
The TPS3430 is available in a small 3.00-mm × 3.00-mm, 10-pin VSON package.
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設計與開發
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開發板
TPS3430EVM — 具有可編程重設延遲功能的 TPS3430 窗口監視計時器
TPS3430 評估模組 (EVM) 是評估 TP3430 裝置的平台。TPS3430 是一款獨立的視窗監視定時器，具有可編程 視窗監視 和可編程重設延遲，適用於各種應用。此裝置可用來監控 MCU 的監視輸入，如果可編程監視視窗中沒有脈衝抵達時，會觸發監視輸出。藉由設定 SET0 和 SET1 接腳，以及變更 CRST 和 CWD 的電容器，可以編程此裝置。
使用指南: PDF
模擬工具
PSPICE-FOR-TI — PSpice® for TI 設計與模擬工具
PSpice® for TI 是有助於評估類比電路功能的設計和模擬環境。這款全功能設計和模擬套件使用 Cadence® 的類比分析引擎。PSpice for TI 包括業界最大的模型庫之一，涵蓋我們的類比和電源產品組合，以及特定類比行為模型，且使用無需支付費用。
PSpice for TI 設計和模擬環境可讓您使用其內建函式庫來模擬複雜的混合訊號設計。在進行佈局和製造之前，建立完整的終端設備設計和解決方案原型，進而縮短上市時間並降低開發成本。
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