SN74LVC126A
- Operates from 1.65V to 3.6V
- Specified from –40°C to +125°C
- Inputs accept voltages up to 5.5V
- Maximum tpd of 4.7ns at 3.3V
- Typical VOLP (output ground bounce), <0.8V at VCC = 3.3V, TA = 25°C
- Typical VOHV (output VOH undershoot), >2V at VCC = 3.3V, TA = 25°C
- Latch-up performance exceeds 250mA per JESD 17
The SN74LVC126A device is a quadruple bus buffer gate designed for 1.65V to 3.6V VCC operation.
The SN74LVC126A device features independent line drivers with 3-state outputs. Each output is disabled when the associated output-enable (OE) input is low.
To ensure the high-impedance state during power up or power down, OE must be tied to GND through a pulldown resistor; the minimum value of the resistor is determined by the current-sourcing capability of the driver.
Inputs can be driven from either 3.3V or 5V devices. This feature allows the use of this device as a translator in a mixed 3.3V and 5V system environment.
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기술 자료
설계 및 개발
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패키지 | 핀 | CAD 기호, 풋프린트 및 3D 모델 |
---|---|---|
SOIC (D) | 14 | Ultra Librarian |
SOP (NS) | 14 | Ultra Librarian |
SSOP (DB) | 14 | Ultra Librarian |
TSSOP (PW) | 14 | Ultra Librarian |
TVSOP (DGV) | 14 | Ultra Librarian |
VQFN (RGY) | 14 | Ultra Librarian |
WQFN (BQA) | 14 | Ultra Librarian |
주문 및 품질
- RoHS
- REACH
- 디바이스 마킹
- 납 마감/볼 재질
- MSL 등급/피크 리플로우
- MTBF/FIT 예측
- 물질 성분
- 인증 요약
- 지속적인 신뢰성 모니터링
- 팹 위치
- 조립 위치