LM3881

現行

具可調式時間延遲的 3 軌簡單電源串聯器

產品詳細資料

Number of supplies monitored 3 Number of sequenced outputs 3 Rating Catalog Supply voltage (max) (V) 5.5 Supply voltage (min) (V) 2.7 Iq (typ) (mA) 0.08 Operating temperature range (°C) -40 to 125
Number of supplies monitored 3 Number of sequenced outputs 3 Rating Catalog Supply voltage (max) (V) 5.5 Supply voltage (min) (V) 2.7 Iq (typ) (mA) 0.08 Operating temperature range (°C) -40 to 125
VSSOP (DGK) 8 14.7 mm² 3 x 4.9
  • Easiest Method to Sequence Rails
  • Power-Up and Power-Down Control
  • Tiny Footprint
  • Low Quiescent Current of 80 µA
  • Input Voltage Range of 2.7 V to 5.5 V
  • Output Invert Feature
  • Timing Controlled by Small Value External
    Capacitor
  • Easiest Method to Sequence Rails
  • Power-Up and Power-Down Control
  • Tiny Footprint
  • Low Quiescent Current of 80 µA
  • Input Voltage Range of 2.7 V to 5.5 V
  • Output Invert Feature
  • Timing Controlled by Small Value External
    Capacitor

The LM3881 Simple Power Sequencer offers the easiest method to control power up and power down of multiple power supplies (switching or linear regulators). By staggering the start-up sequence, it is possible to avoid latch conditions or large inrush currents that can affect the reliability of the system.

Available in VSSOP-8 package, the Simple Sequencer contains a precision enable pin and three open-drain output flags. When the LM3881 is enabled, the three output flags will sequentially release, after individual time delays, thus permitting the connected power supplies to start up. The output flags will follow a reverse sequence during power down to avoid latch conditions. Time delays are defined using an external capacitor and the output flag states can be inverted by the user.

The LM3881 Simple Power Sequencer offers the easiest method to control power up and power down of multiple power supplies (switching or linear regulators). By staggering the start-up sequence, it is possible to avoid latch conditions or large inrush currents that can affect the reliability of the system.

Available in VSSOP-8 package, the Simple Sequencer contains a precision enable pin and three open-drain output flags. When the LM3881 is enabled, the three output flags will sequentially release, after individual time delays, thus permitting the connected power supplies to start up. The output flags will follow a reverse sequence during power down to avoid latch conditions. Time delays are defined using an external capacitor and the output flag states can be inverted by the user.

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類型 標題 日期
* Data sheet LM3881 Simple Power Sequencer With Adjustable Timing datasheet (Rev. D) PDF | HTML 2014年 12月 10日
Selection guide Power Management Guide 2018 (Rev. R) 2018年 6月 25日
Technical article How to manage processor power during uncontrolled power off PDF | HTML 2018年 6月 21日
Technical article Sequencing solutions: simple, reliable and cost-effective PDF | HTML 2017年 9月 27日
Technical article A simple six-channel power-rail sequencing solution PDF | HTML 2015年 11月 16日
Analog Design Journal Power-supply sequencing for FPGAs 2014年 10月 24日
EVM User's guide AN-1785 LM3881 Power Sequencer Evaluation Board (Rev. C) 2013年 5月 7日
Application note Power Supply Design Considerations for Modern FPGAs (Power Designer 121) 2010年 2月 2日

設計與開發

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開發板

LM3881EVAL — 適用於 LM3881 電源序列器的評估板

The LM3881 evaluation board has been designed to connect directly to the power supplies of an existing system to enable sequencing. Upon enabling the device, the three open drain output flags will rise in sequential order, 1-2-3. Once the part is disabled, the shutdown sequence will occur in (...)

使用指南: PDF
TI.com 無法提供
模擬工具

PSPICE-FOR-TI — PSpice® for TI 設計與模擬工具

PSpice® for TI 是有助於評估類比電路功能的設計和模擬環境。這款全功能設計和模擬套件使用 Cadence® 的類比分析引擎。PSpice for TI 包括業界最大的模型庫之一,涵蓋我們的類比和電源產品組合,以及特定類比行為模型,且使用無需支付費用。

PSpice for TI 設計和模擬環境可讓您使用其內建函式庫來模擬複雜的混合訊號設計。在進行佈局和製造之前,建立完整的終端設備設計和解決方案原型,進而縮短上市時間並降低開發成本。 

在 PSpice for TI 設計與模擬工具中,您可以搜尋 TI (...)
參考設計

TIDA-01466 — 適用於超音波前端的低電壓、低雜訊電源參考設計

此參考設計為經過最佳化的電源供應器,專為超音波成像系統中八個 16 通道接收 AFE IC 供電。此設計使用單晶片 DC-DC 轉換器 + LDO 組合穩壓器,能在將 LDO 輸入設定在剛好略高於壓降電壓的情況下充分利用 LDO PSRR,從而在效率最大化的同時減少零件數量。  此外,超低雜訊 LDO 有助於從 A/D 轉換獲得最高解析度,進而提升影像品質。此設計能夠與主時脈和系統時脈頻率同步切換頻率,協助系統設計師應用簡單的濾波技術,去除接地迴路上的電源供應器切換雜訊,或使用擴頻時脈來降低 EMI。此外,此設計採用 eFuse 裝置,提供簡單彈性的過電流防護方式。
Design guide: PDF
電路圖: PDF
參考設計

TIDA-01568 — 用於應用處理器的 12 mm x 12 mm 5 軌電源定序參考設計

此參考設計展示一種經過驗證且具成本競爭力的電源排序解決方案,適用於應用處理器或高性能控制平台。此設計支援 5 組不同的電壓軌,並針對 12mm × 12mm 的佈局空間進行了最佳化。此設計亦可調整延遲時間,並重新配置各軌的特定電壓位準,以滿足不同輸入電容器和不同處理器的需求。
Design guide: PDF
電路圖: PDF
參考設計

TIDA-010011 — 用於保護繼電器處理器模組的高效電源供應架構參考設計

此參考設計展示各種電源架構,可為需要 >1A 負載電流和高效率的應用處理器模組產生多重電壓軌。所需的電源是使用來自背板的 5、12 或 24-V DC 輸入所產生。電源供應器是使用配備整合式 FET 的 DC-DC 轉換器,以及具尺寸整合式電感器的電源模組所產生。此設計採用 HotRod™ 封裝類型,適合需要低 EMI 的應用。此外也最適合設計時間有限的應用。其他功能包括 DDR 終端穩壓器、輸入電源 OR-ing、電壓序列、用於過載保護的 eFuse,以及電壓和負載電流監控。此設計可搭配處理器、數位訊號處理器以及現場可編程邏輯閘陣列使用。已通過輻射發射測試,符合 A 類和 B 要求的 (...)
Design guide: PDF
電路圖: PDF
封裝 針腳 CAD 符號、佔位空間與 3D 模型
VSSOP (DGK) 8 Ultra Librarian

訂購與品質

內含資訊:
  • RoHS
  • REACH
  • 產品標記
  • 鉛塗層/球物料
  • MSL 等級/回焊峰值
  • MTBF/FIT 估算值
  • 材料內容
  • 認證摘要
  • 進行中持續性的可靠性監測
內含資訊:
  • 晶圓廠位置
  • 組裝地點

支援與培訓

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