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LM2512A

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オプションのディザリング機能と参照テーブル搭載、モバイル・ピクセル・リンク (MPL-1)、24 ビット RGB ディスプレイ・インターフェイス・シリアライザ

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LM2512A

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製品詳細

Protocols Catalog Rating Catalog Operating temperature range (°C) -30 to 85
Protocols Catalog Rating Catalog Operating temperature range (°C) -30 to 85
NFBGA (NZK) 49 16 mm² 4 x 4 X2QFN (NJM) 40 36 mm² 6 x 6
  • 24-bit RGB Interface Support up to 640 x 480 VGA Format
  • Optional 24 to 18-bit Dithering
  • Optional Look Up Table for Independent Color Correction
  • MPL-1 Physical Layer
  • SPI Interface for Look Up Table Control and Loading
  • Low Power Consumption & Powerdown State
  • Level Translation Between Host and Display
  • Optional Auto Power Down on STOP PCLK
  • Frame Sequence Bits Auto Resync upon Data or Clock Error
  • 1.6V to 2.0V Core / Analog Supply Voltage
  • 1.6V to 3.0V I/O Supply Voltage Range

System Benefits

  • Dithered Data Reduction
  • Independent RGB Color Correction
  • 24-bit Color Input
  • Small Interface, Low Power and Low EMI
  • Intrinsic Level Translation

All trademarks are the property of their respective owners.

  • 24-bit RGB Interface Support up to 640 x 480 VGA Format
  • Optional 24 to 18-bit Dithering
  • Optional Look Up Table for Independent Color Correction
  • MPL-1 Physical Layer
  • SPI Interface for Look Up Table Control and Loading
  • Low Power Consumption & Powerdown State
  • Level Translation Between Host and Display
  • Optional Auto Power Down on STOP PCLK
  • Frame Sequence Bits Auto Resync upon Data or Clock Error
  • 1.6V to 2.0V Core / Analog Supply Voltage
  • 1.6V to 3.0V I/O Supply Voltage Range

System Benefits

  • Dithered Data Reduction
  • Independent RGB Color Correction
  • 24-bit Color Input
  • Small Interface, Low Power and Low EMI
  • Intrinsic Level Translation

All trademarks are the property of their respective owners.

The LM2512A is a MPL Serializer (SER) that performs a 24-bit to 18-bit Dither operation and serialization of the video signals to Mobile Pixel link (MPL) levels on only 3 or 4 active signals. An optional Look Up Table (Three X 256 X 8 bit RAM) is also provided for independent color correction. 18-bit Bufferless or partial buffer displays from QVGA (320 x 240) up to VGA (640 x 480) pixels can utilize a 24-bit video source.

The interconnect is reduced from 28 signals to only 3 or 4 active signals with the LM2512A and companion deserializer easing flex interconnect design, size constraints and cost.

The LM2512A SER resides by the application, graphics or baseband processor and translates the wide parallel video bus from LVCMOS levels to serial Mobile Pixel Link levels for transmission over a flex cable (or coax) and PCB traces to the DES located near or in the display module.

When in Power_Down, the SER is put to sleep and draws less than 10μA. The link can also be powered down by stopping the PCLK (DES dependant) or by the PD* input pins.

The LM2512A provides enhanced AC performance over the LM2512. It implements the physical layer of the MPL-1 and uses a single-ended current-mode transmission.

The LM2512A is a MPL Serializer (SER) that performs a 24-bit to 18-bit Dither operation and serialization of the video signals to Mobile Pixel link (MPL) levels on only 3 or 4 active signals. An optional Look Up Table (Three X 256 X 8 bit RAM) is also provided for independent color correction. 18-bit Bufferless or partial buffer displays from QVGA (320 x 240) up to VGA (640 x 480) pixels can utilize a 24-bit video source.

The interconnect is reduced from 28 signals to only 3 or 4 active signals with the LM2512A and companion deserializer easing flex interconnect design, size constraints and cost.

The LM2512A SER resides by the application, graphics or baseband processor and translates the wide parallel video bus from LVCMOS levels to serial Mobile Pixel Link levels for transmission over a flex cable (or coax) and PCB traces to the DES located near or in the display module.

When in Power_Down, the SER is put to sleep and draws less than 10μA. The link can also be powered down by stopping the PCLK (DES dependant) or by the PD* input pins.

The LM2512A provides enhanced AC performance over the LM2512. It implements the physical layer of the MPL-1 and uses a single-ended current-mode transmission.

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技術資料

star =TI が選定したこの製品の主要ドキュメント
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種類 タイトル 最新の英語版をダウンロード 日付
* データシート MPL-1 24-Bit RGB Display I/F Serializer w/ Optional Dithering & Look Up Table データシート (Rev. B) 2013年 5月 2日

設計および開発

その他のアイテムや必要なリソースを参照するには、以下のタイトルをクリックして詳細ページをご覧ください。

シミュレーション・ツール

PSPICE-FOR-TI — TI Design / シミュレーション・ツール向け PSpice®

PSpice® for TI は、各種アナログ回路の機能評価に役立つ、設計とシミュレーション向けの環境です。設計とシミュレーションに適したこのフル機能スイートは、Cadence® のアナログ分析エンジンを使用しています。PSpice for TI は無償で使用でき、アナログや電源に関する TI の製品ラインアップを対象とする、業界でも有数の大規模なモデル・ライブラリが付属しているほか、選択された一部のアナログ動作モデルも利用できます。

設計とシミュレーション向けの環境である PSpice for TI (...)
リクエスト
シミュレーション・ツール

TINA-TI — SPICE ベースのアナログ・シミュレーション・プログラム

TINA-TI は、DC 解析、過渡解析、周波数ドメイン解析など、SPICE の標準的な機能すべてを搭載しています。TINA には多彩な後処理機能があり、結果を必要なフォーマットにすることができます。仮想計測機能を使用すると、入力波形を選択し、回路ノードの電圧や波形を仮想的に測定することができます。TINA の回路キャプチャ機能は非常に直観的であり、「クイックスタート」を実現できます。

TINA-TI をインストールするには、約 500MB が必要です。インストールは簡単です。必要に応じてアンインストールも可能です。(そのようなことはないと思いますが)

TINA は DesignSoft (...)

ユーザー ガイド: PDF
英語版 (Rev.A): PDF
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パッケージ ピン数 CAD シンボル、フットプリント、および 3D モデル
NFBGA (NZK) 49 Ultra Librarian
X2QFN (NJM) 40 Ultra Librarian
TI の評価品に関する標準契約約款が適用されます。

購入と品質

記載されている情報：
  • RoHS
  • REACH
  • デバイスのマーキング
  • リード端子の仕上げ / ボールの原材料
  • MSL 定格 / ピーク リフロー
  • MTBF/FIT 推定値
  • 使用原材料
  • 認定試験結果
  • 継続的な信頼性モニタ試験結果
記載されている情報：
  • ファブの拠点
  • 組み立てを実施した拠点

サポートとトレーニング

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