LMK03328
- 超低ノイズ、高性能
- ジッタ:100fs RMS (標準値)、FOUT > 100MHz
- PSNR:-80dBc、堅牢な電源ノイズ耐性
- 柔軟なデバイス オプション
- 最大 8 つの AC-LVPECL、AC-LVDS、AC-CML、HCSL、LVCMOS 出力を任意の組み合わせで使用可能
- ピン モード、I2C モード、EEPROM モード
- 71 ピンで選択可能なプログラム済みのデフォルト スタートアップ オプション
- 自動または手動の選択によるデュアル入力
- 水晶振動子入力:10MHz~52MHz
- 外部入力:1MHz~300MHz
- 周波数マージニング オプション
- 低コストのプル可能な水晶振動子を基準に使用した、きめ細かい周波数マージニング (標準値 ±50ppm)
- 出力分周器を使用した、グリッチレスな粗い周波数マージニング (%)
- その他の特長
- 電源電圧:3.3V コア、1.8V、2.5V、3.3V 出力
- 工業用温度範囲:-40℃~85℃
- パッケージ:7mm×7mm 48-WQFN
LMK03328 デバイスは超低ノイズのクロック ジェネレータであり、2 つのフラクショナル N 周波数シンセサイザと内蔵 VCO、柔軟なクロック分配およびファンアウトといった特長を備え、ピンで選択可能な構成状態がオンチップの EEPROM に格納されています。このデバイスは、各種の数ギガビット速度のシリアル インターフェイスおよびデジタル デバイス用に複数のクロックを生成できるため、BOM コストと基板面積を削減し、複数の発振器とクロック分配デバイスを置き換えることで信頼性を向上できます。超低ジッタにより、高速シリアル リンクにおけるビット エラー レート(BER)を低減します。
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技術資料
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| * | データシート | LMK03328 2 つの独立 PLL、8 出力、EEPROM 内蔵、超低ジッタのクロック ジェネレータ データシート (Rev. E 翻訳版) | PDF | HTML | 英語版 (Rev.E) | PDF | HTML | 2024/10/02 |
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設計と開発
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| パッケージ | ピン数 | CAD シンボル、フットプリント、および 3D モデル |
|---|---|---|
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購入と品質
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