KOKY056 December 2024 AMC0106M05 , AMC0106M25 , AMC0136 , AMC0311D , AMC0311S , AMC0386 , AMC0386-Q1 , AMC1100 , AMC1106M05 , AMC1200 , AMC1200-Q1 , AMC1202 , AMC1203 , AMC1204 , AMC1211-Q1 , AMC1300 , AMC1300B-Q1 , AMC1301 , AMC1301-Q1 , AMC1302-Q1 , AMC1303M2510 , AMC1304L25 , AMC1304M25 , AMC1305M25 , AMC1305M25-Q1 , AMC1306M05 , AMC1306M25 , AMC1311 , AMC1311-Q1 , AMC131M03 , AMC1336 , AMC1336-Q1 , AMC1350 , AMC1350-Q1 , AMC23C12 , AMC3301 , AMC3330 , AMC3330-Q1
클록 신호 보상을 위한 마지막 방법은 MCU에서 클록 반전이며, 이는 외부 및 내부 클록 소스를 지원하는 델타-시그마 모듈레이터에 사용됩니다. 이 경우 선택한 MCU가 GPIO 입력을 반전할 수 있어야 합니다. SDFM(시그마 델타 필터 모듈) 이전의 TMS320F28379D GPIO 입력은 그림 154에 나와 있는 것처럼 모든 GPIO에서 입력 신호를 반전하도록 구성할 수 있습니다. 예를 들어 클록 입력 신호는 GPIO123에서 반전되므로 AMC1303Mx 클록 신호가 아닌 SD1_C1 클록 신호가 반전됩니다. 따라서 SDFM은 그림 155에서 볼 수 있듯이 GPIO123의 입력에서 외부 클록 신호의 하강 에지가 아닌 입력 데이터 SD1_D1을 샘플링합니다.
GPIO를 사용하여 클록 입력 신호를 반전하면 클록 기간 절반의 고정 지연이 클록 신호에 추가됩니다. 시스템 설정의 타이밍 사양 및 전파 지연에 따라, 이 추가 지연은 SDFM 인증 GPIO(3-샘플) 모드 0에 대한 최소 10ns의 TMS320F28379D 설정 및 홀드 타이밍을 충족하기에 충분할 수 있습니다. 그러나 이 클록 신호 보상 방법의 추가 지연 시간은 고정되어 있고 변경할 수 없으므로, 각 시스템 설계에서 SDFM 인증 GPIO(3-샘플) 모드 0을 위한 MCU의 설정 및 홀드의 결과 타이밍이 충족되었는지 확인해야 합니다.
이 보상 방법은 외부 클록 신호의 상승 및 하강 에지를 모두 소프트웨어로 데이터 수집 지점으로 설정할 수 있는 Sitara MCU에도 적용됩니다.