製品詳細

Function Clock buffer, Differential Additive RMS jitter (Typ) (fs) 80 Output frequency (Max) (MHz) 250 Number of outputs 20 Output supply voltage (V) 3.3 Core supply voltage (V) 3.3 Output skew (ps) 50 Features 1:20 fanout, PCIe Gen 1-5 compliant, DB2000QL compliant, SMBus control, Side-Band Interface, OE# control, Individual output enable control Operating temperature range (C) -40 to 85 Rating Catalog Output type LP-HCSL Input type LP-HCSL
Function Clock buffer, Differential Additive RMS jitter (Typ) (fs) 80 Output frequency (Max) (MHz) 250 Number of outputs 20 Output supply voltage (V) 3.3 Core supply voltage (V) 3.3 Output skew (ps) 50 Features 1:20 fanout, PCIe Gen 1-5 compliant, DB2000QL compliant, SMBus control, Side-Band Interface, OE# control, Individual output enable control Operating temperature range (C) -40 to 85 Rating Catalog Output type LP-HCSL Input type LP-HCSL
TLGA (NPP) 80 36 mm² 6 x 6
  • 85Ω の出力終端を内蔵した 20 の LP-HCSL 出力
  • 8 つのハードウェア出力イネーブル (OE#) 制御
  • DB2000QL フィルタ処理後の付加位相ジッタ:0.08ps rms 未満
  • PCIe Gen 4 および Gen 5 Common Clock (CC) および Individual Reference (IR) アーキテクチャをサポート
    • スペクトラム拡散対応
  • サイクル間ジッタ:50ps 未満
  • 出力間スキュー:50ps 未満
  • 入力から出力までの遅延:3ns 未満
  • コアおよび IO 電源電圧:3.3V
  • ハードウェア制御による低消費電力モード (PD#)
  • PD# モードでの出力制御のためのサイドバンド・インターフェイス (SBI)
  • 9 つの選択可能な SMBus アドレス
  • 消費電力:600mW 未満
  • 6mm × 6mm、80 ピン TLGA/GQFN パッケージ
  • 85Ω の出力終端を内蔵した 20 の LP-HCSL 出力
  • 8 つのハードウェア出力イネーブル (OE#) 制御
  • DB2000QL フィルタ処理後の付加位相ジッタ:0.08ps rms 未満
  • PCIe Gen 4 および Gen 5 Common Clock (CC) および Individual Reference (IR) アーキテクチャをサポート
    • スペクトラム拡散対応
  • サイクル間ジッタ:50ps 未満
  • 出力間スキュー:50ps 未満
  • 入力から出力までの遅延:3ns 未満
  • コアおよび IO 電源電圧:3.3V
  • ハードウェア制御による低消費電力モード (PD#)
  • PD# モードでの出力制御のためのサイドバンド・インターフェイス (SBI)
  • 9 つの選択可能な SMBus アドレス
  • 消費電力:600mW 未満
  • 6mm × 6mm、80 ピン TLGA/GQFN パッケージ

CDCDB2000 は、PCIe Gen 1~5、QuickPath Interconnect (QPI)、UPI、SAS、SATA インターフェイス用のリファレンス・クロックを分配できる 20 出力 LP-HCSL、DB2000QL 準拠クロック・バッファです。SMBus、SBI、8 つの出力イネーブル・ピンにより、20 の出力すべてを個別に設定および制御できます。CDCDB2000 は DB2000QL から派生したバッファであり、DB2000QL 仕様のシステム・パラメータを満たし、または上回る性能を備えています。CDCDB2000 は 80 ピンの 6mm × 6mm TLGA/GQFN パッケージに封止されています。

CDCDB2000 は、PCIe Gen 1~5、QuickPath Interconnect (QPI)、UPI、SAS、SATA インターフェイス用のリファレンス・クロックを分配できる 20 出力 LP-HCSL、DB2000QL 準拠クロック・バッファです。SMBus、SBI、8 つの出力イネーブル・ピンにより、20 の出力すべてを個別に設定および制御できます。CDCDB2000 は DB2000QL から派生したバッファであり、DB2000QL 仕様のシステム・パラメータを満たし、または上回る性能を備えています。CDCDB2000 は 80 ピンの 6mm × 6mm TLGA/GQFN パッケージに封止されています。

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技術資料

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* データシート CDCDB2000 PCIe Gen 1~Gen 5 用 DB2000QL 準拠 20 出力クロック・バッファ データシート (Rev. A 翻訳版) PDF | HTML 英語版をダウンロード (Rev.A) PDF | HTML 2020年 6月 27日
ユーザー・ガイド CDCDB2000 User's Guide 2019年 10月 29日

設計および開発

追加の事項や他のリソースを参照するには、以下のタイトルをクリックすると、詳細ページを表示できます。

シミュレーション・モデル

CDCDB2000 IBIS Model

SNAM232.ZIP (30 KB) - IBIS Model
設計ツール

CLOCK-TREE-ARCHITECT — Clock tree architect プログラミング・ソフトウェア

Clock tree architect はクロック・ツリーの合成ツールであり、開発中システムの要件に基づいてクロック・ツリー・ソリューションを生成する方法で、お客様の設計プロセスの効率化に貢献します。このツールは、多様なクロック供給製品を収録した包括的なデータベースからデータを抽出し、システム・レベルのマルチチップ・クロック供給ソリューションを生成します。
ガーバー・ファイル

CDCDB2000 Board Files

SNAC085.ZIP (11498 KB)
シミュレーション・ツール

PSPICE-FOR-TI — TI Design / シミュレーション・ツール向け PSpice®

PSpice® for TI は、各種アナログ回路の機能評価に役立つ、設計とシミュレーション向けの環境です。設計とシミュレーションに適したこのフル機能スイートは、Cadence® のアナログ分析エンジンを使用しています。PSpice for TI は無償で使用でき、アナログや電源に関する TI の製品ラインアップを対象とする、業界でも有数の大規模なモデル・ライブラリが付属しているほか、選択された一部のアナログ動作モデルも利用できます。

設計とシミュレーション向けの環境である PSpice for TI (...)
パッケージ ピン数 ダウンロード
TLGA (NPP) 80 オプションの表示

購入と品質

記載されている情報:
  • RoHS
  • REACH
  • デバイスのマーキング
  • リード端子の仕上げ / ボールの原材料
  • MSL rating / リフローピーク温度
  • MTBF/FIT 推定値
  • 原材料組成
  • 認定試験結果
  • 継続的な信頼性モニタ試験結果

推奨製品には、この TI 製品に関連するパラメータ、評価基板、またはリファレンス・デザインが存在する可能性があります。

サポートとトレーニング

TI E2E™ Forums (英語) では、TI のエンジニアからの技術サポートが活用できます

コンテンツは、TI 投稿者やコミュニティ投稿者によって「現状のまま」提供されるもので、TI による仕様の追加を意図するものではありません。使用条件をご確認ください。

TI 製品の品質、パッケージ、ご注文に関するお問い合わせは、TI サポートをご覧ください。​​​​​​​​​​​​​​

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