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SN54AHC74

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クリアとプリセット搭載、デュアル・ポジティブ・エッジ・トリガ D タイプ・フリップ・フロップ

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製品詳細

Number of channels 2 Technology family AHC Supply voltage (min) (V) 2 Supply voltage (max) (V) 5.5 Input type Standard CMOS Output type Push-Pull Clock frequency (max) (MHz) 100 IOL (max) (mA) 8 IOH (max) (mA) -8 Supply current (max) (µA) 20 Features Balanced outputs, High speed (tpd 10-50ns), Over-voltage tolerant inputs Operating temperature range (°C) -55 to 125 Rating Military
Number of channels 2 Technology family AHC Supply voltage (min) (V) 2 Supply voltage (max) (V) 5.5 Input type Standard CMOS Output type Push-Pull Clock frequency (max) (MHz) 100 IOL (max) (mA) 8 IOH (max) (mA) -8 Supply current (max) (µA) 20 Features Balanced outputs, High speed (tpd 10-50ns), Over-voltage tolerant inputs Operating temperature range (°C) -55 to 125 Rating Military
CDIP (J) 14 130.4652 mm² 19.56 x 6.67 CFP (W) 14 58.023 mm² 9.21 x 6.3 LCCC (FK) 20 79.0321 mm² 8.89 x 8.89
  • 2V～5.5V の VCC で動作
  • JESD 17 準拠で 250mA 超のラッチアップ性能
  • JESD 22 を上回る ESD 保護
    • 2000V、人体モデル (A114-A)
    • 200V、マシン モデル(A115-A)
    • 1000V、デバイス帯電モデル (C101)
  • 2V～5.5V の VCC で動作
  • JESD 17 準拠で 250mA 超のラッチアップ性能
  • JESD 22 を上回る ESD 保護
    • 2000V、人体モデル (A114-A)
    • 200V、マシン モデル(A115-A)
    • 1000V、デバイス帯電モデル (C101)

SNx4AHC74 デュアル ポジティブ エッジ トリガ デバイスは、D タイプ フリップ フロップです。

プリセット (PRE) またはクリア (CLR) 入力を Low レベルにすると、その他の入力レベルに関係なく、出力がセットまたはリセットされます。ここで、PREおよびCLRが非アクティブ (High) の場合、セットアップ時間の要件を満たすデータ (D) 入力のデータは、クロック パルスの正方向エッジで出力に転送されます。クロックのトリガは電圧レベルで発生し、クロック パルスの立ち上がり時間とは直接関係しません。ホールド時間が経過した後、D 入力のデータは、出力のレベルに影響を及ぼさずに変更できます。

SNx4AHC74 デュアル ポジティブ エッジ トリガ デバイスは、D タイプ フリップ フロップです。

プリセット (PRE) またはクリア (CLR) 入力を Low レベルにすると、その他の入力レベルに関係なく、出力がセットまたはリセットされます。ここで、PREおよびCLRが非アクティブ (High) の場合、セットアップ時間の要件を満たすデータ (D) 入力のデータは、クロック パルスの正方向エッジで出力に転送されます。クロックのトリガは電圧レベルで発生し、クロック パルスの立ち上がり時間とは直接関係しません。ホールド時間が経過した後、D 入力のデータは、出力のレベルに影響を及ぼさずに変更できます。
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技術資料

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種類 タイトル 最新の英語版をダウンロード 日付
* データシート SNx4AHC74 クリアとプリセット搭載、デュアル・ポジティブ・エッジ・トリガ D タイプ・フリップ・フロップ データシート (Rev. N 翻訳版) PDF | HTML 英語版 (Rev.N) PDF | HTML 2024年 2月 20日
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アプリケーション・ノート Migration From 3.3-V To 2.5-V Power Supplies For Logic Devices 1997年 12月 1日
アプリケーション・ノート Bus-Interface Devices With Output-Damping Resistors Or Reduced-Drive Outputs (Rev. A) 1997年 8月 1日
アプリケーション・ノート CMOS Power Consumption and CPD Calculation (Rev. B) 1997年 6月 1日
アプリケーション・ノート Live Insertion 1996年 10月 1日

設計と開発

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パッケージ ピン数 ダウンロード
CDIP (J) 14 オプションの表示
CFP (W) 14 オプションの表示
LCCC (FK) 20 オプションの表示
TI の評価品に関する標準契約約款が適用されます。

購入と品質

記載されている情報：
  • RoHS
  • REACH
  • デバイスのマーキング
  • リード端子の仕上げ / ボールの原材料
  • MSL 定格 / ピーク リフロー
  • MTBF/FIT 推定値
  • 材質成分
  • 認定試験結果
  • 継続的な信頼性モニタ試験結果
記載されている情報：
  • ファブの拠点
  • 組み立てを実施した拠点

サポートとトレーニング

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