SN54LS91
- For applications in:
- Digital Computer Systems
- Data-Handling Systems
- Control Systems
| TYPE
|
TYPICAL
MAXIMUM CLOCK FREQUENCY |
TYPICAL
POWER DISSIPATION | |||
|---|---|---|---|---|---|
These monolithic serial-in, serial-out, 8-bit shift registers utilize transistor-transistor logic (TTL) circuits and are composed of eight R-S master-slave flip-flops, input gating, and a clock driver. Single-rail data and input control are gated through inputs A and B and an interanl inverter to form the complementary inputs to the first bit of the shift register. Drive for the internal common clock line is provided by an inverting clock driver. This clock pulse inverter/driver causes these circuits to shift information one bit on the positive edge of an input clock pulse.
技術資料
結果が見つかりませんでした。検索条件をクリアしてから、再度検索を試してください。
1 をすべて表示
| 上位の文書 | タイプ | タイトル | フォーマットオプション | 最新の英語版をダウンロード | 日付 | |
|---|---|---|---|---|---|---|
| * | データシート | 8-Bit Shift Registers データシート | 1988/03/01 |