SN54LS91
- For applications in:
- Digital Computer Systems
- Data-Handling Systems
- Control Systems
TYPE | TYPICAL MAXIMUM CLOCK FREQUENCY | TYPICAL POWER DISSIPATION | |||
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These monolithic serial-in, serial-out, 8-bit shift registers utilize transistor-transistor logic (TTL) circuits and are composed of eight R-S master-slave flip-flops, input gating, and a clock driver. Single-rail data and input control are gated through inputs A and B and an interanl inverter to form the complementary inputs to the first bit of the shift register. Drive for the internal common clock line is provided by an inverting clock driver. This clock pulse inverter/driver causes these circuits to shift information one bit on the positive edge of an input clock pulse.
技術資料
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12 をすべて表示 種類 | タイトル | 最新の英語版をダウンロード | 日付 | |||
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ユーザー・ガイド | LOGIC Pocket Data Book (Rev. B) | 2007年 1月 16日 | ||||
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アプリケーション・ノート | Live Insertion | 1996年 10月 1日 |
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