1:2 PECL/ECL Fanout Buffer
Operating Range
- PECL: V_CC = 4.2 V to 5.7 V With V_EE = 0 V
- NECL: V_CC = 0 V With V_EE = -4.2 V to -5.7 V
5-ps Skew Between Outputs
Support for Clock Frequencies >2.5 GHz
265-ps Typical Propagation Delay
Deterministic Output Value for Open Input Conditions
Drop-In Compatible With MC10EL11, MC100EL11
Built-In Input Pulldown Resistors
Built-In Temperature Compensation
APPLICATIONS
- Data and Clock Transmission Over Backplane
- Signaling Level Conversion

1:2 PECL/ECL Fanout Buffer
Operating Range
- PECL: V_CC = 4.2 V to 5.7 V With V_EE = 0 V
- NECL: V_CC = 0 V With V_EE = -4.2 V to -5.7 V
5-ps Skew Between Outputs
Support for Clock Frequencies >2.5 GHz
265-ps Typical Propagation Delay
Deterministic Output Value for Open Input Conditions
Drop-In Compatible With MC10EL11, MC100EL11
Built-In Input Pulldown Resistors
Built-In Temperature Compensation
APPLICATIONS
- Data and Clock Transmission Over Backplane
- Signaling Level Conversion

The SN65EL11 is a differential 1:2 PECL/ECL fanout buffer. The device includes circuitry to maintain a known logic level when inputs are in an open condition. The SN65EL11 is housed in an industry-standard SOIC-8 package and is also available in a TSSOP-8 package.

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	類型	標題		日期
*	Data sheet	5-V PECL/ECL 1:2 Fanout Buffer datasheet		2008年 11月 26日
	Application note	AC Coupling Between Differential LVPECL, LVDS, HSTL and CML (Rev. C)		2007年 10月 17日

設計與開發

如需其他條款或必要資源，請按一下下方的任何標題以檢視詳細頁面 (如有)。

模擬型號

SN65EL11 IBIS Model Version 1.1

SLLM048.ZIP (15 KB) - IBIS Model

下載

模擬工具

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要求

模擬工具

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TINA-TI provides all the conventional DC, transient and frequency domain analysis of SPICE and much more. TINA has extensive post-processing capability that allows you to format results the way you want them. Virtual instruments allow you to select input waveforms and probe circuit nodes voltages (...)

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