JAJSKX3A December   2020  – May 2022 UCC27289

PRODUCTION DATA  

  1.   1
  2. 1 特長
  3. 2 アプリケーション
  4. 3 説明
  5. 4 改訂履歴
  6. 5 ピン構成および機能
  7. 6 仕様
    1. 6.1 絶対最大定格
    2. 6.2 ESD 定格
    3. 6.3 推奨動作条件
    4. 6.4 熱に関する情報
    5. 6.5 電気的特性
    6. 6.6 スイッチング特性
    7. 6.7 代表的特性
  8. 7 詳細説明
    1. 7.1 概要
    2. 7.2 機能ブロック図
    3. 7.3 機能説明
      1. 7.3.1 イネーブル
      2. 7.3.2 起動と UVLO
      3. 7.3.3 入力段
      4. 7.3.4 レベル・シフタ
      5. 7.3.5 出力段
      6. 7.3.6 負の電圧過渡
    4. 7.4 デバイスの機能モード
  9. 8 アプリケーションと実装
    1. 8.1 アプリケーション情報
    2. 8.2 代表的なアプリケーション
      1. 8.2.1 設計要件
      2. 8.2.2 詳細な設計手順
        1. 8.2.2.1 ブートストラップおよび VDD コンデンサの選択
        2. 8.2.2.2 外部ブートストラップ・ダイオードと直列抵抗
        3. 8.2.2.3 ドライバの電力損失の推定
        4. 8.2.2.4 外付けゲート抵抗の選択
        5. 8.2.2.5 遅延およびパルス幅
        6. 8.2.2.6 VDD および入力フィルタ
        7. 8.2.2.7 過渡保護
      3. 8.2.3 アプリケーション曲線
  10. 9 電源に関する推奨事項
  11. 10レイアウト
    1. 10.1 レイアウトのガイドライン
    2. 10.2 レイアウト例
  12. 11デバイスおよびドキュメントのサポート
    1. 11.1 ドキュメントの更新通知を受け取る方法
    2. 11.2 サポート・リソース
    3. 11.3 商標
    4. 11.4 静電気放電に関する注意事項
    5. 11.5 用語集
  13. 12メカニカル、パッケージ、および注文情報

パッケージ・オプション

メカニカル・データ（パッケージ｜ピン）
サーマルパッド・メカニカル・データ
発注情報

8.2.2.5 遅延およびパルス幅

PWM、ドライバ、および電力段で発生する合計遅延は、主として電流制限応答の遅延ですが、他にもいくつかの原因を考慮する必要があります。また、ドライバ間の遅延の違いも考慮する必要があります。この場合、トポロジによってはさまざまな問題が発生する可能性があります。同期整流降圧トポロジのスイッチングでは、クロス導通および過剰なボディ・ダイオード導通を避けるため、ハイサイド・スイッチとローサイド・スイッチの間のデッドタイムを慎重に選択する必要があります。

どのような動作条件でも、ハイサイドとローサイドのパルス幅に不均衡が生じた場合、トランスのボルト秒不均衡がブリッジ・トポロジに影響を及ぼす可能性があります。UCC27289 デバイスは、プロセスおよび温度変動全体にわたって、最大伝搬遅延が 30ns、遅延マッチングが 7ns であり、これは業界でもトップクラスの性能です。

入力パルス幅が非常に小さい場合には、出力が入力信号に十分に追従しない可能性があるため、ゲート・ドライバ・デバイスでは、小さい入力パルス幅に対する性能が重要な考慮事項になります。コントローラからの PWM 出力信号は、定常状態では比較的広くなる可能性がありますが、以下の動作条件では非常に小さい幅のパルスが発生することがあります。

  • ソフトスタート期間
  • 大きな負荷過渡
  • 短絡状態

小さい幅のパルスは、ゲート・ドライバ・デバイスへの入力信号として現れるので、ゲート・ドライバ・デバイスは、これらの小さい幅の信号に適切に応答する必要があります。

図 8-2 は、入力パルス幅が非常に小さい場合であっても、UCC27289 デバイスが信頼性の高い出力パルスを生成することを示しています。入力パルス幅が非常に小さい場合でも、伝搬遅延と遅延マッチングは影響を受けません。

GUID-A8739128-2A6D-4862-ACE8-CEBD3542100C-low.gif図 8-2 入力および出力パルス幅