CDCDB400
- 4 つの LP-HCSL 出力、プログラム可能な内蔵 85Ω (デフォルト) または 100Ω 差動出力終端付き
- 4 つのハードウェア出力イネーブル (OE#) 制御
-
PCIe Gen 7 フィルタ後の付加位相ジッタ：11.3fs、RMS (最大値)
- PCIe Gen 6 フィルタ後の付加位相ジッタ：16.1fs、RMS (最大値)
- PCIe Gen 5 フィルタ後の付加位相ジッタ：25fs、RMS (最大値)
- DB2000Q フィルタ後の付加位相ジッタ：38fs、RMS (最大値)
- 共通クロック (CC) アーキテクチャと個別リファレンス (IR) アーキテクチャをサポート
- スペクトラム拡散対応
- 出力間スキュー：< 50ps
- 入出力間遅延：3ns 未満
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フェイルセーフ入力
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プログラマブルな出力スルーレート制御機能
-
3 つの選択可能な SMBus アドレス
- コアおよび入出力電源電圧：3.3V
- ハードウェア制御による低消費電力モード (PD#)
- 消費電流：46mA 以下
- 5mm × 5mmの 32 ピン VQFN パッケージ
CDCDB400 は、PCIe Gen 1～7、QuickPath Interconnect (QPI)、UPI、SAS、SATA インターフェイス用のリファレンス クロックを分配できる 4 出力 LP-HCSL、DB800ZL 準拠クロック バッファです。SMBus インターフェイスおよび 4 本の出力イネーブル ピンにより、4 個の出力すべてを個別に設定および制御できます。CDCDB400 は DB800ZL から派生したバッファであり、DB800ZL 仕様のシステム パラメータと同等またはそれを上回る性能を備えています。このデバイスは、DB2000Q 仕様のパラメータと同等またはそれを上回る性能も備えています。CDCDB400 は、5mm × 5mm の 32 ピン VQFN パッケージで供給されます。
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技術資料
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| 上位の文書 | タイプ | タイトル | フォーマットオプション | 最新の英語版をダウンロード | 日付 | |
|---|---|---|---|---|---|---|
| * | データシート | CDCDB400 PCIe Gen 1～Gen 7 向け DB800ZL 準拠 4 出力 クロック バッファ データシート (Rev. B 翻訳版) | PDF | HTML | 英語版 (Rev.B) | PDF | HTML | 2025/10/13 |
設計と開発
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評価ボード
CDCDB800EVM — CDCDB800 評価基板は、PCIe® Gen 1 ～ Gen 5 の各種アプリケーションに適した 8 出力 LP-HCSL クロック バッファです
CDCDB800 評価基板は、LP-HCSL (低消費電力のホスト クロック信号レベル) を供給する DB800ZL に準拠した 8 出力のクロック バッファであり、PCIe® Gen 1 ～ Gen 5 の各アプリケーションや、QPI (QuickPath Interconnect)、UPI、SAS、SATA の各インターフェイスで、リファレンス クロックを分配することができます。SMBus インターフェイスと 8 出力を採用した結果、ピンで 8 個の出力すべてを個別に構成および制御することができます。CDCDB800 は、DB800ZL から派生したバッファであり、DB800ZL と (...)
在庫あり
制限：
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入手不可
設計ツール
PLLATINUMSIM-SW — PLL ループ フィルタ、位相ノイズ、ロック時間、スプア シミュレーション ツール
PLLATINUMSIM-SW は、開発ユーザーが TI の各種 PLLatinum™ IC の詳細な設計とシミュレーションを行うためのシミュレーション ツールです。これらの IC は LMX シリーズのフェーズ ロック ループ (PLL) とシンセサイザを搭載しています。
| パッケージ | ピン数 | CAD シンボル、フットプリント、および 3D モデル |
|---|---|---|
| VQFN (RHB) | 32 | Ultra Librarian |
購入と品質
推奨製品には、この TI 製品に関連するパラメータ、評価基板、またはリファレンス デザインが存在する可能性があります。