TPS7A57
- 入力電圧範囲:
- BIAS なし:1.1V ~ 6.0V
- BIAS あり:0.7V ~ 6.0V
- 1V 以下のコア電圧に対して LILO 動作を有効にします
- 可変出力電圧範囲:0.5V ~ 5.2V
- 単一の外付け抵抗 (RREF) で設定
- VOUT = IREF × RREF
- ユニティ ゲイン アーキテクチャにより、全範囲にわたって低ノイズを維持します
- 出力電圧ノイズ:2.45µVRMS (10Hz - 100kHz、CNR/SS = 4.7µF)
- ノイズは VOUT に応じてスケーリングされません
- ライン、負荷、温度の全範囲にわたって 1% (最大値) の精度
- 低いドロップアウト:5A 時に 75mV
- VOUT から独立したドロップアウト
- 電源電圧変動除去比 (5A):
- 1kHz 時に 100dB
- 10kHz 時に 78dB
- 100kHz 時に 60dB
- 1MHz において 36dB (高電流 LDO として業界トップクラス)
- 負荷過渡応答:
- 100mA~5A の負荷ステップで ±2mV
- 高いループ帯域幅 (約 1MHz) により高速応答を実現
- プログラム可能なソフトスタート:CNR/SS を使用
- デュアル機能 - 突入制御 + ノイズ フィルタリング
- バイアス レールの柔軟性:
- 内部チャージ ポンプ (CP_EN) または 3V ~ 11V の外部電源レールを使用可能
- スイッチング ノイズをゼロにするために、内部チャージ ポンプを無効にできます
- パワー グッド表示 (PG):オープン ドレイン出力:
- スレッショルド:VOUT の 90%
- ヒステリシス:2%
- パッケージ:3mm x 3mm、16 ピン WQFN (RTE)
- 放熱性能: RθJA: 21.9°C/W (評価基板のレイアウト)
TPS7A57 は、超低ノイズ (2.45µVRMS) かつ高電流 (5A) に対応したリニアレギュレータであり、優れた電源品質を必要とするノイズに敏感なアナログおよびデジタル負荷向けに設計されています。75mV のドロップアウト、1MHz における 36dB の PSRR、1% の精度を特長とするこの LDO は、内部チャージ ポンプまたは外部バイアス レールを用いて、0.7V ~ 6V の入力電圧で動作します。この LDO は、レーダー、RF、SERDES、および高精度計測機器用途向けに設計されています。
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技術資料
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設計と開発
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| パッケージ | ピン数 | CAD シンボル、フットプリント、および 3D モデル |
|---|---|---|
| WQFN (RTE) | 16 | Ultra Librarian |
購入と品質
推奨製品には、この TI 製品に関連するパラメータ、評価基板、またはリファレンス デザインが存在する可能性があります。