JAJSGI4C November   2018  – March 2025 ADC12DJ3200QML-SP

PRODUCTION DATA  

  1.   1
  2. 1 特長
  3. 2 アプリケーション
  4. 3 説明
  5. 4 ピン構成および機能
  6. 5 仕様
    1. 5.1  絶対最大定格
    2. 5.2  ESD 定格
    3. 5.3  推奨動作条件
    4. 5.4  熱に関する情報
    5. 5.5  電気的特性：DC の仕様
    6. 5.6  電気的特性：消費電力
    7. 5.7  電気的特性：AC 仕様 (デュアル チャネル モード)
    8. 5.8  電気的特性：AC 仕様 (シングル チャネル モード)
    9. 5.9  タイミング要件
    10. 5.10 スイッチング特性
    11. 5.11 タイミング図
    12. 5.12 代表的特性
  7. 6 詳細説明
    1. 6.1 概要
    2. 6.2 機能ブロック図
    3. 6.3 機能説明
      1. 6.3.1 アナログ入力
        1. 6.3.1.1 アナログ入力保護
        2. 6.3.1.2 フルスケール電圧 (VFS) の調整
        3. 6.3.1.3 アナログ入力オフセットの調整
      2. 6.3.2 ADC コア
        1. 6.3.2.1 ADC の動作原理
        2. 6.3.2.2 ADC コアのキャリブレーション
        3. 6.3.2.3 ADC のオーバーレンジ検出
        4. 6.3.2.4 コード エラー レート (CER)
      3. 6.3.3 タイムスタンプ
      4. 6.3.4 クロック供給
        1. 6.3.4.1 ノイズなしのアパーチャ遅延調整 (tAD 調整)
        2. 6.3.4.2 アパーチャ遅延ランプ制御 (TAD_RAMP)
        3. 6.3.4.3 SYSREF キャプチャによるマルチ デバイス同期および決定論的レイテンシ
          1. 6.3.4.3.1 SYSREF 位置検出器およびサンプリング位置選択 (SYSREF ウィンドウ処理)
          2. 6.3.4.3.2 SYSREF 自動較正
      5. 6.3.5 デジタル ダウン コンバータ (デュアル チャネル モードのみ)
        1. 6.3.5.1 数値制御オシレータと複素ミキサ
          1. 6.3.5.1.1 NCO 高速周波数ホッピング (FFH)
          2. 6.3.5.1.2 NCO の選択
          3. 6.3.5.1.3 基本 NCO 周波数設定モード
          4. 6.3.5.1.4 有理 NCO 周波数設定モード
          5. 6.3.5.1.5 NCO 位相オフセット設定
          6. 6.3.5.1.6 NCO 位相同期
        2. 6.3.5.2 デシメーション フィルタ
        3. 6.3.5.3 出力データ フォーマット
        4. 6.3.5.4 デシメーション設定
          1. 6.3.5.4.1 デシメーション係数
          2. 6.3.5.4.2 DDC ゲイン ブースト
      6. 6.3.6 JESD204B インターフェイス
        1. 6.3.6.1 トランスポート層
        2. 6.3.6.2 スクランブル機能
        3. 6.3.6.3 リンク層
          1. 6.3.6.3.1 コード グループ同期 (CGS)
          2. 6.3.6.3.2 初期レーン整列シーケンス (ILAS)
          3. 6.3.6.3.3 8b/10b エンコーディング
          4. 6.3.6.3.4 フレームおよびマルチフレーム監視
        4. 6.3.6.4 物理層
          1. 6.3.6.4.1 SerDes プリエンファシス
        5. 6.3.6.5 JESD204B 対応
        6. 6.3.6.6 複数デバイスの同期と決定論的レイテンシ
        7. 6.3.6.7 Subclass 0 システムでの動作
      7. 6.3.7 アラームの監視
        1. 6.3.7.1 NCO エラー検出
        2. 6.3.7.2 クロック エラー検出
      8. 6.3.8 温度監視ダイオード
      9. 6.3.9 アナログ基準電圧
    4. 6.4 デバイスの機能モード
      1. 6.4.1 デュアル チャネル モード
      2. 6.4.2 シングル チャネル モード (DES モード)
      3. 6.4.3 JESD204B モード
        1. 6.4.3.1 JESD204B 出力データ フォーマット
        2. 6.4.3.2 デュアル DDC および冗長データ モード
      4. 6.4.4 パワーダウン モード
      5. 6.4.5 テスト モード
        1. 6.4.5.1 シリアライザのテスト モードの詳細
        2. 6.4.5.2 PRBS テスト モード
        3. 6.4.5.3 ランプ テスト モード
        4. 6.4.5.4 ショートおよびロング トランスポート テスト モード
          1. 6.4.5.4.1 ショート トランスポート テスト パターン
          2. 6.4.5.4.2 ロング トランスポート テスト パターン
        5. 6.4.5.5 D21.5 テスト モード
        6. 6.4.5.6 K28.5 テスト モード
        7. 6.4.5.7 反復 ILA テスト モード
        8. 6.4.5.8 修正 RPAT テスト モード
      6. 6.4.6 キャリブレーション モードとトリミング
        1. 6.4.6.1 フォアグラウンド キャリブレーション モード
        2. 6.4.6.2 バックグラウンド キャリブレーション モード
        3. 6.4.6.3 低消費電力バックグラウンド キャリブレーション (LPBG) モード
      7. 6.4.7 オフセット キャリブレーション
      8. 6.4.8 トリミング
      9. 6.4.9 オフセット フィルタリング
    5. 6.5 プログラミング
      1. 6.5.1 シリアル インターフェイスの使い方
        1. 6.5.1.1 SCS
        2. 6.5.1.2 SCLK
        3. 6.5.1.3 SDI
        4. 6.5.1.4 SDO
        5. 6.5.1.5 ストリーミング モード
    6. 6.6 レジスタマップ
      1. 6.6.1 レジスタの説明
      2. 6.6.2 SYSREF 較正レジスタ (0x2B0 ～ 0x2BF)
      3. 6.6.3 アラーム レジスタ (0x2C0 ～ 0x2C2)
  8. 7 アプリケーション情報に関する免責事項
    1. 7.1 アプリケーション情報
      1. 7.1.1 アナログ入力
      2. 7.1.2 アナログ入力帯域幅
      3. 7.1.3 クロック供給
      4. 7.1.4 放射線環境に関する推奨事項
        1. 7.1.4.1 シングル イベント ラッチアップ (SEL)
        2. 7.1.4.2 シングル イベント機能割り込み (SEFI)
        3. 7.1.4.3 シングル イベント アップセット (SEU)
    2. 7.2 代表的なアプリケーション
      1. 7.2.1 設計要件
      2. 7.2.2 詳細な設計手順
        1. 7.2.2.1 RF 入力信号路
        2. 7.2.2.2 AC カップリング コンデンサの値の計算
      3. 7.2.3 アプリケーション曲線
    3. 7.3 初期化セットアップ
    4.     電源に関する推奨事項
      1. 7.4.1 電源シーケンス
    5. 7.4 レイアウト
      1. 7.4.1 レイアウトのガイドライン
      2. 7.4.2 レイアウト例
  9. 8 デバイスおよびドキュメントのサポート
    1. 8.1 デバイス サポート
      1. 8.1.1 開発サポート
    2. 8.2 ドキュメントのサポート
      1. 8.2.1 関連資料
    3. 8.3 サード・パーティ製品に関する免責事項
    4. 8.4 ドキュメントの更新通知を受け取る方法
    5. 8.5 サポート・リソース
    6. 8.6 商標
    7. 8.7 静電気放電に関する注意事項
    8. 8.8 用語集
  10. 9 改訂履歴
  11. 10メカニカル、パッケージ、および注文情報

4 ピン構成および機能

ADC12DJ3200QML-SP ZMX (CGLA) および NWE (CCGA) パッケージ196 パッド フリップ チップ セラミック LGA (上面図)図 4-1 ZMX (CGLA) および NWE (CCGA) パッケージ
196 パッド フリップ チップ セラミック LGA (上面図)
表 4-1 ピンの機能
ピン タイプ 説明
名称 番号
AGND(1) A1、A3、A6、B1、B3、B4、B6、B6、C6、C7、D4、D5、D6、D7、E4、E5、E6、E7、F1、F4、F5、F6、F7、G2、G4、G5、G6、G7、H2、H4、H5、H6、H7、J1、J4、J5、J6、J7、K4、K5、K6、K7、L4、L5、L6、L7、M6、M7、N1、N3、N4、N5、N6、P1、P3、P6 — アナログ電源の接地。AGND および DGND は基板に直接接続する必要があります。
BG A2 O バンドギャップ電圧出力。このピンは 100μA をソースでき、最大 80pF の負荷を駆動できます。詳細については、「アナログ リファレンス電圧」セクションを参照してください。このピンは、使用しない場合は接続解除できます。
CALSTAT B9 O フォアグラウンド キャリブレーション ステータス出力またはデバイス アラーム出力。機能は CAL_STATUS_SEL によってプログラムされます。このピンは、使用しない場合は接続解除できます。
CALTRIG A9 I フォアグラウンド キャリブレーション トリガ入力。このピンは、CAL_TRIG_EN でハードウェア キャリブレーション トリガが選択されている場合にのみ使用されます。それ以外の場合は、CAL_SOFT_TRIG を使用してソフトウェア トリガが実行されます。このピンを使用しない場合は GND に接続してください。
CLK+ G1 I デバイス (サンプリング) クロックの正の入力。クロック信号は、この入力に AC 結合する必要があります。シングル チャネル モードでは、立ち上がりエッジと立ち下がりエッジの両方でアナログ入力信号がサンプリングされます。デュアル チャネル モードでは、立ち上がりエッジでアナログ信号がサンプリングされます。この差動入力は 100Ω の差動終端を内蔵し、最適な入力同相電圧に自己バイアスされます。
CLK– H1 I デバイス (サンプリング) クロックの負の入力。AC 結合が必要です。
DA0+ E14 O チャネル A、レーン 0、正接続の高速シリアル化データ出力。この差動出力は AC 結合する必要があり、レシーバに接続された 100Ω の差動終端で常に終端する必要があります。このピンを使用しない場合は接続解除するか、0Ω ~ 1MΩ の抵抗を使用してGND（0V）とVD11（1.1V）の間の任意の電圧レベルに接続できます。
DA0– F14 O チャネル A、レーン 0、負接続の高速シリアル化データ出力。このピンを使用しない場合は接続解除するか、0Ω ～ 1MΩ の抵抗を使用して GND (0V) と VD11 (1.1V) の間の任意の電圧レベルに接続できます。
DA1+ C14 O チャネル A、レーン 1、正接続の高速シリアル化データ出力。この差動出力は AC 結合する必要があり、レシーバに接続された 100Ω の差動終端で常に終端する必要があります。このピンを使用しない場合は接続解除するか、0Ω ~ 1MΩ の抵抗を使用してGND（0V）とVD11（1.1V）の間の任意の電圧レベルに接続できます。
DA1– D14 O チャネル A、レーン 1、負接続の高速シリアル化データ出力。このピンを使用しない場合は接続解除するか、0Ω ～ 1MΩ の抵抗を使用して GND (0V) と VD11 (1.1V) の間の任意の電圧レベルに接続できます。
DA2+ A12 O チャネル A、レーン 2、正接続の高速シリアル化データ出力。この差動出力は AC 結合する必要があり、レシーバに接続された 100Ω の差動終端で常に終端する必要があります。このピンを使用しない場合は接続解除するか、0Ω ～ 1MΩ の抵抗を使用して GND (0V) と VD11 (1.1V) の間の任意の電圧レベルに接続できます。
DA2– A13 O チャネル A、レーン 2、負接続の高速シリアル化データ出力。このピンを使用しない場合は接続解除するか、0Ω ～ 1MΩ の抵抗を使用して GND (0V) と VD11 (1.1V) の間の任意の電圧レベルに接続できます。
DA3+ A10 O チャネル A、レーン 3、正接続の高速シリアル化データ出力。この差動出力は AC 結合する必要があり、レシーバに接続された 100Ω の差動終端で常に終端する必要があります。このピンを使用しない場合は接続解除するか、0Ω ～ 1MΩ の抵抗を使用して GND (0V) と VD11 (1.1V) の間の任意の電圧レベルに接続できます。
DA3– A11 O チャネル A、レーン 3、負接続の高速シリアル化データ出力。このピンを使用しない場合は接続解除するか、0Ω ～ 1MΩ の抵抗を使用して GND (0V) と VD11 (1.1V) の間の任意の電圧レベルに接続できます。
DA4+ E13 O チャネル A、レーン 4、正接続の高速シリアル化データ出力。この差動出力は AC 結合する必要があり、レシーバに接続された 100Ω の差動終端で常に終端する必要があります。このピンを使用しない場合は接続解除するか、0Ω ～ 1MΩ の抵抗を使用して GND (0V) と VD11 (1.1V) の間の任意の電圧レベルに接続できます。
DA4– F13 O チャネル A、レーン 4、負接続の高速シリアル化データ出力。このピンを使用しない場合は接続解除するか、0Ω ～ 1MΩ の抵抗を使用して GND (0V) と VD11 (1.1V) の間の任意の電圧レベルに接続できます。
DA5+ C13 O チャネル A、レーン 5、正接続の高速シリアル化データ出力。この差動出力は AC 結合する必要があり、レシーバに接続された 100Ω の差動終端で常に終端する必要があります。このピンを使用しない場合は接続解除するか、0Ω ～ 1MΩ の抵抗を使用して GND (0V) と VD11 (1.1V) の間の任意の電圧レベルに接続できます。
DA5– D13 O チャネル A、レーン 5、負接続の高速シリアル化データ出力。このピンを使用しない場合は接続解除するか、0Ω ～ 1MΩ の抵抗を使用して GND (0V) と VD11 (1.1V) の間の任意の電圧レベルに接続できます。
DA6+ B12 O チャネル A、レーン 6、正接続の高速シリアル化データ出力。この差動出力は AC 結合する必要があり、レシーバに接続された 100Ω の差動終端で常に終端する必要があります。このピンを使用しない場合は接続解除するか、0Ω ～ 1MΩ の抵抗を使用して GND (0V) と VD11 (1.1V) の間の任意の電圧レベルに接続できます。
DA6– B13 O チャネル A、レーン 6、負接続の高速シリアル化データ出力。このピンを使用しない場合は接続解除するか、0Ω ～ 1MΩ の抵抗を使用して GND (0V) と VD11 (1.1V) の間の任意の電圧レベルに接続できます。
DA7+ B10 O チャネル A、レーン 7、正接続の高速シリアル化データ出力。この差動出力は AC 結合する必要があり、レシーバに接続された 100Ω の差動終端で常に終端する必要があります。このピンを使用しない場合は接続解除するか、0Ω ～ 1MΩ の抵抗を使用して GND (0V) と VD11 (1.1V) の間の任意の電圧レベルに接続できます。
DA7– B11 O チャネル A、レーン 7、負接続の高速シリアル化データ出力。このピンを使用しない場合は接続解除するか、0Ω ～ 1MΩ の抵抗を使用して GND (0V) と VD11 (1.1V) の間の任意の電圧レベルに接続できます。
DB0+ K14 O チャネル B、レーン 0、正接続の高速シリアル化データ出力。この差動出力は AC 結合する必要があり、レシーバに接続された 100Ω の差動終端で常に終端する必要があります。このピンを使用しない場合は接続解除するか、0Ω ～ 1MΩ の抵抗を使用して GND (0V) と VD11 (1.1V) の間の任意の電圧レベルに接続できます。
DB0– J14 O チャネル B、レーン 0、負接続の高速シリアル化データ出力。このピンを使用しない場合は接続解除するか、0Ω ～ 1MΩ の抵抗を使用して GND (0V) と VD11 (1.1V) の間の任意の電圧レベルに接続できます。
DB1+ M14 O チャネル B、レーン 1、正接続の高速シリアル化データ出力。この差動出力は AC 結合する必要があり、レシーバに接続された 100Ω の差動終端で常に終端する必要があります。このピンを使用しない場合は接続解除するか、0Ω ～ 1MΩ の抵抗を使用して GND (0V) と VD11 (1.1V) の間の任意の電圧レベルに接続できます。
DB1– L14 O チャネル B、レーン 1、負接続の高速シリアル化データ出力。このピンを使用しない場合は接続解除するか、0Ω ～ 1MΩ の抵抗を使用して GND (0V) と VD11 (1.1V) の間の任意の電圧レベルに接続できます。
DB2+ P12 O チャネル B、レーン 2、正接続の高速シリアル化データ出力。この差動出力は AC 結合する必要があり、レシーバに接続された 100Ω の差動終端で常に終端する必要があります。このピンを使用しない場合は接続解除するか、0Ω ～ 1MΩ の抵抗を使用して GND (0V) と VD11 (1.1V) の間の任意の電圧レベルに接続できます。
DB2– P13 O チャネル B、レーン 2、負接続の高速シリアル化データ出力。このピンを使用しない場合は接続解除するか、0Ω ～ 1MΩ の抵抗を使用して GND (0V) と VD11 (1.1V) の間の任意の電圧レベルに接続できます。
DB3+ P10 O チャネル B、レーン 3、正接続の高速シリアル化データ出力。この差動出力は AC 結合する必要があり、レシーバに接続された 100Ω の差動終端で常に終端する必要があります。このピンを使用しない場合は接続解除するか、0Ω ～ 1MΩ の抵抗を使用して GND (0V) と VD11 (1.1V) の間の任意の電圧レベルに接続できます。
DB3– P11 O チャネル B、レーン 3、負接続の高速シリアル化データ出力。このピンを使用しない場合は接続解除するか、0Ω ～ 1MΩ の抵抗を使用して GND (0V) と VD11 (1.1V) の間の任意の電圧レベルに接続できます。
DB4+ K13 O チャネル B、レーン 4、正接続の高速シリアル化データ出力。この差動出力は AC 結合する必要があり、レシーバに接続された 100Ω の差動終端で常に終端する必要があります。このピンを使用しない場合は接続解除するか、0Ω ～ 1MΩ の抵抗を使用して GND (0V) と VD11 (1.1V) の間の任意の電圧レベルに接続できます。
DB4– J13 O チャネル B、レーン 4、負接続の高速シリアル化データ出力。このピンを使用しない場合は接続解除するか、0Ω ～ 1MΩ の抵抗を使用して GND (0V) と VD11 (1.1V) の間の任意の電圧レベルに接続できます。
DB5+ M13 O チャネル B、レーン 5、正接続の高速シリアル化データ出力。この差動出力は AC 結合する必要があり、レシーバに接続された 100Ω の差動終端で常に終端する必要があります。このピンを使用しない場合は接続解除するか、0Ω ～ 1MΩ の抵抗を使用して GND (0V) と VD11 (1.1V) の間の任意の電圧レベルに接続できます。
DB5– L13 O チャネル B、レーン 5、負接続の高速シリアル化データ出力。このピンを使用しない場合は接続解除するか、0Ω ～ 1MΩ の抵抗を使用して GND (0V) と VD11 (1.1V) の間の任意の電圧レベルに接続できます。
DB6+ N12 O チャネル B、レーン 6、正接続の高速シリアル化データ出力。この差動出力は AC 結合する必要があり、レシーバに接続された 100Ω の差動終端で常に終端する必要があります。このピンを使用しない場合は接続解除するか、0Ω ～ 1MΩ の抵抗を使用して GND (0V) と VD11 (1.1V) の間の任意の電圧レベルに接続できます。
DB6– N13 O チャネル B、レーン 6、負接続の高速シリアル化データ出力。このピンを使用しない場合は接続解除するか、0Ω ～ 1MΩ の抵抗を使用して GND (0V) と VD11 (1.1V) の間の任意の電圧レベルに接続できます。
DB7+ N10 O チャネル B、レーン 7、正接続の高速シリアル化データ出力。この差動出力は AC 結合する必要があり、レシーバに接続された 100Ω の差動終端で常に終端する必要があります。このピンを使用しない場合は接続解除するか、0Ω ～ 1MΩ の抵抗を使用して GND (0V) と VD11 (1.1V) の間の任意の電圧レベルに接続できます。
DB7– N11 O チャネル B、レーン 7、負接続の高速シリアル化データ出力。このピンを使用しない場合は接続解除するか、0Ω ～ 1MΩ の抵抗を使用して GND (0V) と VD11 (1.1V) の間の任意の電圧レベルに接続できます。
DGND A14、B14、C8、C9、D8、D9、D10、D11、E8、E9、E10、E11、F8、F9、F10、F11、G8、G9、G10、G11、H8、H9、H10、H11、J8、J9、J10、J11、K8、K9、K10、K11、L8、L9、L10、L11、M8、M9、N9、N14、P14 — デジタル電源の接地。AGND および DGND は基板に直接接続する必要があります。
INA+ A4 I チャネル A アナログ入力の正接続。差動フルスケール入力範囲は、フルスケール電圧調整レジスタによって決定されます。入力同相電圧は、AGND に設定する必要があります。この入力は、50Ω の終端抵抗を経由してグランドに終端されます。性能が最適化されているため、シングル チャネル モードには INA の使用を推奨します。このピンは、使用しない場合は接続解除できます。
INA– A5 I チャネル A アナログ入力の負接続。この入力は、50Ω の終端抵抗を経由してグランドに終端されます。性能が最適化されているため、シングル チャネル モードには INA の使用を推奨します。このピンは、使用しない場合は接続解除できます。
INB+ P4 I チャネル B アナログ入力の正接続。差動フルスケール入力範囲は、フルスケール電圧調整レジスタによって決定されます。入力同相電圧は、AGND に設定する必要があります。この入力は、50Ω の終端抵抗を経由してグランドに終端されます。このピンは、使用しない場合は接続解除できます。
INB– P5 I チャネル B アナログ入力の負接続。この入力は、50Ω の終端抵抗を経由してグランドに終端されます。このピンは、使用しない場合は接続解除できます。
NCOA0 A7 I NCO アキュムレータ選択は DDC A の LSB を制御します。NCOA0 および NCOA1 は、可能な 4 つの NCO のうち、デジタル ミキシングに使用される NCO を選択します。残りの未選択の NCO は、位相コヒーレントを維持するため引き続き動作し、NCOA0 と NCOA1 の値を変更することで交換できます。これは非同期入力です。このピンを使用しない場合は GND に接続してください。
NCOA1 B7 I NCO アキュムレータ選択は DDC A の MSB を制御します。このピンを使用しない場合は GND に接続してください。
NCOB0 P7 I NCO アキュムレータ選択は DDC B の LSB を制御します。NCOB0 および NCOB1 は、可能な 4 つの NCO のうち、デジタル ミキシングに使用される NCO を選択します。残りの未選択の NCO は、位相コヒーレントを維持するため引き続き動作し、NCOB0 と NCOB1 の値を変更することで交換できます。これは非同期入力です。このピンを使用しない場合は GND に接続してください。
NCOB1 N7 I NCO アキュムレータ選択は DDC B の MSB を制御します。このピンを使用しない場合は GND に接続してください。
ORA0 A8 O T0 スレッショルドのチャネル A の高速オーバーレンジ検出ステータス。アナログ入力が OVR_T0 にプログラムされたスレッショルドを超えると、このステータスが High になります。最小パルス幅は OVR_N によって設定されます。このピンは、使用しない場合は接続解除できます。
ORA1 B8 O T1 スレッショルドのチャネル A の高速オーバーレンジ検出ステータス。アナログ入力が OVR_T1 にプログラムされたスレッショルドを超えると、このステータスが High になります。最小パルス幅は OVR_N によって設定されます。このピンは、使用しない場合は接続解除できます。
ORB0 P8 O T0 スレッショルドのチャネル B の高速オーバーレンジ検出ステータス。アナログ入力が OVR_T0 にプログラムされたスレッショルドを超えると、このステータスが High になります。最小パルス幅は OVR_N によって設定されます。このピンは、使用しない場合は接続解除できます。
ORB1 N8 O T1 スレッショルドのチャネル B の高速オーバーレンジ検出ステータス。アナログ入力が OVR_T1 にプログラムされたスレッショルドを超えると、このステータスが High になります。最小パルス幅は OVR_N によって設定されます。このピンは、使用しない場合は接続解除できます。
PD P9 I このピンは、温度ダイオード キャリブレーション専用に High に設定すると、すべてのアナログ回路およびシリアライザ出力を無効化します。電力を節約するため、このピンをデバイスのパワーダウンに使用しないでください。通常動作時はこのピンを GND に接続してください。信頼性の高いシリアライザ動作の詳細については、「パワーダウン モード」セクションを参照してください。
SCLK G14 I シリアル インターフェイス クロック。このピンはシリアル プログラミング データの入出力をクロックするシリアル インターフェイス クロック入力として機能します。「シリアル インターフェイスの使い方」では、シリアル インターフェイスについて詳しく説明しています。このピンは 1.1V ～ 1.9V の CMOS レベルをサポートしています。
SCS G13 I シリアル インターフェイスのチップ セレクトのアクティブ Low 入力。「シリアル インターフェイスの使い方」では、シリアル インターフェイスについて詳しく説明しています。このピンは 1.1V ～ 1.9V の CMOS レベルをサポートしています。このピンには、VD11 への 82kΩ のプルアップ抵抗が搭載されています。
SDI H13 I シリアル インターフェイスのデータ入力。「シリアル インターフェイスの使い方」では、シリアル インターフェイスについて詳しく説明しています。このピンは 1.1V ～ 1.9V の CMOS レベルをサポートしています。
SDO H14 O シリアル インターフェイス データ出力。「シリアル インターフェイスの使い方」では、シリアル インターフェイスについて詳しく説明しています。このピンは、デバイス通常動作中はハイインピーダンスになります。このピンは、シリアルインターフェイスの読み取り動作時に 1.9V CMOS レベルを出力します。このピンは、使用しない場合は接続解除できます。
SYNCSE B2 I JESD204B 同期信号のシングルエンド アクティブ Low 入力。このピンは、JESD204B に必要な同期要求入力を提供します。この入力にロジック Low を印加すると、コード グループの同期と初期レーン整列シーケンスが開始されます。SYNC_SEL をプログラミングすることで、シングルエンドまたは差動 SYNC (TMSTP+ および TMSTP- ピンを使用) の選択を選べます。差動 SYNC (TMSTP±) を JESD204B 同期信号として使用する場合、このピンを GND に接続する必要があります。
SYSREF+ L1 I SYSREF の正入力は、JESD204B インターフェイス全体で同期と決定論的レイテンシを実現するために使用されます。この差動入力 (SYSREF+ ～ SYSREF–) には、100Ω の差動終端が内蔵されています。AC 結合時に入力は自己バイアスされます (SYSREF_LVPECL_EN を 0 に設定する必要があります) が、SYSREF_LVPECL_EN を 1 に設定することで DC 結合することができ、内部終端は各 SYSREF+ および SYSREF- 入力のグランドに対して 50Ω のシングルエンド終端に変化します。DC 結合のときは、同相電圧を推奨範囲内にする必要があります。
SYSREF– M1 I SYSREF 負入力。
TDIODE+ N2 I 温度ダイオードの正 (アノード) 接続。デバイスの接合部温度を監視するため、外部温度センサを TDIODE+ および TDIODE– に接続できます。このピンは、使用しない場合は接続解除できます。
TDIODE– P2 I 温度ダイオードの負 (カソード) 接続。このピンは、使用しない場合は接続解除できます。
TMSTP+ C1 I タイムスタンプ入力の正接続または差動 JESD204B SYNC の正接続。SYNC_SEL が JESD204B 同期信号として SYNCSE を使用するように設定されている場合、この入力はタイムスタンプ入力として使用されます。SYNC_SEL が JESD204B 同期信号として TMSTP+ および TMSTP– を使用するように設定されている場合、この入力は JESD204B 同期信号として使用されます。タイムスタンプ入力としての使用法の詳細については、「タイムスタンプ」セクションを参照してください。SYNCSE を使用し、タイムスタンプが不要な場合、このピンを接続解除できます。
TMSTP– D1 I タイムスタンプ入力の正接続または差動 JESD204B SYNC の負接続。SYNCSE を使用し、タイムスタンプが不要な場合、このピンを接続解除できます。
VA11 D3、E3、F2、F3、G3、H3、J2、J3、K3、L3 I 1.1V アナログ電源。
VA19 C2、C3、C4、C5、D2、E1、E2、K1、K2、L2、M2、M3、M4、M5 I 1.9V アナログ電源。
VD11 C10、C11、C12、D12、E12、F12、G12、H12、J12、K12、L12、M10、M11、M12 I 1.1V デジタル電源。
(1) デバイス リッドは AGND に接続されています。