Este diseño de referencia aborda los desafíos de diseño de sincronización asociados con aplicaciones adaptadas a 5G emergente, como MIMO masivo (mMIMO), radar de antenas en fase y carga útil de comunicaciones. El extremo frontal de RF típico contiene antena, amplificador de bajo ruido (LNA), mezclador, oscilador local (LO) en dominio analógico y convertidor analógico a digital, oscilador controlado por numérico (NCO) y convertidor descendente digital (DDC) en dominio digital. Para lograr la sincronización general del sistema, estos bloques digitales deben sincronizarse con un reloj del sistema. Este diseño de referencia utiliza el convertidor de datos ADC12DJ3200 para lograr un sesgo entre canales de menos de 5 ps en múltiples receptores con latencia determinista, sincronizando el NCO interno con SYNC~ y utilizando la característica de ajuste de retardo de apertura sin ruido (tAD Adjust) para reducir aún más el desfase. Este diseño también proporciona un reloj de ruido de fase muy baja basado en PLL de banda ancha LMX2594 y sintetizador LMK04828 y limpiador de fluctuaciones.
Funciones
- Módulo frontal analógico de alta velocidad de 4 canales, 3.2 GSPS y 6 GHz
- La sincronización NCO en chip permite la sincronización entre varios ADC mediante SYNC~
- Reloj multicanal compatible con JESD204B
- JESD204B compatible con 16 o 32 carriles JESD y velocidades de datos de hasta 12.8 Gbps por carril
- Diseño de referencia de potencia complementario con una eficiencia de >85 % en la entrada 12 V