Inicio Convertidores de datos Convertidores analógico-digitales (ADC) ADC de alta velocidad (≥ 10 MSPS)
Inicio
Convertidores de datos
Convertidores analógico-digitales (ADC)
ADC de alta velocidad (≥ 10 MSPS)

ADC12DJ3200

ACTIVO

Convertidor analógico a digital (ADC) de muestreo de RF de 12 bits, 3,2 GSPS dobles o 6,4 GSPS simpl

Haga su pedido ahora
Hoja de datos

ADC12DJ3200

ACTIVO
Hoja de datos Haga su pedido ahora

Detalles del producto

Sample rate (max) (Msps) 3200, 6400 Resolution (Bits) 12 Number of input channels 1, 2 Interface type JESD204B Analog input BW (MHz) 8000 Features Ultra High Speed Rating Catalog Peak-to-peak input voltage range (V) 0.8 Power consumption (typ) (mW) 3000 Architecture Folding Interpolating SNR (dB) 57.6 ENOB (Bits) 9 SFDR (dB) 75 Operating temperature range (°C) -40 to 85 Input buffer Yes
Sample rate (max) (Msps) 3200, 6400 Resolution (Bits) 12 Number of input channels 1, 2 Interface type JESD204B Analog input BW (MHz) 8000 Features Ultra High Speed Rating Catalog Peak-to-peak input voltage range (V) 0.8 Power consumption (typ) (mW) 3000 Architecture Folding Interpolating SNR (dB) 57.6 ENOB (Bits) 9 SFDR (dB) 75 Operating temperature range (°C) -40 to 85 Input buffer Yes
FCCSP (AAV) 144 100 mm² 10 x 10 FCCSP (ZEG) 144 100 mm² 10 x 10
  • ADC core:
    • 12-bit resolution
    • Up to 6.4 GSPS in single-channel mode
    • Up to 3.2 GSPS in dual-channel mode
  • Performance specifications:
    • Noise floor (no signal, VFS = 1.0 VPP-DIFF):
      • Dual-channel mode: –151.8 dBFS/Hz
      • Single-channel mode: –154.6 dBFS/Hz
    • HD2, HD3: –65 dBc up to 3 GHz
  • Buffered analog inputs with VCMI of 0 V:
    • Analog input bandwidth (–3 dB): 8.0 GHz
    • Usable input frequency range: >10 GHz
    • Full-scale input voltage (VFS, default): 0.8 VPP
    • Analog input common-mode (VICM): 0 V
  • Noiseless aperture delay (TAD) adjustment:
    • Precise sampling control: 19-fs step
    • Simplifies synchronization and interleaving
    • Temperature and voltage invariant delays
  • Easy-to-use synchronization features:
    • Automatic SYSREF timing calibration
    • Timestamp for sample marking
  • JESD204B serial data interface:
    • Supports subclass 0 and 1
    • Maximum lane rate: 12.8 Gbps
    • Up to 16 lanes allows reduced lane rate
  • Digital down-converters in dual-channel mode:
    • Real output: DDC bypass or 2x decimation
    • Complex output: 4x, 8x, or 16x decimation
    • Four independent 32-Bit NCOs per DDC
  • Power consumption: 3 W
  • Power supplies: 1.1 V, 1.9 V
  • ADC core:
    • 12-bit resolution
    • Up to 6.4 GSPS in single-channel mode
    • Up to 3.2 GSPS in dual-channel mode
  • Performance specifications:
    • Noise floor (no signal, VFS = 1.0 VPP-DIFF):
      • Dual-channel mode: –151.8 dBFS/Hz
      • Single-channel mode: –154.6 dBFS/Hz
    • HD2, HD3: –65 dBc up to 3 GHz
  • Buffered analog inputs with VCMI of 0 V:
    • Analog input bandwidth (–3 dB): 8.0 GHz
    • Usable input frequency range: >10 GHz
    • Full-scale input voltage (VFS, default): 0.8 VPP
    • Analog input common-mode (VICM): 0 V
  • Noiseless aperture delay (TAD) adjustment:
    • Precise sampling control: 19-fs step
    • Simplifies synchronization and interleaving
    • Temperature and voltage invariant delays
  • Easy-to-use synchronization features:
    • Automatic SYSREF timing calibration
    • Timestamp for sample marking
  • JESD204B serial data interface:
    • Supports subclass 0 and 1
    • Maximum lane rate: 12.8 Gbps
    • Up to 16 lanes allows reduced lane rate
  • Digital down-converters in dual-channel mode:
    • Real output: DDC bypass or 2x decimation
    • Complex output: 4x, 8x, or 16x decimation
    • Four independent 32-Bit NCOs per DDC
  • Power consumption: 3 W
  • Power supplies: 1.1 V, 1.9 V

The ADC12DJ3200 device is an RF-sampling, giga-sample, analog-to-digital converter (ADC) that can directly sample input frequencies from DC to above 10 GHz. In dual-channel mode, the ADC12DJ3200 can sample up to 3200 MSPS and up to 6400 MSPS in single-channel mode. Programmable tradeoffs in channel count (dual-channel mode) and Nyquist bandwidth (single-channel mode) allow development of flexible hardware that meets the needs of both high channel count or wide instantaneous signal bandwidth applications. Full-power input bandwidth (–3 dB) of 8.0 GHz, with usable frequencies exceeding the –3-dB point in both dual- and single-channel modes, allows direct RF sampling of L-band, S-band, C-band, and X-band for frequency agile systems.

The ADC12DJ3200 uses a high-speed JESD204B output interface with up to 16 serialized lanes and subclass-1 compliance for deterministic latency and multi-device synchronization. The serial output lanes support up to 12.8 Gbps and can be configured to trade-off bit rate and number of lanes. Innovative synchronization features, including noiseless aperture delay (TAD) adjustment and SYSREF windowing, simplify system design for phased array radar and MIMO communications. Optional digital down converters (DDCs) in dual-channel mode allow for reduction in interface rate (real and complex decimation modes) and digital mixing of the signal (complex decimation modes only).

The ADC12DJ3200 device is an RF-sampling, giga-sample, analog-to-digital converter (ADC) that can directly sample input frequencies from DC to above 10 GHz. In dual-channel mode, the ADC12DJ3200 can sample up to 3200 MSPS and up to 6400 MSPS in single-channel mode. Programmable tradeoffs in channel count (dual-channel mode) and Nyquist bandwidth (single-channel mode) allow development of flexible hardware that meets the needs of both high channel count or wide instantaneous signal bandwidth applications. Full-power input bandwidth (–3 dB) of 8.0 GHz, with usable frequencies exceeding the –3-dB point in both dual- and single-channel modes, allows direct RF sampling of L-band, S-band, C-band, and X-band for frequency agile systems.

The ADC12DJ3200 uses a high-speed JESD204B output interface with up to 16 serialized lanes and subclass-1 compliance for deterministic latency and multi-device synchronization. The serial output lanes support up to 12.8 Gbps and can be configured to trade-off bit rate and number of lanes. Innovative synchronization features, including noiseless aperture delay (TAD) adjustment and SYSREF windowing, simplify system design for phased array radar and MIMO communications. Optional digital down converters (DDCs) in dual-channel mode allow for reduction in interface rate (real and complex decimation modes) and digital mixing of the signal (complex decimation modes only).
filter Buscar otro/a ADC de alta velocidad (≥ 10 MSPS)
Descargar Ver vídeo con transcripción Video

Productos similares que pueden interesarle

open-in-new Comparar alternativas
Pin por pin con la misma funcionalidad que el dispositivo comparado
ADC08DJ5200RF ACTIVO ADC de 8 bits de muestreo de RF con 5,2 GSPS de doble canal o 10,4 GSPS de un solo canal ADC08DJ5200RF offers higher speed, lower resolution, and no DDC.
ADC12DJ4000RF ACTIVO ADC de muestreo de RF de 12 bits con 4 GSPS de doble canal u 8 GSPS de un solo canal ADC12DJ4000RF offers higher speed, DDC in both single and dual modes, and internal dither.

Documentación técnica

star =Principal documentación para este producto seleccionada por TI
No se encontraron resultados. Borre su búsqueda y vuelva a intentarlo.
Ver todo 10
Documentación principal Tipo Título Opciones de formato Fecha
* Data sheet ADC12DJ3200 6.4-GSPS Single-Channel or 3.2-GSPS Dual-Channel, 12-bit, RF-Sampling Analog-to-Digital Converter (ADC) datasheet (Rev. A) PDF | HTML 21 feb 2019
Application note Comparing Active vs. Passive High-Speed/RF A/D Converter Front Ends PDF | HTML 28 mar 2025
Application note Evaluating High-Speed, RF ADC Converter Front-end Architectures PDF | HTML 26 mar 2025
Technical article So, what's a VNA anyway? PDF | HTML 23 ago 2019
Technical article So, what's the deal with frequency response? PDF | HTML 23 ago 2019
Technical article So, what are S-parameters anyway? PDF | HTML 23 may 2019
Application note Intel Stratix 10 GX 16-Lane RX JESD204B-ADC12DJ3200 Interoperability Reference Design 30 may 2018
Technical article Preparing for 5G applications: sync your multichannel JESD204B data acquisition sy PDF | HTML 28 ago 2017
Technical article High-speed data converter clocking for JESD204B PDF | HTML 07 jul 2017
Analog Design Journal Designing a modern power supply for RF sampling converters 26 abr 2017

Diseño y desarrollo

Para conocer los términos adicionales o los recursos necesarios, haga clic en cualquier título de abajo para ver la página de detalles cuando esté disponible.

Placa de evaluación

ADC12DJ3200EVM — Módulo de evaluación de ADC de muestreo de RF ADC12DJ3200 de 12 bits, 3.2 GSPS dobles o 6.4 GSPS sim

El módulo de evaluación (EVM) ADC12DJ3200 está diseñado para evaluar la familia ADC12DJ3200 de convertidores analógico-digitales (ADC) de alta velocidad. El EVM está poblado con el ADC12DJ3200, un ADC de 12 bits, 3.2 GSPS de doble canal o 6.4 GSPS de un solo canal con interfaz JESD204B y permite (...)
Guía del usuario: PDF
No disponible en TI.com
Placa de evaluación

ABACO-3P-FMC134 — Tarjeta intermedia FPGA ADC de 4 canales y 3,2 GSPS de conversión directa RF o de 2 canales y 6,4 GS

Abaco FMC134 proporciona cuatro convertidores analógico a digital ADC de 12-bits 3.2-GSPS o dos convertidores analógico-digitales (ADC) de 6.4-GSPS de 12 bits. El módulo destaca el ADC (dos) ADC12DJ3200 de dos canales, 12 bits y 3.2 GSPS de Texas Instruments en una tarjeta secundaria con un (...)

Desde: Abaco Systems
Visitar el sitio del socio
Placa de evaluación

ANNAP-3P-WWDM60 — Annapolis Microsystems de 4 canales ADC, tarjeta intermedia DAC FPGA de 2 canales hasta 10 GSPS

This high performance WILD FMC+ DM60 ADC & DAC has two input bandwidth options, internal sample clock options and internal 10MHz reference clock options. The WWDM60 has a choice of speed grades that utilize the ADC12DJ2700, ADC12DJ3200 and ADC12DJ5200RF up to 10GSPS. It allows for ADC and DAC (...)
Desde: Annapolis Micro Systems
Visitar el sitio del socio
Placa de evaluación

PENTEK-3P-71141-XMC — Pentek Modelo 71141 ADC de 1 canal a 6,4 GHz o 2 canales a 3,2 GHz, DAC de 2 canales a 6,4 GHz Kinte

Accelerate your project by considering a complete off-the-shelf board that utilizes the ADC12DJ3200. The Pentek Jade® Model 71141 is an ideal radar and software radio interface solution that includes the Texas Instrument's ADC12DJ3200 ADC. The solution from Pentek provides a one-channel 6.4GSPS (...)

Desde: Pentek Inc.
Visitar el sitio del socio
Firmware

SLAC748 — Arria10 + ADC12DJ3200 JMODE0 Design Firmware

Productos y hardware compatibles

Productos y hardware compatibles
Descargar
Firmware

SLVC698 — Xilinx KCU105 + ADC12DJ3200 JMODE0/JMODE2 Design Firmware

Productos y hardware compatibles

Productos y hardware compatibles
Descargar
Firmware

TI204C-IP — Request for JESD204 rapid design IP

The JESD204 rapid design IP has been designed to enable FPGA engineers to achieve an accelerated path to a working JESD204 system. The IP has been architected in a way that downstream digital processing and other application logic are isolated from most of the performance- and timing-critical (...)

Productos y hardware compatibles

Productos y hardware compatibles
Solicitar
GUI para el módulo de evaluación (EVM)

DATACONVERTERPRO-SW — High Speed Data Converter Pro GUI Installer, v5.31

This high-speed data converter pro GUI is a PC (Windows® XP/7/10 compatible) program designed to aid in evaluation of most TI high-speed data converter [analog-to-digital converter (ADC) and digital-to-analog converter (DAC)] and analog front-end (AFE) platforms. Designed to support the entire (...)

Productos y hardware compatibles

Productos y hardware compatibles
Descargar
GUI para el módulo de evaluación (EVM)

SLAC745 — ADC12DJxx00 GUI

Productos y hardware compatibles

Productos y hardware compatibles
Descargar
Modelo de simulación

ADC12DJ3200 S-Parameter Model

SLVMD69.ZIP (10 KB) - S-Parameter Model
Descargar
Modelo de simulación

ADC12DJ3200 and ADC12DJ3200QML-SP IBIS and IBIS-AMI Model

SLVMDV3.ZIP (47828 KB) - IBIS-AMI Model
Descargar
Herramienta de cálculo

ADC12DJ5200RF-HSACCURACY-CALC — Accuracy calculation for ADC12DJ5200RF with amplifier input

DC accuracy calculator which accounts for ADC and amplifier noise and imperfections.
Productos y hardware compatibles

Productos y hardware compatibles
Descargar
Herramienta de cálculo

FREQ-DDC-FILTER-CALC — RF-Sampling Frequency Planner, Analog Filter, and DDC Excel Calculator

This Excel calculator provides system designers a way to simplify the design and debugging of direct RF-sampling receivers. It offers three functions: frequency planning, analog filtering, and decimation filter spur location.

In the concept phase, a frequency-planning tool enables fine tuning of (...)

Productos y hardware compatibles

Productos y hardware compatibles
Descargar
Herramienta de simulación

PSPICE-FOR-TI — PSpice® para herramienta de diseño y simulación de TI

PSpice® para TI es un entorno de diseño y simulación que ayuda a evaluar la funcionalidad de los circuitos analógicos. Esta completa suite de diseño y simulación utiliza un motor de análisis analógico de Cadence®. Disponible sin ningún costo, PSpice para TI incluye una de las bibliotecas de modelos (...)
Solicitar
Diseños de referencia

TIDA-01021 — Diseño de referencia de registro de tiempo de JESD204B 15 GHz multicanal para DSO, radares y comprob

Las aplicaciones multicanal de alta velocidad requieren soluciones de sincronización precisas capaces de gestionar el sesgo entre canales para lograr una SNR, SFDR y ENOB óptimas del sistema. Este diseño de referencia es capaz de admitir dos canales de alta velocidad en placas independientes (...)
Design guide: PDF
Esquema: PDF
Diseños de referencia

TIDA-01022 — Diseño de referencia flexible AFE multicanal de 3.2 GSPS para DSO, radares y sistemas de prueba 5G i

Este diseño de referencia de captura de datos multicanal de alta velocidad permite un buen rendimiento de sistema. Los diseñadores de sistemas deben considerar parámetros de diseño críticos, como la fluctuación de reloj y el sesgo para la generación de reloj multicanal de alta velocidad, lo que (...)
Design guide: PDF
Esquema: PDF
Diseños de referencia

TIDA-01023 — Dsñ. de ref. de gen. de reloj JESD204B de alto rec. de canales para RADAR y comprobadores 5G inalám.

Las aplicaciones multicanal de alta velocidad requieren soluciones de reloj escalables y de bajo nivel de ruido, capaces de ajustar con precisión el desajuste entre canales, para lograr un rendimiento adecuado del sistema en términos de relación señal-ruido (SNR), alto rango dinámico libre de (...)
Design guide: PDF
Esquema: PDF
Diseños de referencia

TIDA-01024 — Dis. de ref. de reloj de encadenam. JESD204B de alto rec. de canales p/RADAR y comprob. 5G inalám.

Las aplicaciones multicanal de alta velocidad requieren soluciones de reloj escalables y de bajo nivel de ruido, capaces de ajustar con precisión el desajuste entre canales, para lograr un rendimiento adecuado del sistema en términos de relación señal-ruido (SNR), alto rango dinámico libre de (...)
Design guide: PDF
Esquema: PDF
Diseños de referencia

TIDA-01027 — Diseño de referencia de fuente de alimentación de bajo ruido, que maximiza el rendimiento en sistema

Este diseño de referencia demuestra un diseño de fuente de alimentación de cinco carriles eficiente y de bajo ruido para sistemas de adquisición de datos (DAQ) de muy alta velocidad capaces > 12.8 GSPS. Los convertidores CC/CC de la fuente de alimentación están sincronizados con frecuencia y con (...)
Design guide: PDF
Esquema: PDF
Diseños de referencia

TIDA-01028 — Diseño de referencia de interfaz analógica 12.8 GSPS para osciloscopio de alta velocidad y digitaliz

Este diseño de referencia proporciona un ejemplo práctico de convertidores analógico a digital (ADC) de muestreo de RF intercalados para lograr una velocidad de muestreo de 12.8 GSPS. Esto se hace intercalando temporalmente dos ADC de muestreo de RF. El intercalado requiere un cambio de fase entre (...)
Design guide: PDF
Esquema: PDF
Diseños de referencia

TIDA-010122 — Diseño de referencia de DDC de convertidor de datos de sincronización y características de NCO para

Este diseño de referencia aborda los desafíos de diseño de sincronización asociados con aplicaciones adaptadas a 5G emergente, como MIMO masivo (mMIMO), radar de antenas en fase y carga útil de comunicaciones. El extremo frontal de RF típico contiene antena, amplificador de bajo ruido (LNA), (...)
Design guide: PDF
Esquema: PDF
Diseños de referencia

TIDA-01442 — Receptor de radar directo de muestreo de RF para bandas L, S, C y X mediante el diseño de referencia

Este diseño de referencia utiliza el módulo de evaluación (EVM) ADC12DJ3200 para demostrar un receptor de muestreo de RF directo para un radar que funciona en HF, VHF, UHF, L, S, C y parte de la banda X. El amplio ancho de banda de entrada analógica y la alta velocidad de muestreo (6.4 GSPS) del (...)
Design guide: PDF
Esquema: PDF
Encapsulado Pines Símbolos CAD, huellas y modelos 3D
FCCSP (AAV) 144 Ultra Librarian
FCCSP (ZEG) 144 Ultra Librarian
Se aplican los Términos y condiciones estándar de TI para los elementos de evaluación.

Pedidos y calidad

Información incluida:
  • RoHS
  • REACH
  • Marcado del dispositivo
  • Acabado de plomo/material de la bola
  • Clasificación de nivel de sensibilidad a la humedad (MSL)/reflujo máximo
  • Estimaciones de tiempo medio entre fallas (MTBF)/fallas en el tiempo (FIT)
  • Contenido del material
  • Resumen de calificaciones
  • Monitoreo continuo de confiabilidad
Información incluida:
  • Lugar de fabricación
  • Lugar de ensamblaje

Los productos recomendados pueden tener parámetros, módulos de evaluación o diseños de referencia relacionados con este producto de TI.

Soporte y capacitación

Foros de TI E2E™ con asistencia técnica de los ingenieros de TI

Ver todos los temas del foro en inglés

El contenido lo proporcionan “tal como está” TI y los colaboradores de la comunidad y no constituye especificaciones de TI. Consulte los términos de uso.

Si tiene alguna pregunta sobre calidad, encapsulados o pedido de productos de TI, consulte el servicio de asistencia de TI. ​​​​​​​​​​​​​​

Videos