Produktdetails

Function Differential Additive RMS jitter (typ) (fs) 171 Output frequency (max) (MHz) 800 Number of outputs 12 Output supply voltage (V) 2.5 Core supply voltage (V) 2.5 Output skew (ps) 35 Features 2:12 fanout, Universal inputs Operating temperature range (°C) -40 to 85 Rating Catalog Output type LVDS Input type LVCMOS, LVDS, LVPECL
Function Differential Additive RMS jitter (typ) (fs) 171 Output frequency (max) (MHz) 800 Number of outputs 12 Output supply voltage (V) 2.5 Core supply voltage (V) 2.5 Output skew (ps) 35 Features 2:12 fanout, Universal inputs Operating temperature range (°C) -40 to 85 Rating Catalog Output type LVDS Input type LVCMOS, LVDS, LVPECL
VQFN (RHA) 40 36 mm² 6 x 6
  • 2:12 Differential Buffer
  • Low Additive Jitter: < 300-fs RMS in
    10-kHz to 20-MHz
  • Low Output Skew of 35 ps (Maximum)
  • Universal Inputs Accept LVDS, LVPECL, and LVCMOS
  • Selectable Clock Inputs Through Control Pin
  • 12 LVDS Outputs, ANSI EIA/TIA-644A Standard Compatible
  • Clock Frequency: Up to 800 MHz
  • Device Power Supply: 2.375 V to 2.625 V
  • LVDS Reference Voltage, VAC_REF, Available for Capacitive Coupled Inputs
  • Industrial Temperature Range: –40°C to 85°C
  • Packaged in 6-mm × 6-mm, 40-Pin VQFN (RHA)
  • ESD Protection Exceeds 3-kV HBM, 1-kV CDM
  • 2:12 Differential Buffer
  • Low Additive Jitter: < 300-fs RMS in
    10-kHz to 20-MHz
  • Low Output Skew of 35 ps (Maximum)
  • Universal Inputs Accept LVDS, LVPECL, and LVCMOS
  • Selectable Clock Inputs Through Control Pin
  • 12 LVDS Outputs, ANSI EIA/TIA-644A Standard Compatible
  • Clock Frequency: Up to 800 MHz
  • Device Power Supply: 2.375 V to 2.625 V
  • LVDS Reference Voltage, VAC_REF, Available for Capacitive Coupled Inputs
  • Industrial Temperature Range: –40°C to 85°C
  • Packaged in 6-mm × 6-mm, 40-Pin VQFN (RHA)
  • ESD Protection Exceeds 3-kV HBM, 1-kV CDM

The CDCLVD1212 clock buffer distributes one of two selectable clock inputs (IN0 and IN1) to 12 pairs of differential LVDS clock outputs (OUT0 through OUT11) with minimum skew for clock distribution. The CDCLVD1212 can accept two clock sources into an input multiplexer. The inputs can either be LVDS, LVPECL, or LVCMOS.

The CDCLVD1212 is specifically designed for driving 50-Ω transmission lines. In case of driving the inputs in single-ended mode, the appropriate bias voltage, VAC_REF, must be applied to the unused negative input pin.

The IN_SEL pin selects the input which is routed to the outputs. If this pin is left open, it disables the outputs (static). The part supports a fail-safe function. The device incorporates an input hysteresis which prevents random oscillation of the outputs in the absence of an input signal.

The device operates in 2.5-V supply environment and is characterized from –40°C to 85°C (ambient temperature). The CDCLVD1212 is packaged in small, 40-pin, 6-mm × 6-mm VQFN package.

The CDCLVD1212 clock buffer distributes one of two selectable clock inputs (IN0 and IN1) to 12 pairs of differential LVDS clock outputs (OUT0 through OUT11) with minimum skew for clock distribution. The CDCLVD1212 can accept two clock sources into an input multiplexer. The inputs can either be LVDS, LVPECL, or LVCMOS.

The CDCLVD1212 is specifically designed for driving 50-Ω transmission lines. In case of driving the inputs in single-ended mode, the appropriate bias voltage, VAC_REF, must be applied to the unused negative input pin.

The IN_SEL pin selects the input which is routed to the outputs. If this pin is left open, it disables the outputs (static). The part supports a fail-safe function. The device incorporates an input hysteresis which prevents random oscillation of the outputs in the absence of an input signal.

The device operates in 2.5-V supply environment and is characterized from –40°C to 85°C (ambient temperature). The CDCLVD1212 is packaged in small, 40-pin, 6-mm × 6-mm VQFN package.

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Technische Dokumentation

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Typ Titel Datum
* Data sheet CDCLVD1212 2:12 Low Additive Jitter LVDS Buffer datasheet (Rev. D) PDF | HTML 13 Nov 2017
User guide Low Additive Jitter, Twelve LVDS Outputs Clock Buffer Evaluation Board 01 Sep 2010

Design und Entwicklung

Weitere Bedingungen oder erforderliche Ressourcen enthält gegebenenfalls die Detailseite, die Sie durch Klicken auf einen der unten stehenden Titel erreichen.

Simulationsmodell

CDCLVD1212 IBIS Model (Rev. B)

SLLM091B.ZIP (15 KB) - IBIS Model
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CLOCK-TREE-ARCHITECT — Programmiersoftware Clock Tree Architect

Clock tree architect is a clock tree synthesis tool that streamlines your design process by generating clock tree solutions based on your system requirements. The tool pulls data from an extensive database of clocking products to generate a system-level multi-chip clocking solution.
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PLLATINUMSIM-SW PLLatinum Sim Tool

PLLATINUMSIM-SW is a simulation tool that allows users to create detailed designs and simulations of our PLLatinum™ integrated circuits, which include the LMX series of phase-locked loops (PLLs) and synthesizers.

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Unterstützte Produkte und Hardware

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Produkte
HF-PLLs und Synthesizer
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Takt-Jitter-Cleaner & Synchronisierer
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Taktpuffer
CDCDB2000 DB2000QL-konformer Taktpuffer mit 20 Ausgängen für PCIe Gen 1 bis Gen 5 CDCDB400 Taktpuffer mit 4 Ausgängen für PCIe Gen 1 bis Gen 6 CDCDB800 Taktpuffer mit 8 Ausgängen für PCIe Gen 1 bis Gen 6 CDCDB803 Taktpuffer mit 8 Ausgängen für PCIe® Gen 1 bis Gen 6 mit auswählbaren SMBus-Adressen CDCLVC1102 Jitterarmer Fanout-Taktpuffer, 1:2 LVCMOS CDCLVC1103 Jitterarmer Fanout-Taktpuffer, 1:3 LVCMOS CDCLVC1104 Jitterarmer Fanout-Taktpuffer, 1:4 LVCMOS CDCLVC1106 Jitterarmer Fanout-Taktpuffer, 1:6 LVCMOS CDCLVC1108 Jitterarmer Fanout-Taktpuffer, 1:8 LVCMOS CDCLVC1110 Jitterarmer Fanout-Taktpuffer, 1:10 LVCMOS CDCLVC1112 Jitterarmer Fanout-Taktpuffer, 1:12 LVCMOS CDCLVC1310 LVCMOS-Puffer mit Universaleingang, 10 Ausgängen und niedriger Impedanz CDCLVD110 1 bis 10 LVDS-Taktpuffer bis zu 900 MHz mit minimalem Versatz für Taktverteilung CDCLVD110A 1 bis 10 LVDS-Taktpuffer bis zu 1100 MHz mit minimalem Versatz für Taktverteilung CDCLVD1204 Jitterarmer 1:4-Universal-auf-LVDS-Puffer mit zwei auswählbaren Eingängen CDCLVD1208 Jitterarmer 1:8-Universal-auf-LVDS-Puffer mit zwei auswählbaren Eingängen CDCLVD1212 Jitterarmer 1:12-Universal-auf-LVDS-Puffer mit zwei auswählbaren Eingängen CDCLVD1213 Jitterarmer 1:4 Universal-zu-LVDS-Puffer mit wählbarem Ausgangsteiler CDCLVD1216 Wählbarer 1:16-Universal-zu-LVDS-Puffer mit 2 Eingängen und geringem Jitter CDCLVD2102 Jitterarmer, wählbarer 1:12 Universal-zu-LVDS-Puffer mit 2 Eingängen CDCLVD2104 Dualer 1:4-Universal-zu-LVDS-Puffer mit geringem Jitter CDCLVD2106 Jitterarmer 1:12-Universal-auf-LVDS-Puffer mit zwei auswählbaren Eingängen CDCLVD2108 Dualer 1:8-Universal-zu-LVDS-Puffer mit geringem Jitter CDCLVP110 1-10-LVPECL/HSTL-zu-LVPECL-Takttreiber CDCLVP1102 Jitterarmer Puffer, 1:2, universeller Eingang, LVPECL-Ausgang CDCLVP111 1:10 LVPECL-Puffer mit wählbarem Eingang CDCLVP111-EP HiRel, 1-10-LVPECL-Puffer mit wählbarem Eingang CDCLVP111-SP 1:10-Highspeed-Taktpuffer mit wählbarem Eingangstakttreiber CDCLVP1204 Jitterarmer, wählbarer 1:1:4-Universal-zu-LVPECL-Puffer mit zwei Eingängen CDCLVP1208 Jitterarmer, wählbarer 1:8-Universal-zu-LVPECL-Puffer mit 2 Eingängen CDCLVP1212 Jitterarmer, wählbarer 1:12-Universal-zu-LVPECL-Puffer mit 2 Eingängen CDCLVP1216 Jitterarmer, wählbarer 1:16-Universal-zu-LVPECL-Puffer mit 2 Eingängen CDCLVP2102 Dual-1:2 Universal-zu-LVPECL-Puffer mit geringem Jitter CDCLVP2104 Jitterarmer, Dual-1:4-Universal-zu-LVPECL-Puffer CDCLVP2106 Jitterarmer, Dual-1:6-Universal-zu-LVPECL-Puffer CDCLVP2108 Jitterarmer, Dual-1:8-Universal-zu-LVPECL-Puffer CDCLVP215 Zwei 1:5-Hochgeschwindigkeits-LVPECL-Fan-Out-Puffer LMK00301 3-GHz-Differenzial-Fanout-Puffer/Pegelumsetzer mit 10 Ausgängen LMK00304 3,1-GHz-Differenzialtaktpuffer/Pegelumsetzer mit 4 konfigurierbaren Ausgängen LMK00306 3,1-GHz-Differenzialtaktpuffer/Pegelumsetzer mit 6 konfigurierbaren Ausgängen LMK00308 3,1-GHz-Differenztaktpuffer/Pegelumsetzer mit 8 konfigurierbaren Ausgängen LMK00334 Taktpuffer/Pegelumsetzer, 4 Ausgänge, PCIe® Gen1/Gen2/Gen3/Gen4/Gen5 LMK00334-Q1 Taktpuffer/Pegelumsetzer, 4 Ausgänge, PCIe® Gen1/Gen2/Gen3/Gen4/Gen5 LMK00338 Taktpuffer/Pegelumsetzer, 8 Ausgänge, PCIe® Gen1/Gen2/Gen3/Gen4/Gen5 LMK1C1102 LVCMOS-Puffer, 1,8 V, mit 2-Kanal-Ausgang LMK1C1103 LVCMOS-Puffer, 1,8 V, mit 3-Kanal-Ausgang LMK1C1104 LVCMOS-Puffer, 1,8 V, mit 4-Kanal-Ausgang LMK1C1106 LVCMOS-Puffer, 1,8 V, mit 6-Kanal-Ausgang LMK1C1108 LVCMOS-Puffer, 1,8 V, mit 8-Kanal-Ausgang LMK1D1204 LVDS-Puffer, 1,8 V, mit 4-Kanal-Ausgang LMK1D1204P 4-Kanal-Ausgang LVDS 1,8-V-, 2,5-V- und 3,3-V-Puffer mit Pinsteuerung LMK1D1208 8-Kanal-Ausgang LVDS 1,8-V-, 2,5-V- und 3,3-V-Puffer LMK1D1208I 8-Kanal-Ausgang 1,8-V-, 2,5-V- und 3,3-V-LVDS-Puffer mit I²C-Schnittstelle LMK1D1208P 8-Kanal-Ausgang 1,8-V-, 2,5-V- und 3,3-V-LVDS-Puffer mit Pin-Steuerung LMK1D1212 12-Kanal-Ausgang LVDS 1,8-V-, 2,5-V- und 3,3-V-Puffer LMK1D1216 16-Kanal-Ausgang 1,8-V-, 2,5-V- und 3,3-V-LVDS-Puffer LMK1D2102 2-Kanal-Ausgang Dual-Bank-LVDS 1,8-V-, 2,5-V- und 3,3-V-Puffer LMK1D2104 4-Kanal-Ausgang Dual-Bank mit 1,8-V-, 2,5-V- und 3,3-V-LVDS-Puffer LMK1D2106 6-Kanal-Ausgang Dual-Bank mit 1,8-V-, 2,5-V- und 3,3-V-LVDS-Puffer LMK1D2108 8-Kanal-Doppelbank mit 1,8-V-Ausgang, 2,5-V- und 3,3-V-LVDS-Puffer
Taktgeneratoren
LMK03318 Ultra-Low-Jitter-Takt-Generator-Familie mit Einzel-PLL LMK03328 Extrem jitterarme Taktgeneratorfamilie mit zwei unabhängigen PLLs LMK03806 Extrem jitterarmer Taktgenerator mit 14 Ausgängen
IQ-Demodulatoren
LMX8410L Hochleistungsmischer mit Integriertem Synthesizer
Hardware-Entwicklung
Evaluierungsplatine
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Software
Anwendungssoftware und Frameworks
PLLATINUMSIM-SW Texas Instruments PLLatinum-Simulator-Tool TICSPRO-SW Texas Instruments Clocks and Synthesizers (TICS) Pro Software
IDE, Konfiguration, Compiler oder Debugger
CODELOADER CodeLoader-Software für die Programmierung von Geräteregistern LMX9830-SW LMX9830 Anwendungshinweise, Software und Tools LMX9838-SW LMX9838 Anwendungshinweise, Software und Tools
Download-Optionen
Simulationstool

PSPICE-FOR-TI — PSpice® für TI Design-und Simulationstool

PSpice® für TI ist eine Design- und Simulationsumgebung, welche Sie dabei unterstützt, die Funktionalität analoger Schaltungen zu evaluieren. Diese voll ausgestattete Design- und Simulationssuite verwendet eine analoge Analyse-Engine von Cadence®. PSpice für TI ist kostenlos erhältlich und (...)
Gehäuse Pins Herunterladen
VQFN (RHA) 40 Optionen anzeigen

Bestellen & Qualität

Beinhaltete Information:
  • RoHS
  • REACH
  • Bausteinkennzeichnung
  • Blei-Finish/Ball-Material
  • MSL-Rating / Spitzenrückfluss
  • MTBF-/FIT-Schätzungen
  • Materialinhalt
  • Qualifikationszusammenfassung
  • Kontinuierliches Zuverlässigkeitsmonitoring
Beinhaltete Information:
  • Werksstandort
  • Montagestandort

Empfohlene Produkte können Parameter, Evaluierungsmodule oder Referenzdesigns zu diesem TI-Produkt beinhalten.

Support und Schulungen

TI E2E™-Foren mit technischem Support von TI-Ingenieuren

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Bei Fragen zu den Themen Qualität, Gehäuse oder Bestellung von TI-Produkten siehe TI-Support. ​​​​​​​​​​​​​​

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