CDCLVP1102

Name: CDCLVP1102
Brand: TI
SKU: CDCLVP1102
Price: 2.888 USD

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Jitterarmer Puffer, 1:2, universeller Eingang, LVPECL-Ausgang

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document-pdfAcrobat CDCLVP1102 Two-LVPECL Output, High-Performance Clock Buffer datasheet (Rev. D) (Englisch) PDF | HTML

CDCLVP1102

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Produktdetails

Number of outputs

2

Additive RMS jitter (typ) (fs)

90

Core supply voltage (V)

2.5, 3.3

Output supply voltage (V)

2.5, 3.3

Output skew (ps)

10

Operating temperature range (°C)

-40 to 85

Rating

Catalog

Output type

LVPECL

Input type

LVCMOS, LVDS, LVPECL

Number of outputs

2

Additive RMS jitter (typ) (fs)

90

Core supply voltage (V)

2.5, 3.3

Output supply voltage (V)

2.5, 3.3

Output skew (ps)

10

Operating temperature range (°C)

-40 to 85

Rating

Catalog

Output type

LVPECL

Input type

LVCMOS, LVDS, LVPECL

VQFN (RGT)

16

9 mm² 3 x 3

1:2 Differential Buffer
Single Clock Input
Universal Inputs Can Accept LVPECL, LVDS,
LVCMOS/LVTTL
Two LVPECL Outputs
Maximum Clock Frequency: 2 GHz
Maximum Core Current Consumption: 33 mA
Very Low Additive Jitter: <100 fs, RMS in 10-kHz
to 20-MHz Offset Range
2.375-V to 3.6-V Device Power Supply
Maximum Propagation Delay: 450 ps
Maximum Output Skew: 10 ps
LVPECL Reference Voltage, V_{AC_REF}, Available
for Capacitive-Coupled Inputs
Industrial Temperature Range: –40°C to 85°C
Supports 105°C PCB Temperature
(Measured at Thermal Pad)
Available in 3-mm × 3-mm QFN-16 (RGT) Package
ESD Protection Exceeds 2 kV (HBM)

1:2 Differential Buffer
Single Clock Input
Universal Inputs Can Accept LVPECL, LVDS,
LVCMOS/LVTTL
Two LVPECL Outputs
Maximum Clock Frequency: 2 GHz
Maximum Core Current Consumption: 33 mA
Very Low Additive Jitter: <100 fs, RMS in 10-kHz
to 20-MHz Offset Range
2.375-V to 3.6-V Device Power Supply
Maximum Propagation Delay: 450 ps
Maximum Output Skew: 10 ps
LVPECL Reference Voltage, V_{AC_REF}, Available
for Capacitive-Coupled Inputs
Industrial Temperature Range: –40°C to 85°C
Supports 105°C PCB Temperature
(Measured at Thermal Pad)
Available in 3-mm × 3-mm QFN-16 (RGT) Package
ESD Protection Exceeds 2 kV (HBM)

The CDCLVP1102 is a highly versatile, low additive jitter buffer that can generate two copies of LVPECL clock outputs from one LVPECL, LVDS, or LVCMOS input for a variety of communication applications. It has a maximum clock frequency up to 2 GHz. The overall additive jitter performance is less than 0.1 ps, RMS from 10 kHz to 20 MHz, and overall output skew is as low as 10 ps, making the device a perfect choice for use in demanding applications.

The CDCLVP1102 clock buffer distributes a single clock input (IN) to two pairs of differential LVPECL clock outputs (OUT0, OUT1) with minimum skew for clock distribution. The inputs can be LVPECL, LVDS, or LVCMOS/LVTTL.

The CDCLVP1102 is specifically designed for driving 50-Ω transmission lines. When driving the inputs in single-ended mode, the LVPECL bias voltage (V_{AC_REF}) should be applied to the unused negative input pin. However, for high-speed performance up to 2 GHz, differential mode is strongly recommended.

The CDCLVP1102 is characterized for operation from –40°C to 85°C and is available in a QFN-16, 3-mm × 3-mm package.

The CDCLVP1102 is a highly versatile, low additive jitter buffer that can generate two copies of LVPECL clock outputs from one LVPECL, LVDS, or LVCMOS input for a variety of communication applications. It has a maximum clock frequency up to 2 GHz. The overall additive jitter performance is less than 0.1 ps, RMS from 10 kHz to 20 MHz, and overall output skew is as low as 10 ps, making the device a perfect choice for use in demanding applications.

The CDCLVP1102 clock buffer distributes a single clock input (IN) to two pairs of differential LVPECL clock outputs (OUT0, OUT1) with minimum skew for clock distribution. The inputs can be LVPECL, LVDS, or LVCMOS/LVTTL.

The CDCLVP1102 is specifically designed for driving 50-Ω transmission lines. When driving the inputs in single-ended mode, the LVPECL bias voltage (V_{AC_REF}) should be applied to the unused negative input pin. However, for high-speed performance up to 2 GHz, differential mode is strongly recommended.

The CDCLVP1102 is characterized for operation from –40°C to 85°C and is available in a QFN-16, 3-mm × 3-mm package.

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Top-Dokumentation	Typ	Titel	Format-Optionen	Datum
*	Data sheet	CDCLVP1102 Two-LVPECL Output, High-Performance Clock Buffer datasheet (Rev. D)	PDF \| HTML	11 Dez 2015

Design und Entwicklung

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Schaltplan: PDF

Gehäuse	Pins	CAD-Symbole, Footprints und 3D-Modelle
VQFN (RGT)	16	Ultra Librarian

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