ADC12DJ5200RF
- ADC コア:
- 12 ビット分解能
- シングル チャネル モードで最大 10.48GSPS
- デュアル チャネル モードで最大 5.24GSPS
- 性能仕様:
- ノイズ フロア (-20dBFS、VFS = 1VPP-DIFF):
- デュアル チャネル モード:-151.8dBFS/Hz
- シングル チャネルモード:-154.4dBFS/Hz
- ENOB (デュアル チャネル、FIN = 2.4GHz):8.6 ビット
- ノイズ フロア (-20dBFS、VFS = 1VPP-DIFF):
- バッファ付きアナログ入力、VCMI = 0V:
- アナログ入力帯域幅 (-3dB):8GHz
- 使用可能な入力周波数範囲:> 10GHz
- フルスケール入力電圧 (VFS、デフォルト):0.8Vpp
- ノイズなしのアパーチャ遅延 (tAD) 調整:
- 高精度サンプリング制御:19fs ステップ
- 同期およびインターリーブ動作を簡素化
- 遅延は温度および電圧に対して不変
- 使いやすい同期機能:
- SYSREF タイミングの自動較正
- サンプル マーキング用のタイムスタンプ
- JESD204C シリアル データ インターフェイス
- 最大レーン速度:17.16Gbps
- 64b/66b および 8b/10b エンコードのサポート
- 8b/10b モードは JESD204B 互換
- オプションのデジタル ダウン コンバータ (DDC):
- 4x、8x、16x および 32x の複素数間引き
- DDC ごとに 4 つの独立した 32 ビット NCO
- ピーク RF 入力電力 (差動):+26.5dBm (+27.5dBFS、560x フルスケール電力)
- 「イコライゼーション用のプログラム可能な FIR フィルタ」を追加
- 消費電力:4W
- 電源:1.1V、1.9V
ADC12DJ5200RF デバイスは、RF サンプリング、ギガ サンプルの A/D コンバータ (ADC) で、DC から 10GHz 超までの入力周波数を直接サンプリングできます。ADC12DJ5200RF はデュアル チャネル 5.2GSPS の ADC、またはシングル チャネル 10.4GSPS の ADC として構成できます。使用可能な入力周波数帯域が最高 10GHz であるため、L バンド、S バンド、C バンド、X バンドを直接 RF サンプリングでき、多様な周波数に対応したシステムを実現できます。
ADC12DJ5200RF は、最大 17.16Gbps のライン速度をサポートする最大 16 個のシリアル化されたレーンを備えた、高速な JESD204C 出力インターフェイスを使っています。JESD204C subclass-1 により、決定論的レイテンシおよびマルチデバイス同期をサポートしています。JESD204C インターフェイスは、ライン速度とレーン数との間でトレードオフのバランスを取るように構成できます。8b/10b と 64b/66b の両方のデータ エンコードをサポートしています。64B/66B エンコードでは、前方エラー訂正 (FEC) によるビット エラー率の改善をサポートしています。このインターフェイスは、JESD204B レシーバと下位互換性があります。
ノイズなしのアパーチャ遅延調整や、SYSREF ウィンドウ処理などの革新的な同期機能により、マルチ チャネル アプリケーションのシステム設計を簡素化できます。オプションのデジタル ダウン コンバータ (DDC) を使用すると、ベースバンドへのデジタル変換を実行でき、またインターフェイス速度を低減できます。プログラム可能な FIR フィルタにより、オンチップのイコライゼーションが可能です。
お客様が関心を持ちそうな類似品
比較対象デバイスにアップグレード機能を搭載した、ドロップ・イン代替製品。
比較対象デバイスと同等の機能で、ピン互換製品。
技術資料
設計と開発
その他のアイテムや必要なリソースを参照するには、以下のタイトルをクリックして詳細ページをご覧ください。
ADC12DJ5200RFEVM — ADC12DJ5200RF RF サンプリング、12 ビット、デュアル 5.2GSPS またはシングル 10.4GSPS ADC の評価基板
TRF1208-ADC12DJ5200RFEVM — TRF1208 高速 RF サンプリング FDA (完全差動アンプ) (ADC12DJ5200RF 搭載) の評価基板
ANNAP-3P-WWDM60 — Annapolis Microsystems 4-channel ADC, 2-channel DAC FPGA mezzanine card up to 10GSPS
SLWC120 — TSW14J57 ADC12DJ5200RF Reference Design Firmware
TI204C-IP — Request for JESD204 rapid design IP
JESD204 rapid design IP (迅速設計知的財産) は、良好に動作する JESD204 システムを FPGA エンジニアが開発する際に、迅速な経路をたどれる設計を採用しています。この IP は、ダウンストリーム (下流) のデジタル処理と他のアプリケーション ロジックを、性能とタイミングに関する JESD204 プロトコルの重要な制約の大半から分離できるアーキテクチャを採用しています。この IP は、ファームウェア開発に費やす期間を短縮し、FPGA の統合を平易化できるように、設計者の皆様を支援します。
JESD204 rapid design IP は、TI の高速データ (...)
DATACONVERTERPRO-SW — 高速データ コンバータ向け Pro GUI インストーラー、v5.31
この高速データ コンバータ Pro GUIは、PC (Windows® XP/7/10 対応) 向けプログラムであり、TI の大半の高速データ コンバータである A/D コンバータ (ADC) や D/A コンバータ (DAC) と、アナログ フロント エンド (AFE) の各プラットフォームの評価を支援するために設計されました。DATACONVERTERPRO-SW は、データ キャプチャとパターン ジェネレータのカードである TSW14xxx シリーズ全体をサポートする設計を採用しており、時間ドメインと周波数ドメインの両方でデータ (...)
ADC12DJ5200RF-CALC — ADC12DJ5200RF 入力ネットワークのフルスケール計算ツール。
ADC12DJ5200RF-HSACCURACY-CALC — Accuracy calculation for ADC12DJ5200RF with amplifier input
FREQ-DDC-FILTER-CALC — RF-Sampling Frequency Planner, Analog Filter, and DDC Excel Calculator
この Excel カリキュレータは、システム設計者がダイレクト RF サンプリングレシーバの設計とデバッグを簡素化する方法を提供します。周波数計画、アナログ フィルタリング、デシメーション フィルタのスプリアス位置の 3 つの機能を備えています。
コンセプト フェーズでは、周波数計画ツールを使用して、ADC サンプリング レートと入力周波数の両方の位置を微調整し、ブロッキング イベント時にスプリアス フリー ダイナミック レンジ (SFDR) を最適化できます。一部の設計は、その両方に対応する柔軟性があります。L バンド レシーバやワイヤレス (...)
SLVRBH0 — ADC12DJ5200RF-EVM Assembly Package
TIDA-010128 — 12 ビット デジタイザ向け、スケーラブル 20.8GSPS のリファレンス デザイン
TIDA-01027 — 12.8GSPS データ アクイジション システムの性能を最大化する低ノイズ電源のリファレンス デザイン
TIDA-01028 — 高速オシロスコープおよび広帯域デジタイザ向けの 12.8GSPS アナログ フロント エンドのリファレンス デザイン
| パッケージ | ピン数 | CAD シンボル、フットプリント、および 3D モデル |
|---|---|---|
| FCCSP (AAV) | 144 | Ultra Librarian |
| FCCSP (ZEG) | 144 | Ultra Librarian |
購入と品質
推奨製品には、この TI 製品に関連するパラメータ、評価基板、またはリファレンス デザインが存在する可能性があります。