LMX2594PSEVM
다중 장치 위상 동기화를 지원하는 15GHz RF 신시사이저용 LMX2594 평가 모듈
LMX2594PSEVM
개요
LMX2594 평가 모듈(EVM)은 LMX2594 광대역 RF 신시사이저의 PS(위상 동기화) 기능 평가용 플랫폼입니다. LMX2594PSEVM에는 동일한 레퍼런스 클록을 공유하는 LMX2594 부품 2개가 포함되어 있습니다.
위상 동기화 이후 부품의 출력 위상을 측정 및 비교할 수 있습니다. 또한 EVM에는 위상 동기화 출력 2개를 단일 출력으로 결합해 위상 잡음을 줄이는 데 사용할 수 있는 RF(무선 주파수) 전력 컴바이너가 포함되어 있습니다.
특징
- LMX2594 온보드 2개는 동일한 레퍼런스 클록 및 동기화 신호를 공유합니다
- 매우 짧은 RF 출력 트레이스로 PCB 트레이스 길이 디스큐가 필요 없습니다
- 독립 LDO(저손실) 전원 공급 장치로 전원 공급 라인을 통한 크로스토크가 필요 없습니다
- 온보드 RF 전원 컴바이너를 통해 감소된 위상 잡음 검증을 지원합니다
- Reference Pro 보드(SV601349)
- USB 케이블
- 10핀 리본 케이블
RF PLL 및 신시사이저
시작하기
- LMX2594PSEVM 주문
- Ticspro-SW 및 PLLATINUMSIM-SW 다운로드 및 설치
- LMX2594PSEVM 사용 설명서 읽기
- TICSPRO-SW에 레지스터를 구성하고 PLLATINUMSIM-SW에서 성능 시뮬레이션
주문 및 개발 시작
평가 보드
LMX2594PSEVM — LMX2594 evaluation module for 15-GHz RF synthesizer with multiple-device phase synchronization
LMX2594PSEVM — LMX2594 evaluation module for 15-GHz RF synthesizer with multiple-device phase synchronization
설계 툴
PLLATINUMSIM-SW — PLL 루프 필터, 위상 잡음, 잠금 시간, 스퍼 시뮬레이션 툴
지원되는 제품 및 하드웨어
제품
RF PLL 및 신시사이저
오실레이터
클록 버퍼
클록 생성기
클록 지터 클리너
하드웨어 개발
평가 보드
PLLATINUMSIM-SW — PLL 루프 필터, 위상 잡음, 잠금 시간, 스퍼 시뮬레이션 툴
제품
RF PLL 및 신시사이저
오실레이터
클록 버퍼
클록 생성기
클록 지터 클리너
하드웨어 개발
평가 보드
출시 정보
Added cascaded phase noise analysis
새 소식
- Added cascaded phase noise analysis
지원 소프트웨어
TICSPRO-SW — TICS Pro GUI and Live Programming Tool for Clocking Devices
지원되는 제품 및 하드웨어
제품
RF PLL 및 신시사이저
오실레이터
클록 네트워크 싱크로나이저
클록 버퍼
클록 생성기
클록 지터 클리너
하드웨어 개발
평가 보드
TICSPRO-SW — TICS Pro GUI and Live Programming Tool for Clocking Devices
TICS Pro 1.7.7.6 installer binary for Windows operating system
제품
RF PLL 및 신시사이저
오실레이터
클록 네트워크 싱크로나이저
클록 버퍼
클록 생성기
클록 지터 클리너
하드웨어 개발
평가 보드
문서
TICS Pro 1.7.7.6 Software Manifest
TICS Pro 1.7.7.6 Release Notes
출시 정보
Added Features
LMK5Bxxyyy, LMK5Cxxyyy
- Warnings and errors improved, particularly corrective suggestions
- REFx_FREQ=0 automatically disables DPLL reference input selection for that input
- Input validation enabled and disabled by start page settings, including 1PPS
- APLL reference selection moved to Step 5, just before clock output definition
- Quick-set multiple outputs to the same settings on frequency planner
- BAW VCO allows some ppm deviation
- Force SYSREF option on OUT0/1
- Expose DPLLx_LCK_TIMER field
- Match LMK05318B EEPROM page design
- .EPR export option
- EEPROM SRAM programming generation support
- For complete changelist, see release notes
LMK3H0102
- Configuration search tool
- Wizard: voltage selection option
Bug Fixes
- LMK04832-SP, LMK04832-SEP, LMK04714-Q1, LMK04368-EP - PD_FIN0 corrected to FIN0_PD
- LMK3H0102 - Several wizard bugfixes
Known Issues
- LMK5C33216 - When cascading from VCO3 to DPLL input, the divide value must manually be entered into DPLLx_REF5_RDIV as ( VCO3 output frequency / DPLLx TDC frequency )
- LMK05318 - In some cases, it is necessary to press "Calculate Frequency Plan" twice for correct VCO2 frequency. This issue is resolved in LMK05318B GUI.
- Burst mode page looping requires long delays to halt, and halting may crash the GUI. If possible, do not loop in burst mode.
- User Controls page can sometimes become desynchronized from Raw Registers and other pages. Refer to Raw Registers or other pages for correct values. Saving/Loading and Import/Export of register data is unaffected, and register data will still be written to and read from connected devices correctly.
설계 파일
기술 자료
=
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2개 모두 보기
| 상위 문서 | 유형 | 직함 | 형식 옵션 | 최신 영어 버전 다운로드 | 날짜 |
|---|---|---|---|---|---|
| * | EVM User's guide | LMX2594PSEVM User's Guide | PDF | HTML | 2022. 7. 29 | |
| 인증서 | LMX2594PSEVM EU RoHS Declaration of Conformity (DoC) | PDF | HTML | 2022. 7. 28 |