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LMK1D2108

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デュアル・バンク、8 チャネル出力、1.8V、2.5V、3.3V LVDS バッファ

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LMK1D2108

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製品詳細

Function Clock buffer, Differential Additive RMS jitter (typ) (fs) 45 Output frequency (max) (MHz) 2000 Number of outputs 16 Output supply voltage (V) 1.8, 2.5, 3.3 Core supply voltage (V) 1.8, 2.5, 3.3 Output skew (ps) 20 Features Dual 1:8 fanout, Output enable control, Universal inputs Operating temperature range (°C) -40 to 105 Rating Catalog Output type LVDS Input type HCSL, LP-HCSL, LVCMOS, LVDS, LVPECL
Function Clock buffer, Differential Additive RMS jitter (typ) (fs) 45 Output frequency (max) (MHz) 2000 Number of outputs 16 Output supply voltage (V) 1.8, 2.5, 3.3 Core supply voltage (V) 1.8, 2.5, 3.3 Output skew (ps) 20 Features Dual 1:8 fanout, Output enable control, Universal inputs Operating temperature range (°C) -40 to 105 Rating Catalog Output type LVDS Input type HCSL, LP-HCSL, LVCMOS, LVDS, LVPECL
VQFN (RGZ) 48 49 mm² 7 x 7
  • 高性能 LVDS クロック・バッファ・ファミリ：最大 2GHz
    • デュアル 1：6 差動バッファ
    • デュアル 1：8 差動バッファ
  • 電源電圧：1.71V～3.465V
  • 小さい付加ジッタ：156.25MHz 時、12kHz～20MHz の範囲で最大 60fs RMS
    • 非常に小さい位相ノイズ・フロア：-164dBc/Hz (標準値)
  • 非常に小さい伝搬遅延：575ps (最大値)
  • 出力スキュー：20ps (最大値)
  • 高スイング LVDS (昇圧モード)：AMP_SEL = 1 の場合、500mV VOD (標準値)
  • EN ピンによるバンクのイネーブル / ディスエーブル
  • フェイルセーフ入力動作
  • ユニバーサル入力は LVDS、LVPECL、LVCMOS、HCSL、CML の信号レベルに対応
  • LVDS リファレンス電圧 VAC_REF は、容量性結合入力に使用可能
  • 産業用温度範囲：–40℃～105℃
  • 以下に示すパッケージで供給

    • LMK1D2106：6mm × 6mm、40 ピン VQFN (RHA)

    • LMK1D2108：7mm × 7mm、48 ピン VQFN (RGZ)
  • 高性能 LVDS クロック・バッファ・ファミリ：最大 2GHz
    • デュアル 1：6 差動バッファ
    • デュアル 1：8 差動バッファ
  • 電源電圧：1.71V～3.465V
  • 小さい付加ジッタ：156.25MHz 時、12kHz～20MHz の範囲で最大 60fs RMS
    • 非常に小さい位相ノイズ・フロア：-164dBc/Hz (標準値)
  • 非常に小さい伝搬遅延：575ps (最大値)
  • 出力スキュー：20ps (最大値)
  • 高スイング LVDS (昇圧モード)：AMP_SEL = 1 の場合、500mV VOD (標準値)
  • EN ピンによるバンクのイネーブル / ディスエーブル
  • フェイルセーフ入力動作
  • ユニバーサル入力は LVDS、LVPECL、LVCMOS、HCSL、CML の信号レベルに対応
  • LVDS リファレンス電圧 VAC_REF は、容量性結合入力に使用可能
  • 産業用温度範囲：–40℃～105℃
  • 以下に示すパッケージで供給

    • LMK1D2106：6mm × 6mm、40 ピン VQFN (RHA)

    • LMK1D2108：7mm × 7mm、48 ピン VQFN (RGZ)

LMK1D210x クロック・バッファは、2 つのクロック入力 (IN0 および IN1) を、合計 16 ペアの差動 LVDS クロック出力 (OUT0～OUT15) (LMK1D2108 の場合) 、または12 ペアの差動 LVDS クロック出力 (OUT0～OUT11) (LMK1D2106 の場合) に分配します。このとき、クロック分配のスキューを最小限に抑えます。各バッファ・ブロックは 1 つの入力と最大 6 つ (LMK1D2106) または 8 つ (LMK1D2108) の LVDS 出力で構成されます。入力は LVDS、LVPECL、HCSL、CML、LVCMOS のいずれかに対応可能です。

LMK1D210x は、50Ω 伝送経路の駆動に特化して設計されています。シングルエンド・モードで入力を駆動する場合は、未使用の負入力ピンに適切なバイアス電圧を印加する必要があります (Figure 8-6 参照)。

制御ピン (EN) を使用して、出力バンクをイネーブルまたはディセーブルできます。このピンがオープンのままの場 合、両方のバンク出力がイネーブルになります。制御ピンがロジック「0」の場合、両方のバンク出力がディセーブルになります (静的ロジック「0」)。制御ピンがロジック「1」の場合、一方のバンクの出力がディセーブルになりますが、他のバンクの出力はイネーブルになります。このデバイスは、フェイルセーフ機能をサポートしています。さらに、このデバイスは入力ヒステリシスを備えており、入力信号が存在しないときに出力がランダムに発振することを防止します。

このデバイスは、1.8V、2.5V または 3.3V 電源で動作し、-40℃～105℃ (周囲温度) で動作が規定されています。

LMK1D210x クロック・バッファは、2 つのクロック入力 (IN0 および IN1) を、合計 16 ペアの差動 LVDS クロック出力 (OUT0～OUT15) (LMK1D2108 の場合) 、または12 ペアの差動 LVDS クロック出力 (OUT0～OUT11) (LMK1D2106 の場合) に分配します。このとき、クロック分配のスキューを最小限に抑えます。各バッファ・ブロックは 1 つの入力と最大 6 つ (LMK1D2106) または 8 つ (LMK1D2108) の LVDS 出力で構成されます。入力は LVDS、LVPECL、HCSL、CML、LVCMOS のいずれかに対応可能です。

LMK1D210x は、50Ω 伝送経路の駆動に特化して設計されています。シングルエンド・モードで入力を駆動する場合は、未使用の負入力ピンに適切なバイアス電圧を印加する必要があります (Figure 8-6 参照)。

制御ピン (EN) を使用して、出力バンクをイネーブルまたはディセーブルできます。このピンがオープンのままの場 合、両方のバンク出力がイネーブルになります。制御ピンがロジック「0」の場合、両方のバンク出力がディセーブルになります (静的ロジック「0」)。制御ピンがロジック「1」の場合、一方のバンクの出力がディセーブルになりますが、他のバンクの出力はイネーブルになります。このデバイスは、フェイルセーフ機能をサポートしています。さらに、このデバイスは入力ヒステリシスを備えており、入力信号が存在しないときに出力がランダムに発振することを防止します。

このデバイスは、1.8V、2.5V または 3.3V 電源で動作し、-40℃～105℃ (周囲温度) で動作が規定されています。
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* データシート LMK1D210x 低付加ジッタ LVDS バッファ データシート (Rev. A 翻訳版) PDF | HTML 英語版をダウンロード (Rev.A) PDF | HTML 2022年 3月 17日

設計および開発

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評価ボード

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購入と品質

記載されている情報：
  • RoHS
  • REACH
  • デバイスのマーキング
  • リード端子の仕上げ / ボールの原材料
  • MSL rating / リフローピーク温度
  • MTBF/FIT 推定値
  • 材料 (内容)
  • 認定試験結果
  • 継続的な信頼性モニタ試験結果

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サポートとトレーニング

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