CDCLVD1204
- 2:4 差動バッファ
- 小さい付加ジッタ：10kHz ～ 20MHz の範囲で 300fs RMS 未満
- 20ps (最大値) の低い出力スキュー
- ユニバーサル入力は LVDS、LVPECL、および LVCMOS に対応
- 制御端子によりクロック入力を選択可能
- 4 個の LVDS 出力、ANSI EIA/TIA-644A 規格互換
- クロック周波数：最大 800MHz
- デバイス電源：2.375V ～ 2.625V
- LVDS リファレンス電圧 VAC_REF を容量性結合入力に使用可能
- 産業用温度範囲：-40℃ ～ 85℃
- 3mm × 3mm、16 ピン VQFN (RGT) パッケージで供給
- 3kV HBM、1kV CDM を超える ESD 保護
CDCLVD1204 クロック バッファは、2 つのクロック入力 (IN0 および IN1) のいずれか 1 つを 4 ペアの差動 LVDS クロック出力 (OUT0～OUT3) に分配します。このとき、クロック分配のスキューを最小限に抑えます。CDCLVD1204 は、入力マルチプレクサに 2 つのクロック ソースを接続できます。入力は LVDS、LVPECL、LVCMOS のいずれかに対応可能です。
CDCLVD1204 は、50Ω の伝送経路の駆動に特化して設計されています。シングルエンド モードで入力を駆動する場合には、適切なバイアス電圧、VAC_REFを未使用の負入力ピンに印加する必要があります。
IN_SEL ピンは、どの入力を出力に転送するかを選択します。このピンがオープンのままの場合、出力はディセーブルになります (静的状態)。このデバイスは、フェイルセーフ機能をサポートしています。このデバイスは入力ヒステリシスを備えており、入力信号が存在しないときに出力がランダムに発振することを防止します。
このデバイスは、電源電圧 2.5V の環境で動作し、-40℃～85℃ (周囲温度) で仕様が規定されています。CDCLVD1204 は、小型の 16 ピン 3mm × 3mm VQFN パッケージで提供されます。
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技術資料
| 上位の文書 | タイプ | タイトル | フォーマットオプション | 最新の英語版をダウンロード | 日付 | |
|---|---|---|---|---|---|---|
| * | データシート | CDCLVD1204 2:4 低付加ジッタ LVDS バッファ データシート (Rev. C 翻訳版) | PDF | HTML | 最新英語版 (Rev.B) | PDF | HTML | 2026/05/19 |
| アプリケーション・ノート | Sine to Square Wave Conversion Using Clock Buffers | PDF | HTML | 2024/09/03 | |||
| アプリケーション・ノート | Clocking Design Guidelines: Unused Pins | 2015/11/19 | ||||
| ユーザー・ガイド | Low-Additive Jitter, Four LVDS Outputs Clock Buffer Evaluation Board | 2010/06/14 |
設計と開発
その他のアイテムや必要なリソースを参照するには、以下のタイトルをクリックして詳細ページをご覧ください。
CDCLVD1204EVM — CDCLVD1204 評価モジュール
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| パッケージ | ピン数 | CAD シンボル、フットプリント、および 3D モデル |
|---|---|---|
| VQFN (RGT) | 16 | Ultra Librarian |
購入と品質
推奨製品には、この TI 製品に関連するパラメータ、評価基板、またはリファレンス デザインが存在する可能性があります。