LMK04832-SEP
Radiation-tolerant, 30krad, ultra-low-noise, 3.2GHz 15-output JESD204C clock jitter cleaner
LMK04832-SEP
- VID#: V62/22612
- 総照射線量耐性：30krad (ELDRS フリー)
- SEL 耐性 > 43MeV × cm2/mg
- SEFI 耐性 > 43MeV × cm2/mg
- 周囲温度範囲：-55℃～125℃
- 最高クロック出力周波数：3255MHz
- マルチモード：デュアル PLL、シングル PLL、クロック・ディストリビューション
- 6GHz の外部 VCO または分配入力に対応
- 超低ノイズ (2500MHz 時)：
- RMS ジッタ (12kHz～20MHz)：54fs
- RMS ジッタ (100Hz～20MHz)：64fs
- -157.6dBc/Hz のノイズ・フロア
- 超低ノイズ (3200MHz 時)：
- RMS ジッタ (12kHz～20MHz)：61fs
- RMS ジッタ (100Hz～100MHz)：67fs
- -156.5dBc/Hz のノイズ・フロア
- PLL2
- PLL FOM：-230dBc/Hz
- PLL 1/f：-128dBc/Hz
- 位相検出速度：最高 320MHz
- 2 つの VCO を内蔵2440～2600MHz および 2945～3255MHz
- 最大 14 個の差動デバイス・クロック
- CML、LVPECL、LCPECL、HSDS、LVDS、2xLVCMOS プログラマブル出力
- 最大 1 個のバッファ付き VCXO/XO 出力
- LVPECL、LVDS、2xLVCMOS をプログラム可能
- 1～1023 の CLKOUT 分周器
- 1～8191 の SYSREF 分周器
- SYSREF クロックの 25ps ステップ・アナログ遅延
- デバイス・クロックおよび SYSREF のデジタル遅延および動的デジタル遅延
- PLL1 によるホールドオーバー・モード
- PLL1 または PLL2 による 0 遅延
- 高信頼性
- 管理されたベースライン
- 単一のアセンブリ / テスト施設
- 単一の製造施設
- 長期にわたる製品ライフ・サイクル
- 長期にわたる製品変更通知
- 製品のトレーサビリティ
LMK04832-SEP は、JEDEC JESD204B/C をサポートする宇宙アプリケーション向け高性能クロック・コンディショナです。
PLL2 からの 14 のクロック出力を構成して、7 つの JESD204B/C コンバータ、あるいはデバイス・クロックおよび SYSREF クロックを使用するその他のロジック・デバイスを駆動できます。DC および AC 結合により SYSREF を生成することが可能です。JESD204B/C アプリケーションに限らず、従来のクロッキング・システム向けに 14 の出力をそれぞれ高性能出力として個別に構成できます。
このデバイスは、SYSREF の生成またはリクロッキングの有無にかかわらず、デュアル PLL、シングル PLL、またはクロック分配モードで動作するように構成できます。PLL2 は内蔵 VCO でも外付け VCO でも動作します。
高性能である上に、電力と性能のトレードオフ調整、デュアル VCO、動的デジタル遅延、ホールドオーバーなどの機能を備えているため、柔軟性の高い高性能クロック・ツリーを実現できます。
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比較対象デバイスと類似の機能。
技術資料
| 上位の文書 | タイプ | タイトル | フォーマットオプション | 最新の英語版をダウンロード | 日付 | |
|---|---|---|---|---|---|---|
| * | データシート | LMK04832-SEP 宇宙グレード、超低ノイズ、JESD204B/C 対応、デュアル・ループ・クロック・ジッタ・クリーナ データシート (Rev. A 翻訳版) | PDF | HTML | 英語版 (Rev.A) | PDF | HTML | 2022/12/23 |
| * | 放射線と信頼性レポート | LMK04832-SEP TID RLAT Report | 2022/11/19 | |||
| * | 放射線と信頼性レポート | LMK04832-SEP Process Flow and Reliability Report | PDF | HTML | 2022/11/18 | ||
| * | 放射線と信頼性レポート | LMK04832-SEP Single-Event Effects Report | PDF | HTML | 2022/11/18 | ||
| アプリケーション・ノート | 次世代の高速コンバータ設計に優位性をもたらす実用的なクロッキ ングに関する考慮事項 (Rev. A 翻訳版) | PDF | HTML | 英語版 (Rev.A) | PDF | HTML | 2025/05/01 | |
| アプリケーション・ノート | Multi-Clock Synchronization | 2019/12/30 | ||||
| アナログ デザイン ジャーナル | JESD204B multi-device synchronization: Breaking down the requirements | 2015/04/28 | ||||
| アナログ デザイン ジャーナル | When is the JESD204B interface the right choice? | 2014/01/22 |
設計と開発
その他のアイテムや必要なリソースを参照するには、以下のタイトルをクリックして詳細ページをご覧ください。
LMK04832SEPEVM — LMK04832-SEP 超低ノイズ、3.2GHz、15 出力、クロック ジッタ クリーナ用評価基板
LMK04832-SEP 評価基板 (EVM) は、LMK04832-SEP の性能と機能を評価するためのプラットフォームです。この製品は、宇宙グレード、超低ノイズ、JESD204B/C 対応、デュアル ループ クロック ジッタ クリーナです。
各 評価基板 (EVM) が搭載している LMK04832-SEP デバイスはエンジニアリング モデルであり、エンジニアリング評価のみを意図しています。このデバイスと評価基板 (EVM) は、
認定、量産、放射線テスト、航空での使用には適していません。
ALPHA-3P-ADM-VA601-SPACE-AMD — AMD Versal コア XQRVC1902 ACAP と TI の耐放射線特性製品を採用した Alpha Data の ADM-VA601 キット
これは 6U の VPX フォーム ファクタで、AMD-Xilinx® Versal AI Core XQRVC1902 適応型 SoC/FPGA を提示します。ADM-VA600 は、1 個の FMC+ コネクタ、DDR4 DRAM、システム監視機能を搭載したモジュール型ボードのデザインです。主な部品は、耐放射線特性のパワー マネージメント、インターフェイス、クロック処理機能、組込みプロセッシング (-SEP) の各デバイスです。
TICSPRO-SW — TICS Pro GUI and Live Programming Tool for Clocking Devices
TICS ( テキサス・インスツルメンツのクロックとシンセサイザ) Pro ソフトウェアを使用すると、接頭辞 (製品型番の先頭部分) が以下のいずれかに該当する製品と組み合わせて、評価基板 (EVM) をプログラム (設定) することができます。CDC、LMK、LMX。これらの製品は、フェーズ ロック ループと電圧制御発振器 (PLL+VCO)、シンセサイザ、クロック関連デバイスを搭載しています。
CLOCK-TREE-ARCHITECT — Clock tree architect プログラミング ソフトウェア
Clock tree architect はクロック ツリーの合成ツールであり、開発中システムの要件に基づいてクロック ツリー ソリューションを生成する方法で、お客様の設計プロセスの効率化に貢献します。このツールは、多様なクロック供給製品を収録した包括的なデータベースからデータを抽出し、システム レベルのマルチチップ クロック供給ソリューションを生成します。
PLLATINUMSIM-SW — PLL ループ フィルタ、位相ノイズ、ロック時間、スプア シミュレーション ツール
PLLATINUMSIM-SW は、開発ユーザーが TI の各種 PLLatinum™ IC の詳細な設計とシミュレーションを行うためのシミュレーション ツールです。これらの IC は LMX シリーズのフェーズ ロック ループ (PLL) とシンセサイザを搭載しています。
TIDA-010260 — 4T5R 宇宙グレード統合型トランシーバのリファレンス デザイン
4T5R 宇宙グレード統合型トランシーバのリファレンス デザインは、クロッキング ソリューションと電源ソリューションを搭載したフル RF サンプリング トランシーバを組み込んでいます。このデザインでは、すべて SEP 特性の TI デバイスと宇宙認定取得済みの受動部品が VITA-57 フォーム ファクタ内に搭載されています。
TIDA-010274 — 宇宙グレードのディスクリート RF サンプリング トランシーバのリファレンス デザイン
このリファレンス デザインは、10GSPS のデュアル D/A コンバータと、5GSPS のデュアル A/D コンバータを搭載しているほか、X バンドまでの各帯域をサポートする RF インターフェイスに複数のアクティブ バランを採用しています。このデザインには、宇宙グレードのクロック処理ドーター カードと、宇宙グレードの電源ソリューション ドーター カードも付属しています。
| パッケージ | ピン数 | CAD シンボル、フットプリント、および 3D モデル |
|---|---|---|
| HTQFP (PAP) | 64 | Ultra Librarian |
購入と品質
推奨製品には、この TI 製品に関連するパラメータ、評価基板、またはリファレンス デザインが存在する可能性があります。