ホーム クロックとタイミング クロック・ジッタ・クリーナとシンクロナイザ
ホーム
クロックとタイミング
クロック・ジッタ・クリーナとシンクロナイザ

LMK04805

アクティブ

デュアル・カスケード接続 PLL と 2.2GHz VCO 内蔵、低ノイズのクロック・ジッタ・クリーナ

ご注文はこちら
データシート

LMK04805

アクティブ
データシート ご注文はこちら

製品詳細

Function Cascaded PLLs Number of outputs 14 RMS jitter (fs) 111 Output frequency (min) (MHz) 0.22 Output frequency (max) (MHz) 2370 Input type LVCMOS, LVDS, LVPECL Output type LVCMOS, LVDS, LVPECL Supply voltage (min) (V) 3.15 Supply voltage (max) (V) 3.45 Features 0 Delay Rating Catalog Operating temperature range (°C) -40 to 85 Number of input channels 2
Function Cascaded PLLs Number of outputs 14 RMS jitter (fs) 111 Output frequency (min) (MHz) 0.22 Output frequency (max) (MHz) 2370 Input type LVCMOS, LVDS, LVPECL Output type LVCMOS, LVDS, LVPECL Supply voltage (min) (V) 3.15 Supply voltage (max) (V) 3.45 Features 0 Delay Rating Catalog Operating temperature range (°C) -40 to 85 Number of input channels 2
WQFN (NKD) 64 81 mm² 9 x 9
  • Ultra-Low RMS Jitter Performance
    • 111 fs RMS Jitter (12 kHz to 20 MHz)
    • 123 fs RMS Jitter (100 Hz to 20 MHz)
  • Dual Loop PLLatinum™ PLL Architecture
  • PLL1
    • Integrated Low-Noise Crystal Oscillator
      Circuit
    • Holdover Mode when Input Clocks are Lost
    • Automatic or Manual Triggering/Recovery
  • PLL2
    • Normalized PLL Noise Floor of –227 dBc/Hz
    • Phase Detector Rate up to 155 MHz
    • OSCin Frequency-Doubler
    • Integrated Low-Noise VCO
  • 2 Redundant Input Clocks with LOS
    • Automatic and Manual Switch-Over Modes
  • 50 % Duty Cycle Output Divides, 1 to 1045 (Even
    and Odd)
  • 12 LVPECL, LVDS, or LVCMOS Programmable
    Outputs
  • Digital Delay: Fixed or Dynamically Adjustable
  • 25 ps Step Analog Delay Control.
  • 14 Differential Outputs. Up to 26 Single Ended.
    • Up to 6 VCXO/Crystal Buffered Outputs
  • Clock Rates of up to 1536 MHz
  • 0-Delay Mode
  • Three Default Clock Outputs at Power Up
  • Multi-Mode: Dual PLL, Single PLL, and Clock
    Distribution
  • Industrial Temperature Range: –40 to 85°C
  • 3.15-V to 3.45-V Operation
  • 2 Dedicated Buffered/Divided OSCin Clocks
  • Package: 64-Pin WQFN (9.0 × 9.0 × 0.8 mm)
  • Ultra-Low RMS Jitter Performance
    • 111 fs RMS Jitter (12 kHz to 20 MHz)
    • 123 fs RMS Jitter (100 Hz to 20 MHz)
  • Dual Loop PLLatinum™ PLL Architecture
  • PLL1
    • Integrated Low-Noise Crystal Oscillator
      Circuit
    • Holdover Mode when Input Clocks are Lost
    • Automatic or Manual Triggering/Recovery
  • PLL2
    • Normalized PLL Noise Floor of –227 dBc/Hz
    • Phase Detector Rate up to 155 MHz
    • OSCin Frequency-Doubler
    • Integrated Low-Noise VCO
  • 2 Redundant Input Clocks with LOS
    • Automatic and Manual Switch-Over Modes
  • 50 % Duty Cycle Output Divides, 1 to 1045 (Even
    and Odd)
  • 12 LVPECL, LVDS, or LVCMOS Programmable
    Outputs
  • Digital Delay: Fixed or Dynamically Adjustable
  • 25 ps Step Analog Delay Control.
  • 14 Differential Outputs. Up to 26 Single Ended.
    • Up to 6 VCXO/Crystal Buffered Outputs
  • Clock Rates of up to 1536 MHz
  • 0-Delay Mode
  • Three Default Clock Outputs at Power Up
  • Multi-Mode: Dual PLL, Single PLL, and Clock
    Distribution
  • Industrial Temperature Range: –40 to 85°C
  • 3.15-V to 3.45-V Operation
  • 2 Dedicated Buffered/Divided OSCin Clocks
  • Package: 64-Pin WQFN (9.0 × 9.0 × 0.8 mm)

The LMK0480x family is the industry’s highest performance clock conditioner with superior clock jitter cleaning, generation, and distribution with advanced features to meet next generation system requirements. The dual loop PLLatinum architecture is capable of 111 fs rms jitter (12 kHz to 20 MHz) using a low noise VCXO module or sub-200 fs rms jitter (12 kHz to 20 MHz) using a low cost external crystal and varactor diode.

The dual loop architecture consists of two high-performance phase-locked loops (PLL), a low-noise crystal oscillator circuit, and a high-performance voltage controlled oscillator (VCO). The first PLL (PLL1) provides low-noise jitter cleaner functionality while the second PLL (PLL2) performs the clock generation. PLL1 can be configured to either work with an external VCXO module or the integrated crystal oscillator with an external tunable crystal and varactor diode. When paired with a very narrow loop bandwidth, PLL1 uses the superior close-in phase noise (offsets below 50 kHz) of the VCXO module or the tunable crystal to clean the input clock. The output of PLL1 is used as the clean input reference to PLL2 where it locks the integrated VCO. The loop bandwidth of PLL2 can be optimized to clean the far-out phase noise (offsets above 50 kHz) where the integrated VCO outperforms the VCXO module or tunable crystal used in PLL1.

The LMK0480x family is the industry’s highest performance clock conditioner with superior clock jitter cleaning, generation, and distribution with advanced features to meet next generation system requirements. The dual loop PLLatinum architecture is capable of 111 fs rms jitter (12 kHz to 20 MHz) using a low noise VCXO module or sub-200 fs rms jitter (12 kHz to 20 MHz) using a low cost external crystal and varactor diode.

The dual loop architecture consists of two high-performance phase-locked loops (PLL), a low-noise crystal oscillator circuit, and a high-performance voltage controlled oscillator (VCO). The first PLL (PLL1) provides low-noise jitter cleaner functionality while the second PLL (PLL2) performs the clock generation. PLL1 can be configured to either work with an external VCXO module or the integrated crystal oscillator with an external tunable crystal and varactor diode. When paired with a very narrow loop bandwidth, PLL1 uses the superior close-in phase noise (offsets below 50 kHz) of the VCXO module or the tunable crystal to clean the input clock. The output of PLL1 is used as the clean input reference to PLL2 where it locks the integrated VCO. The loop bandwidth of PLL2 can be optimized to clean the far-out phase noise (offsets above 50 kHz) where the integrated VCO outperforms the VCXO module or tunable crystal used in PLL1.
open-in-new その他の クロック・ジッタ・クリーナとシンクロナイザ を検索
ダウンロード 字幕付きのビデオを表示 ビデオ

お客様が関心を持ちそうな類似製品

open-in-new 代替品と比較
比較対象デバイスと同等の機能で、ピン互換製品
LMK04803 アクティブ デュアル・カスケード接続 PLL と 1.9GHz VCO 内蔵、低ノイズのクロック・ジッタ・クリーナ Low Noise Clock Jitter Cleaner With Dual Cascaded PLLs and Integrated 1.9 GHz VCO
LMK04806 アクティブ デュアル・カスケード接続 PLL と 2.5GHz VCO 内蔵、低ノイズのクロック・ジッタ・クリーナ Low Noise Clock Jitter Cleaner With Dual Cascaded PLLs and Integrated 2.5 GHz VCO
LMK04808 アクティブ デュアル・ループ PLL と 2.9GHz VCO 内蔵、低ノイズ・クロック・ジッタ・クリーナ Low Noise Clock Jitter Cleaner With Dual Cascaded PLLs and Integrated 2.9 GHz VCO
比較対象デバイスと類似の機能
LMK04821 アクティブ JESD204B サポート、超低ジッタ・シンセサイザとジッタ・クリーナ LMK04821( it has additional features and better performance)

技術資料

star =TI が選定したこの製品の主要ドキュメント
結果が見つかりませんでした。検索条件をクリアして、もう一度検索を行ってください。
9 をすべて表示
種類 タイトル 最新の英語版をダウンロード 日付
* データシート LMK0480x Low-Noise Clock Jitter Cleaner with Dual Loop PLLs データシート (Rev. K) PDF | HTML 2014年 12月 24日
ユーザー・ガイド TSW308x Evaluation Module (Rev. B) 2016年 5月 18日
EVM ユーザー ガイド (英語) TSW4806EVM User's Guide (Rev. A) 2016年 4月 26日
EVM ユーザー ガイド (英語) LMK0480x Evaluation Board Instructions (Rev. B) 2014年 8月 4日
その他の技術資料 クロック＆タイミング・ソリューション (Rev. A 翻訳版) 2013年 12月 11日
設計ガイド TSW1265 Dual-Wideband RF-to-Digital Receiver Design Guide 2013年 9月 3日
アプリケーション・ノート Using the LMK0480x/LMK04906 for Hitless Switching and Holdover 2013年 7月 12日
ユーザー・ガイド TSW3085EVM ACPR and EVM Measurements (TIDA-00076 Reference Guide) 2011年 12月 29日
設計ガイド Clock Conditioner Owner's Manual 2006年 11月 10日

設計および開発

その他のアイテムや必要なリソースを参照するには、以下のタイトルをクリックして詳細ページを表示してください。

評価ボード

DAC34SH84EVM — DAC34SH84 評価モジュール

The DAC34SH84EVM is a circuit board that allows designers to evaluate the performance of Texas Instruments' four-channel, ultra-low power, 16-bit, 1.5 GSPS DAC34SH84 digital-to-analog converter (DAC) with 32-bit wide DDR LVDS data input, integrated 2x/4x/8x/16x interpolation filters, 32-bit NCO and (...)

ユーザー・ガイド: PDF
TI.com で取扱いなし
評価ボード

LMK04805BEVAL — クロック・ジッタ・クリーナ、デュアル・カスケード接続 PLL/ 2.2GHz VCO 内蔵

The LMK04800 family is the industry's highest performance clock conditioner with superior clock jitter cleaning, generation, and distribution with advanced features to meet next generation system requirements. The dual loop PLLatinum? architecture enables 111 fs rms jitter (12 kHz to 20 MHz) using (...)

ユーザー・ガイド: PDF
TI.com で取扱いなし
評価ボード

TSW1265EVM — 広帯域、2回路 レシーバ・リファレンス・デザイン / 評価プラットフォーム

The TSW1265EVM is a wideband dual receiver reference design and evaluation platform. The signal chain allows conversion from RF to bits using a dual-channel downconverter mixer, the LMH6521 dual-channel DVGA, and the ADS4249 14-bit 250-MSPS ADC. The TSW1265EVM also includes the LMK04800 dual-PLL (...)

ユーザー・ガイド: PDF
TI.com で取扱いなし
評価ボード

TSW3084EVM — RF シグナル・チェーン評価モジュール一式

The TSW3084EVM Evaluation Module is a circuit board that allows system designers to evaluate the combined performance of Texas Instruments' transmit signal chain with the LMK04806B low noise clock generator/jitter cleaner. For ease of use as a complete RF transmit solution the TSW3084EVM includes (...)

ユーザー・ガイド: PDF
TI.com で取扱いなし
評価ボード

TSW30H84EVM — RF シグナル・チェーン評価モジュール一式

The TSW30H84EVM Evaluation Module is a circuit board that allows system designers to evaluate the combined performance of Texas Instruments' transmit signal chain with the LMK04806B (Please see LMK04800) low noise clock generator/jitter cleaner. For ease of use as a complete RF transmit solution (...)

ユーザー・ガイド: PDF
TI.com で取扱いなし
評価ボード

TSW30SH84EVM — RF シグナル・チェーン評価モジュール一式

The TSW30SH84EVM Evaluation Module is a circuit board that allows system designers to evaluate the combined performance of Texas Instruments' transmit signal chain with the LMK04800 low noise clock generator/jitter cleaner. For ease of use as a complete RF transmit solution the TSW30SH84EVM (...)

ユーザー・ガイド: PDF
TI.com で取扱いなし
評価基板 (EVM) 向けの GUI

SLAC507 — TSW308x EVM Software

サポート対象の製品とハードウェア

サポート対象の製品とハードウェア

製品
高速 DAC (10MSPS 超過)
DAC3482 — デュアルチャネル、16 ビット、1.25GSPS、1x ～ 16x 補間 D/A コンバータ (DAC) DAC3484 — クワッドチャネル、16 ビット、1.25GSPS、1x ～ 16x 補間 D/A コンバータ (DAC) DAC34H84 — クワッドチャネル、16 ビット、1.25GSPS、1x ～ 16x 補間 D/A コンバータ (DAC) DAC34SH84 — クワッドチャネル、16 ビット、1.5GSPS、1x ～ 16x 補間 D/A コンバータ (DAC)
IQ 変調器
TRF3705 — 300MHz ～ 4GHz 直交変調器
クロック・ジッタ・クリーナとシンクロナイザ
LMK04803 — デュアル・カスケード接続 PLL と 1.9GHz VCO 内蔵、低ノイズのクロック・ジッタ・クリーナ LMK04805 — デュアル・カスケード接続 PLL と 2.2GHz VCO 内蔵、低ノイズのクロック・ジッタ・クリーナ LMK04806 — デュアル・カスケード接続 PLL と 2.5GHz VCO 内蔵、低ノイズのクロック・ジッタ・クリーナ LMK04808 — デュアル・ループ PLL と 2.9GHz VCO 内蔵、低ノイズ・クロック・ジッタ・クリーナ
ハードウェア開発
評価ボード
TSW3084EVM — RF シグナル・チェーン評価モジュール一式 TSW3085EVM — TSW3085EVM TSW30H84EVM — RF シグナル・チェーン評価モジュール一式 TSW30SH84EVM — RF シグナル・チェーン評価モジュール一式
ダウンロード
評価基板 (EVM) 向けの GUI

SLAC532 — TSW4806 Installer GUI

サポート対象の製品とハードウェア

サポート対象の製品とハードウェア

製品
クロック・ジッタ・クリーナとシンクロナイザ
LMK04803 — デュアル・カスケード接続 PLL と 1.9GHz VCO 内蔵、低ノイズのクロック・ジッタ・クリーナ LMK04805 — デュアル・カスケード接続 PLL と 2.2GHz VCO 内蔵、低ノイズのクロック・ジッタ・クリーナ LMK04806 — デュアル・カスケード接続 PLL と 2.5GHz VCO 内蔵、低ノイズのクロック・ジッタ・クリーナ LMK04808 — デュアル・ループ PLL と 2.9GHz VCO 内蔵、低ノイズ・クロック・ジッタ・クリーナ
ダウンロード
シミュレーション・モデル

LMK04805 IBIS Model (Rev. C)

SNAM098C.ZIP (111 KB) - IBIS Model
ダウンロード
設計ツール

CLOCK-TREE-ARCHITECT — Clock tree architect プログラミング・ソフトウェア

Clock tree architect はクロック・ツリーの合成ツールであり、開発中システムの要件に基づいてクロック・ツリー・ソリューションを生成する方法で、お客様の設計プロセスの効率化に貢献します。このツールは、多様なクロック供給製品を収録した包括的なデータベースからデータを抽出し、システム・レベルのマルチチップ・クロック供給ソリューションを生成します。
設計を開始
シミュレーション・ツール

PSPICE-FOR-TI — TI Design / シミュレーション・ツール向け PSpice®

PSpice® for TI は、各種アナログ回路の機能評価に役立つ、設計とシミュレーション向けの環境です。設計とシミュレーションに適したこのフル機能スイートは、Cadence® のアナログ分析エンジンを使用しています。PSpice for TI は無償で使用でき、アナログや電源に関する TI の製品ラインアップを対象とする、業界でも有数の大規模なモデル・ライブラリが付属しているほか、選択された一部のアナログ動作モデルも利用できます。

設計とシミュレーション向けの環境である PSpice for TI (...)
リクエスト
パッケージ ピン数 ダウンロード
WQFN (NKD) 64 オプションの表示
TI の評価品に関する標準契約約款が適用されます。

購入と品質

記載されている情報：
  • RoHS
  • REACH
  • デバイスのマーキング
  • リード端子の仕上げ / ボールの原材料
  • MSL rating / リフローピーク温度
  • MTBF/FIT 推定値
  • 材料 (内容)
  • 認定試験結果
  • 継続的な信頼性モニタ試験結果

推奨製品には、この TI 製品に関連するパラメータ、評価基板、またはリファレンス・デザインが存在する可能性があります。

サポートとトレーニング

TI E2E™ Forums (英語) では、TI のエンジニアからの技術サポートが活用できます

英語で投稿されたすべてのフォーラムトピックを表示

コンテンツは、TI 投稿者やコミュニティ投稿者によって「現状のまま」提供されるもので、TI による仕様の追加を意図するものではありません。使用条件をご確認ください。

TI 製品の品質、パッケージ、ご注文に関するお問い合わせは、TI サポートをご覧ください。​​​​​​​​​​​​​​

ビデオ