製品詳細

Function Dual-loop PLL Number of outputs 10 RMS jitter (fs) 65 Output frequency (Min) (MHz) 0.03 Output frequency (Max) (MHz) 2000 Input type LVCMOS, LVDS, LVPECL Output type LVDS, LVPECL Supply voltage (Min) (V) 1.7 Supply voltage (Max) (V) 3.465 Features JESD204B Operating temperature range (C) -40 to 85
Function Dual-loop PLL Number of outputs 10 RMS jitter (fs) 65 Output frequency (Min) (MHz) 0.03 Output frequency (Max) (MHz) 2000 Input type LVCMOS, LVDS, LVPECL Output type LVDS, LVPECL Supply voltage (Min) (V) 1.7 Supply voltage (Max) (V) 3.465 Features JESD204B Operating temperature range (C) -40 to 85
VQFN (RTQ) 56 64 mm² 8 x 8
  • デュアル・ループ DLL アーキテクチャ
  • 超低ノイズ (10kHz~20MHz)
    • RMS ジッタ (1966.08MHz):48fs
    • RMS ジッタ (983.04MHz):50fs
    • RMS ジッタ (122.88MHz):61fs
  • ノイズ・フロア (122.88MHz):-165dBc/Hz
  • JESD204B をサポート
    • シングル・ショット、パルス、連続の SYSREF
  • 4 つの周波数グループの 16 の差動出力クロック
    • 700mVpp~1600mVpp のプログラム可能な出力スイング
    • 各出力ペアを SYSREF クロック出力に構成可能
    • 16 ビットのチャネル分周器
    • 最低 SYSREF 周波数 25kHz
    • 最高出力周波数:2GHz
    • 高精度デジタル遅延、動的に調整可能
      • クロック分配パス周波数 × 1/2 のデジタル遅延 (DDLY) (最高 2GHz)
    • 60ps ステップのアナログ遅延
    • 50% デューティ・サイクルの出力分周、1~65535
      (偶数または奇数)
  • 2 つのリファレンス入力
    • 入力喪失時のホールドオーバー・モード
    • 自動および手動スイッチオーバー・モード
    • 信号喪失 (LOS) 検出
  • 消費電力 0.88W (標準値、10 出力がアクティブな場合)
  • 通常、1.8V (出力、入力) および 3.3V (デジタル、PLL1、PLL2_OSC、PLL2 コア) 電源で動作
  • プログラム可能なループ・フィルタを完全統合
  • PLL2
    • 最大レート 250MHz の PLL2 位相検出器
    • OSCin 周波数ダブラー
    • 低ノイズ VCO を内蔵
  • 内部電力調整:VDDO で -80dBc より優れた PSRR により 122.88MHz の差動出力を実現
  • 3 線式または 4 線式 SPI インターフェイス (4 線式がデフォルト)
  • 産業用周囲温度:-40ºC~+85ºC
  • 105ºC の PCB 温度をサポート (サーマル・パッドで測定)
  • LMK04610:8mm × 8mm の VQFN-56 パッケージ (0.5mm ピッチ)
  • デュアル・ループ DLL アーキテクチャ
  • 超低ノイズ (10kHz~20MHz)
    • RMS ジッタ (1966.08MHz):48fs
    • RMS ジッタ (983.04MHz):50fs
    • RMS ジッタ (122.88MHz):61fs
  • ノイズ・フロア (122.88MHz):-165dBc/Hz
  • JESD204B をサポート
    • シングル・ショット、パルス、連続の SYSREF
  • 4 つの周波数グループの 16 の差動出力クロック
    • 700mVpp~1600mVpp のプログラム可能な出力スイング
    • 各出力ペアを SYSREF クロック出力に構成可能
    • 16 ビットのチャネル分周器
    • 最低 SYSREF 周波数 25kHz
    • 最高出力周波数:2GHz
    • 高精度デジタル遅延、動的に調整可能
      • クロック分配パス周波数 × 1/2 のデジタル遅延 (DDLY) (最高 2GHz)
    • 60ps ステップのアナログ遅延
    • 50% デューティ・サイクルの出力分周、1~65535
      (偶数または奇数)
  • 2 つのリファレンス入力
    • 入力喪失時のホールドオーバー・モード
    • 自動および手動スイッチオーバー・モード
    • 信号喪失 (LOS) 検出
  • 消費電力 0.88W (標準値、10 出力がアクティブな場合)
  • 通常、1.8V (出力、入力) および 3.3V (デジタル、PLL1、PLL2_OSC、PLL2 コア) 電源で動作
  • プログラム可能なループ・フィルタを完全統合
  • PLL2
    • 最大レート 250MHz の PLL2 位相検出器
    • OSCin 周波数ダブラー
    • 低ノイズ VCO を内蔵
  • 内部電力調整:VDDO で -80dBc より優れた PSRR により 122.88MHz の差動出力を実現
  • 3 線式または 4 線式 SPI インターフェイス (4 線式がデフォルト)
  • 産業用周囲温度:-40ºC~+85ºC
  • 105ºC の PCB 温度をサポート (サーマル・パッドで測定)
  • LMK04610:8mm × 8mm の VQFN-56 パッケージ (0.5mm ピッチ)

LMK0461xデバイス・ファミリは、業界最高水準の性能と最低水準の消費電力を誇るJESD204B対応ジッタ・クリーナです。

LMK0461xデバイス・ファミリは、業界最高水準の性能と最低水準の消費電力を誇るJESD204B対応ジッタ・クリーナです。

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技術資料

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種類 タイトル 最新の英語版をダウンロード 日付
* データシート LMK04610 超低ノイズおよび低消費電力 JESD204B 準拠クロック・ジッタ・クリーナ、デュアル・ループ PLL 内蔵 データシート (Rev. B 翻訳版) PDF | HTML 英語版をダウンロード (Rev.B) PDF | HTML 2019年 11月 11日
アプリケーション・ノート JESD204B multi-device synchronization using LMK0461x 2017年 8月 16日
アプリケーション・ノート LMK0461x Phase Noise Performance With DC-DC Converters (Rev. B) 2017年 7月 20日
アプリケーション・ノート SDPLL for LMK046xx Family 2017年 5月 15日
EVM ユーザー ガイド (英語) LMK04610 Evaluation Board User's Guide (Rev. A) 2017年 2月 1日

設計および開発

追加の事項や他のリソースを参照するには、以下のタイトルをクリックすると、詳細ページを表示できます。

評価ボード

LMK04610EVM — LMK04610 デュアル PLL 搭載、超低ノイズ / 低電力 JESD204B 準拠クロック・ジッタ・クリーナの EVM

LMK04610EVM は、JESD204B に準拠した超低ノイズかつ低消費電力のデュアル・ループ・ジッタ・クリーナである LMK04610 を採用しています。LMK04610 の特長は、すべての出力を動作させているときの消費電力がわずか 900mW であること、および低ノイズの VCXO モジュールを使用して 74fs (フェムト秒) 以下のジッタ (12kHz ~ 20MHz) をサポートしていることです。複数の内蔵 LDO は高 PSRR を実現しているので、複数の DC/DC コンバータと組み合わせることができます。
ユーザー・ガイド: PDF
TI.com で取り扱いなし
アプリケーション・ソフトウェアとフレームワーク

TICSPRO-SW — TICS (テキサス・インスツルメンツのクロックとシンセサイザ) Pro ソフトウェア

TICS (テキサス・インスツルメンツのクロックとシンセサイザ) Pro ソフトウェアを使用すると、接頭辞 (製品型番の先頭部分) が以下のいずれかに該当する製品と組み合わせて、評価基板 (EVM) をプログラム (設定) することができます。CDC、LMK、LMX。これらの製品は、フェーズ・ロック・ループと電圧制御発振器 (PLL+VCO)、シンセサイザ、クロック関連デバイスを搭載しています。
シミュレーション・モデル

LMK0461X IBIS Model

SNAM204.ZIP (126 KB) - IBIS Model
シミュレーション・ツール

PSPICE-FOR-TI — TI Design / シミュレーション・ツール向け PSpice®

PSpice® for TI は、各種アナログ回路の機能評価に役立つ、設計とシミュレーション向けの環境です。設計とシミュレーションに適したこのフル機能スイートは、Cadence® のアナログ分析エンジンを使用しています。PSpice for TI は無償で使用でき、アナログや電源に関する TI の製品ラインアップを対象とする、業界でも有数の大規模なモデル・ライブラリが付属しているほか、選択された一部のアナログ動作モデルも利用できます。

設計とシミュレーション向けの環境である PSpice for TI (...)
設計ツール

CLOCK-TREE-ARCHITECT — Clock tree architect プログラミング・ソフトウェア

Clock tree architect はクロック・ツリーの合成ツールであり、開発中システムの要件に基づいてクロック・ツリー・ソリューションを生成する方法で、お客様の設計プロセスの効率化に貢献します。このツールは、多様なクロック供給製品を収録した包括的なデータベースからデータを抽出し、システム・レベルのマルチチップ・クロック供給ソリューションを生成します。
パッケージ ピン数 ダウンロード
QFN (RTQ) 56 オプションの表示

購入と品質

記載されている情報:
  • RoHS
  • REACH
  • デバイスのマーキング
  • リード端子の仕上げ / ボールの原材料
  • MSL rating / リフローピーク温度
  • MTBF/FIT 推定値
  • 原材料組成
  • 認定試験結果
  • 継続的な信頼性モニタ試験結果

推奨製品には、この TI 製品に関連するパラメータ、評価基板、またはリファレンス・デザインが存在する可能性があります。

サポートとトレーニング

TI E2E™ Forums (英語) では、TI のエンジニアからの技術サポートが活用できます

コンテンツは、TI 投稿者やコミュニティ投稿者によって「現状のまま」提供されるもので、TI による仕様の追加を意図するものではありません。使用条件をご確認ください。

TI 製品の品質、パッケージ、ご注文に関するお問い合わせは、TI サポートをご覧ください。​​​​​​​​​​​​​​

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