PLLATINUMSIM-SW — PLLatinum Sim Tool
PLLATINUMSIM-SW is a simulation tool that allows users to create detailed designs and simulations of our PLLatinum™ integrated circuits, which include the LMX series of phase-locked loops (PLLs) and synthesizers.
LMK1D210xL は低ノイズのデュアル クロック バッファで、1 つの入力を最大 2 つ (LMK1D2102L)、4 つ (LMK1D2104L)、6 つ (LMK1D2106L)、または8 つ (LMK1D2108L) の各 LVDS 出力に分配します。入力は LVDS、LVPECL、HCSL、CML、LVCMOS のいずれかに対応可能です。
LMK1D210xL は、50Ω の伝送経路の駆動に特化して設計されています。シングルエンド モードで入力を駆動する場合は、未使用の負入力ピンに適切なバイアス電圧を印加する必要があります (Figure 8-8 参照)。
LMK1D210xL バッファは、異なる動作電源に対して 2 つの出力コモンモード動作 (0.7V と 1.2V) を提供します。このデバイスを使用すると、DC 結合モードのアプリケーションの設計に柔軟性を提供します。
AMP_SELA/AMP_SELB 制御ピンを使用して、出力振幅 LVDS (350mV) またはブースト LVDS (500mV) を選択できます。振幅の選択に加えて、同じピンを使用して出力をディスエーブルできます。
本デバイスは、クロックおよびデジタル入力ピンのFail-Safe Input 機能もサポートしています。さらに、このデバイスは入力ヒステリシスを備えており、入力信号が存在しないときに出力がランダムに発振することを防止します。
| 種類 | タイトル | 最新の英語版をダウンロード | 日付 | |||
|---|---|---|---|---|---|---|
| * | データシート | LMK1D210xL 超低付加ジッタ LVDS バッファ データシート (Rev. A 翻訳版) | PDF | HTML | 英語版 (Rev.A) | PDF | HTML | 2024年 11月 11日 |
その他のアイテムや必要なリソースを参照するには、以下のタイトルをクリックして詳細ページをご覧ください。
PLLATINUMSIM-SW is a simulation tool that allows users to create detailed designs and simulations of our PLLatinum™ integrated circuits, which include the LMX series of phase-locked loops (PLLs) and synthesizers.
| パッケージ | ピン数 | CAD シンボル、フットプリント、および 3D モデル |
|---|---|---|
| VQFN (RHA) | 40 | Ultra Librarian |
推奨製品には、この TI 製品に関連するパラメータ、評価基板、またはリファレンス デザインが存在する可能性があります。
PLLatinum Sim User's Guide
PLLatinum Sim software manifest
PLLatinum Sim 1.6.9 includes the ability to manually specify points on a phase noise curve (for VCOs or other devices that do not fit the standard three-point model), and as a result the phase noise estimation for many devices which use a BAW VCO is greatly improved. Also includes a bugfix for cascading noise inputs.