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AM625SIP

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Arm® Cortex®-A53 と統合型 LPDDR4 を採用した汎用のシステム イン パッケージ

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AM625SIP

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製品詳細

CPU 4 Arm Cortex-A53 Frequency (MHz) 1400 Coprocessors 1 Arm Cortex-M4F Graphics acceleration 1 3D Display type MIPI DPI, OLDI Protocols Ethernet, TSN Hardware accelerators CPU only, Industrial communications subsystem, Programable real-time unit Features General purpose, Integrated 512MB LPDDR4 SDRAM Operating system Linux Security Secure boot Rating Catalog Power supply solution TPS65219 Operating temperature range (°C) -40 to 95 Edge AI enabled Yes
CPU 4 Arm Cortex-A53 Frequency (MHz) 1400 Coprocessors 1 Arm Cortex-M4F Graphics acceleration 1 3D Display type MIPI DPI, OLDI Protocols Ethernet, TSN Hardware accelerators CPU only, Industrial communications subsystem, Programable real-time unit Features General purpose, Integrated 512MB LPDDR4 SDRAM Operating system Linux Security Secure boot Rating Catalog Power supply solution TPS65219 Operating temperature range (°C) -40 to 95 Edge AI enabled Yes
FCCSP (AMK) 425 169 mm² 13 x 13

プロセッサ コア：

  • 最高 1.4GHz、クワッド 64 ビットまでの Arm Cortex-A53 マイクロプロセッサ サブシステム
    • SECDED ECC 付き 512KB L2 共有キャッシュを搭載したクワッド コア Cortex-A53 クラスタ
    • 各 A53 コアには、SECDED ECC を備えた 32KB L1 D キャッシュおよびパリティ保護を備えた 32KB L1 I キャッシュを搭載
  • 最高 400MHz、シングル コア Arm® Cortex®-M4F MCU
    • 256KB の SRAM (SECDED ECC 付き)
  • 専用デバイス / パワー マネージャ

マルチメディア：

  • ディスプレイ サブシステム
    • デュアル ディスプレイのサポート
    • 各ディスプレイで 1920x1080 @ 60fps
    • 1 個の 2048x1080 + 1 個の 1280x720
    • ディスプレイごとに独立した PLL を使用して、最大 165MHz のピクセル クロックをサポートします
    • OLDI (4 レーン LVDS - 2x) および DPI (24 ビット RGB LVCMOS)
    • 凍結フレーム検出や MISR データ チェックなどの安全機能をサポートします
  • 3D グラフィックス処理ユニット
    • クロックあたり 1 ピクセル以上
    • 500 メガピクセル / 秒を超える速度
    • 500 を超える MTexel/s、8 を超える GFLOP
    • 少なくとも 2 つの合成層をサポート
    • 最大 2048x1080 @ 60fps をサポート
    • ARGB32、RGB565、YUV 形式をサポート
    • 2D グラフィックス対応
    • OpenGL ES 3.1、Vulkan 1.2
  • 1 つのカメラ シリアル インターフェイス (CSI-Rx) - DPHY 付きの 4 レーン
    • MIPI CSI-2 v1.3 準拠 + MIPI D-PHY 1.2
    • 最大 1Gbps の 1、2、3、4 データ レーン モードをサポート
    • CRC チェック + RAM 上の ECC による ECC 検証 / 訂正
    • 仮想チャネルのサポート (最大 16)
    • DMA 経由で DDR にストリーム データを直接書き込む機能

メモリ サブシステム：

  • 最大 816KB のオンチップ RAM
    • SECDED ECC 付きの 64KB のオンチップ RAM (OCSRAM) は、最大 2 つの独立したメモリ バンクについて、32KB 単位でより小さなバンクに分割できます
    • SMS サブシステムに SECDED ECC を搭載した 256KB のオンチップ RAM
    • テキサス・インスツルメンツのセキュリティ ファームウェア用の SMS サブシステムに SECDED ECC を搭載した 176KB のオンチップ RAM
    • Cortex-M4F MCU サブシステムに SECDED ECC を搭載した 256KB のオンチップ RAM
    • デバイス / パワー マネージャ サブシステムに SECDED ECC を搭載した 64KB のオンチップ RAM
  • DDR サブシステム (DDRSS)
    • 512MB LPDDR4 SDRAM を内蔵
    • 最大 1600MT/s の速度をサポート
    • インライン ECC 付きの 16 ビット データ バス

セキュリティ：

  • セキュア ブート対応
    • ハードウェアで強化された RoT (Root-of-Trust：信頼の基点)
    • バックアップ キーによる RoT の切り替えをサポート
    • テイクオーバー保護、IP 保護、ロールバック禁止保護のサポート
  • 信頼できる実行環境 (TEE) に対応
    • Arm TrustZone をベースとする TEE
    • 分離用の広範なファイアウォール サポート
    • セキュアなウォッチドッグ / タイマ / IPC
    • セキュアなストレージのサポート
    • リプレイ保護メモリ ブロック (RPMB) のサポート
  • ユーザー プログラマブルな HSM コアと専用セキュリティ DMA および IPC サブシステムの搭載により絶縁処理を実現した専用セキュリティ コントローラ
  • 暗号化アクセラレーションに対応
    • 受信データ ストリームに基づいてキーマテリアルを自動的に切り替えできるセッション認識暗号化エンジン
      • 暗号化コアをサポート
    • AES - 128/192/256 ビットのキー サイズ
    • SHA2 - 224/256/384/512 ビットのキー サイズ
    • DRBG と真性乱数発生器
    • セキュア ブート対応のため PKA (公開鍵アクセラレータ) により RSA/ECC 処理を支援
  • デバッグのセキュリティ
    • ソフトウェア制御によるセキュアなデバッグ アクセス
    • セキュリティ対応のデバッグ

PRU サブシステム：

  • 最大 333MHz で動作するデュアル コア プログラマブル リアルタイム ユニット サブシステム (PRUSS)
  • 追加の機能など、サイクル精度の高いプロトコルを実現するために GPIO を駆動することを目的としています。
    • 汎用入出力 (GPIO)
    • UART
    • I2C
    • 外部 ADC
  • PRU ごとに 16KB のプログラム メモリ、SECDED ECC 付き
  • PRU ごとに 8KB のデータ メモリ、SECDED ECC 付き
  • 32KB 汎用メモリ、SECDED ECC 付き
  • CRC32/16 HW アクセラレータ
  • 30 x 32 ビット レジスタの 3 バンクを備えたスクラッチ パッド メモリ
  • 9 個のキャプチャ イベントと 16 個の比較イベントを搭載した 1 つの産業用 64 ビット タイマと、低速および高速の補正
  • 1 つの割り込みコントローラ (INTC)、最小 64 の入力イベントをサポート

高速インターフェイス：

  • 次の機能をサポートするイーサネット スイッチを内蔵 (合計 2 つの外部ポート)
    • RMII (10/100) または RGMII (10/100/1000)
    • IEEE1588 (Annex D、Annex E、Annex F と 802.1AS PTP)
    • Clause 45 MDIO PHY 管理
    • ALE エンジン (512 の分類子) に基づくパケット分類器
    • プライオリティ ベースのフロー制御
    • 時間に制約のあるネットワーク機能 (TSN) のサポート
    • 4 個の CPU ハードウェア割り込みペーシング
    • ハードウェアの IP/UDP/TCP チェックサム オフロード
  • 2 つの USB2.0 ポート
    • USB ホスト、USB ペリフェラル、USB デュアルロール デバイス (DRD モード) として構成可能なポート
    • USB VBUS 検出機能を内蔵

一般的な接続機能：

  • 9 個のユニバーサル非同期レシーバ トランスミッタ (UART)
  • 5 個のシリアル ペリフェラル インターフェイス (SPI) コントローラ
  • 6 個の内部集積回路 (I2C) ポート
  • 3 個のマルチチャネル オーディオ シリアル ポート (McASP)
    • 最高 50MHz の送信および受信クロック
    • 3 個の McASP で最大 16/10/6 本のシリアル データ ピンを使用でき、TX と RX の各クロックは独立しています
    • 時分割多重化 (TDM)、IC 間サウンド (I2S)、および類似のフォーマットをサポート
    • デジタル オーディオ インターフェイス送信 (SPDIF、IEC60958-1、AES-3 フォーマット) をサポート
    • 送受信用 FIFO バッファ (256 バイト)
    • オーディオ リファレンス出力クロックのサポート
  • 3 つの拡張 PWM モジュール (ePWM)
  • 3 個の拡張直交エンコーダ パルス モジュール (EQEP)
  • 3 個の拡張キャプチャ モジュール (ECAP)
  • 汎用 I/O (GPIO) では、すべての LVCMOS I/O を GPIO として構成可能
  • 3 個のコントローラ エリア ネットワーク (CAN) モジュール、CAN-FD をサポート
    • CAN プロトコル 2.0A、B、ISO 11898-1 に準拠
    • 完全な CAN FD のサポート (最大 64 データ バイト)
    • メッセージ RAM のパリティ / ECC チェック
    • 最大速度：8Mbps

メディアおよびデータ ストレージ：

  • 3 つのマルチメディア カード / セキュア デジタル (MMC/SD/SDIO) インターフェイス
    • 1 個の 8 ビット eMMC インターフェイス、最大速度 HS200
    • 2 個の 4 ビット SD/SDIO インターフェイス、最大 UHS-I
    • eMMC 5.1、SD 3.0、SDIO バージョン 3.0 に準拠
  • 最大 133 MHz の 1 つの汎用メモリ コントローラ (GPMC)
    • 柔軟な 8 および 16 ビットの非同期メモリ インターフェイスと、最大 4 つのチップ (22 ビット アドレス) セレクト (NAND、NOR、Muxed-NOR、SRAM)
    • BCH コードを使用して 4、8、または 16 ビット ECC をサポート
    • ハミング コードを使用して 1 ビット ECC をサポート
    • エラー特定モジュール (ELM)
      • GPMC と組み合わせて使用すると、BCH アルゴリズムで生成されたシンドローム多項式により、データ エラーのアドレスを特定可能
      • BCH アルゴリズムに基づいて、512 バイトのブロックごとに 4、8、または 16 ビットのエラーを特定可能
  • DDR/SDR をサポートする OSPI/QSPI
    • シリアル NAND およびシリアル NOR フラッシュ デバイスをサポート
    • 4GBytes のメモリ アドレスをサポート
    • オプションのオンザフライ暗号化を備えた XIP モード

パワー マネージメント：

  • デバイス / パワー マネージャでサポートされている低消費電力モード
    • CAN/GPIO/UART ウェイクアップに対する部分的 IO サポート
    • ディープスリープ
    • MCU のみ
    • スタンバイ
    • Cortex-A53 用のダイナミック周波数スケーリング

最適なパワー マネージメント ソリューション：

  • 推奨される TPS65219 パワー マネージメント IC (PMIC)
    • デバイスの電源要件を満たすように特別に設計されたコンパニオン PMIC
    • さまざまな使用事例をサポートするためのフレキシブルなマッピングと工場出荷時にプログラムされた構成

ブート オプション：

  • UART
  • I2C EEPROM
  • OSPI/QSPI フラッシュ
  • GPMC NOR/NAND フラッシュ
  • シリアル NAND フラッシュ
  • SD カード
  • eMMC
  • マス ストレージ デバイスからの USB (ホスト) ブート
  • 外部ホストからの USB (デバイス) ブート (DFU モード)
  • イーサネット

テクノロジ / パッケージ：

  • 16nm テクノロジー
  • 13mm × 13mm、0.5mm ピッチ、425 ピン FCCSP BGA (ALW)

プロセッサ コア：

  • 最高 1.4GHz、クワッド 64 ビットまでの Arm Cortex-A53 マイクロプロセッサ サブシステム
    • SECDED ECC 付き 512KB L2 共有キャッシュを搭載したクワッド コア Cortex-A53 クラスタ
    • 各 A53 コアには、SECDED ECC を備えた 32KB L1 D キャッシュおよびパリティ保護を備えた 32KB L1 I キャッシュを搭載
  • 最高 400MHz、シングル コア Arm® Cortex®-M4F MCU
    • 256KB の SRAM (SECDED ECC 付き)
  • 専用デバイス / パワー マネージャ

マルチメディア：

  • ディスプレイ サブシステム
    • デュアル ディスプレイのサポート
    • 各ディスプレイで 1920x1080 @ 60fps
    • 1 個の 2048x1080 + 1 個の 1280x720
    • ディスプレイごとに独立した PLL を使用して、最大 165MHz のピクセル クロックをサポートします
    • OLDI (4 レーン LVDS - 2x) および DPI (24 ビット RGB LVCMOS)
    • 凍結フレーム検出や MISR データ チェックなどの安全機能をサポートします
  • 3D グラフィックス処理ユニット
    • クロックあたり 1 ピクセル以上
    • 500 メガピクセル / 秒を超える速度
    • 500 を超える MTexel/s、8 を超える GFLOP
    • 少なくとも 2 つの合成層をサポート
    • 最大 2048x1080 @ 60fps をサポート
    • ARGB32、RGB565、YUV 形式をサポート
    • 2D グラフィックス対応
    • OpenGL ES 3.1、Vulkan 1.2
  • 1 つのカメラ シリアル インターフェイス (CSI-Rx) - DPHY 付きの 4 レーン
    • MIPI CSI-2 v1.3 準拠 + MIPI D-PHY 1.2
    • 最大 1Gbps の 1、2、3、4 データ レーン モードをサポート
    • CRC チェック + RAM 上の ECC による ECC 検証 / 訂正
    • 仮想チャネルのサポート (最大 16)
    • DMA 経由で DDR にストリーム データを直接書き込む機能

メモリ サブシステム：

  • 最大 816KB のオンチップ RAM
    • SECDED ECC 付きの 64KB のオンチップ RAM (OCSRAM) は、最大 2 つの独立したメモリ バンクについて、32KB 単位でより小さなバンクに分割できます
    • SMS サブシステムに SECDED ECC を搭載した 256KB のオンチップ RAM
    • テキサス・インスツルメンツのセキュリティ ファームウェア用の SMS サブシステムに SECDED ECC を搭載した 176KB のオンチップ RAM
    • Cortex-M4F MCU サブシステムに SECDED ECC を搭載した 256KB のオンチップ RAM
    • デバイス / パワー マネージャ サブシステムに SECDED ECC を搭載した 64KB のオンチップ RAM
  • DDR サブシステム (DDRSS)
    • 512MB LPDDR4 SDRAM を内蔵
    • 最大 1600MT/s の速度をサポート
    • インライン ECC 付きの 16 ビット データ バス

セキュリティ：

  • セキュア ブート対応
    • ハードウェアで強化された RoT (Root-of-Trust：信頼の基点)
    • バックアップ キーによる RoT の切り替えをサポート
    • テイクオーバー保護、IP 保護、ロールバック禁止保護のサポート
  • 信頼できる実行環境 (TEE) に対応
    • Arm TrustZone をベースとする TEE
    • 分離用の広範なファイアウォール サポート
    • セキュアなウォッチドッグ / タイマ / IPC
    • セキュアなストレージのサポート
    • リプレイ保護メモリ ブロック (RPMB) のサポート
  • ユーザー プログラマブルな HSM コアと専用セキュリティ DMA および IPC サブシステムの搭載により絶縁処理を実現した専用セキュリティ コントローラ
  • 暗号化アクセラレーションに対応
    • 受信データ ストリームに基づいてキーマテリアルを自動的に切り替えできるセッション認識暗号化エンジン
      • 暗号化コアをサポート
    • AES - 128/192/256 ビットのキー サイズ
    • SHA2 - 224/256/384/512 ビットのキー サイズ
    • DRBG と真性乱数発生器
    • セキュア ブート対応のため PKA (公開鍵アクセラレータ) により RSA/ECC 処理を支援
  • デバッグのセキュリティ
    • ソフトウェア制御によるセキュアなデバッグ アクセス
    • セキュリティ対応のデバッグ

PRU サブシステム：

  • 最大 333MHz で動作するデュアル コア プログラマブル リアルタイム ユニット サブシステム (PRUSS)
  • 追加の機能など、サイクル精度の高いプロトコルを実現するために GPIO を駆動することを目的としています。
    • 汎用入出力 (GPIO)
    • UART
    • I2C
    • 外部 ADC
  • PRU ごとに 16KB のプログラム メモリ、SECDED ECC 付き
  • PRU ごとに 8KB のデータ メモリ、SECDED ECC 付き
  • 32KB 汎用メモリ、SECDED ECC 付き
  • CRC32/16 HW アクセラレータ
  • 30 x 32 ビット レジスタの 3 バンクを備えたスクラッチ パッド メモリ
  • 9 個のキャプチャ イベントと 16 個の比較イベントを搭載した 1 つの産業用 64 ビット タイマと、低速および高速の補正
  • 1 つの割り込みコントローラ (INTC)、最小 64 の入力イベントをサポート

高速インターフェイス：

  • 次の機能をサポートするイーサネット スイッチを内蔵 (合計 2 つの外部ポート)
    • RMII (10/100) または RGMII (10/100/1000)
    • IEEE1588 (Annex D、Annex E、Annex F と 802.1AS PTP)
    • Clause 45 MDIO PHY 管理
    • ALE エンジン (512 の分類子) に基づくパケット分類器
    • プライオリティ ベースのフロー制御
    • 時間に制約のあるネットワーク機能 (TSN) のサポート
    • 4 個の CPU ハードウェア割り込みペーシング
    • ハードウェアの IP/UDP/TCP チェックサム オフロード
  • 2 つの USB2.0 ポート
    • USB ホスト、USB ペリフェラル、USB デュアルロール デバイス (DRD モード) として構成可能なポート
    • USB VBUS 検出機能を内蔵

一般的な接続機能：

  • 9 個のユニバーサル非同期レシーバ トランスミッタ (UART)
  • 5 個のシリアル ペリフェラル インターフェイス (SPI) コントローラ
  • 6 個の内部集積回路 (I2C) ポート
  • 3 個のマルチチャネル オーディオ シリアル ポート (McASP)
    • 最高 50MHz の送信および受信クロック
    • 3 個の McASP で最大 16/10/6 本のシリアル データ ピンを使用でき、TX と RX の各クロックは独立しています
    • 時分割多重化 (TDM)、IC 間サウンド (I2S)、および類似のフォーマットをサポート
    • デジタル オーディオ インターフェイス送信 (SPDIF、IEC60958-1、AES-3 フォーマット) をサポート
    • 送受信用 FIFO バッファ (256 バイト)
    • オーディオ リファレンス出力クロックのサポート
  • 3 つの拡張 PWM モジュール (ePWM)
  • 3 個の拡張直交エンコーダ パルス モジュール (EQEP)
  • 3 個の拡張キャプチャ モジュール (ECAP)
  • 汎用 I/O (GPIO) では、すべての LVCMOS I/O を GPIO として構成可能
  • 3 個のコントローラ エリア ネットワーク (CAN) モジュール、CAN-FD をサポート
    • CAN プロトコル 2.0A、B、ISO 11898-1 に準拠
    • 完全な CAN FD のサポート (最大 64 データ バイト)
    • メッセージ RAM のパリティ / ECC チェック
    • 最大速度：8Mbps

メディアおよびデータ ストレージ：

  • 3 つのマルチメディア カード / セキュア デジタル (MMC/SD/SDIO) インターフェイス
    • 1 個の 8 ビット eMMC インターフェイス、最大速度 HS200
    • 2 個の 4 ビット SD/SDIO インターフェイス、最大 UHS-I
    • eMMC 5.1、SD 3.0、SDIO バージョン 3.0 に準拠
  • 最大 133 MHz の 1 つの汎用メモリ コントローラ (GPMC)
    • 柔軟な 8 および 16 ビットの非同期メモリ インターフェイスと、最大 4 つのチップ (22 ビット アドレス) セレクト (NAND、NOR、Muxed-NOR、SRAM)
    • BCH コードを使用して 4、8、または 16 ビット ECC をサポート
    • ハミング コードを使用して 1 ビット ECC をサポート
    • エラー特定モジュール (ELM)
      • GPMC と組み合わせて使用すると、BCH アルゴリズムで生成されたシンドローム多項式により、データ エラーのアドレスを特定可能
      • BCH アルゴリズムに基づいて、512 バイトのブロックごとに 4、8、または 16 ビットのエラーを特定可能
  • DDR/SDR をサポートする OSPI/QSPI
    • シリアル NAND およびシリアル NOR フラッシュ デバイスをサポート
    • 4GBytes のメモリ アドレスをサポート
    • オプションのオンザフライ暗号化を備えた XIP モード

パワー マネージメント：

  • デバイス / パワー マネージャでサポートされている低消費電力モード
    • CAN/GPIO/UART ウェイクアップに対する部分的 IO サポート
    • ディープスリープ
    • MCU のみ
    • スタンバイ
    • Cortex-A53 用のダイナミック周波数スケーリング

最適なパワー マネージメント ソリューション：

  • 推奨される TPS65219 パワー マネージメント IC (PMIC)
    • デバイスの電源要件を満たすように特別に設計されたコンパニオン PMIC
    • さまざまな使用事例をサポートするためのフレキシブルなマッピングと工場出荷時にプログラムされた構成

ブート オプション：

  • UART
  • I2C EEPROM
  • OSPI/QSPI フラッシュ
  • GPMC NOR/NAND フラッシュ
  • シリアル NAND フラッシュ
  • SD カード
  • eMMC
  • マス ストレージ デバイスからの USB (ホスト) ブート
  • 外部ホストからの USB (デバイス) ブート (DFU モード)
  • イーサネット

テクノロジ / パッケージ：

  • 16nm テクノロジー
  • 13mm × 13mm、0.5mm ピッチ、425 ピン FCCSP BGA (ALW)

AM625SIP は、ALW パッケージで供給される AM6254 デバイスのシステム イン パッケージ (SIP) 派生品で、LPDDR4 SDRAM が内蔵されています。このドキュメントでは、AM62x Sitara プロセッサ データシート (リビジョン B 以降) に記載された ALW パッケージの AM6254 デバイスとの違いと例外についてのみ説明しています。

LPDDR4 を内蔵した AM625SIP (システム イン パッケージ) Sitara™ MPU は、Linux 開発向けに構築されたアプリケーション プロセッサです。このシステム イン パッケージは、4x Arm® Cortex®-A53 の性能と組み込みの機能を備えた AM6254 デバイスに 512MB の LPDDR4 を統合します。デュアル ディスプレイ サポートや 3D グラフィックス アクセラレーションに加えて、広範なペリフェラルを搭載したシステム イン パッケージは、インテリジェントな機能と最適化された電源アーキテクチャを提供すると同時に、幅広い産業用アプリケーションに適しています。さらに、AM625SIP は、ハードウェア設計の簡素化、堅牢性の向上、サイズ / システム BOM の最適化、消費電力の低減を実現し、ソフトウェアとハードウェアの迅速な開発を可能にします。

アプリケーションの一部を以下に示します。

  • 産業用 HMI
  • 医療用機器、医療用モニタ、ポータブル医療機器
  • スマート ホーム ゲートウェイ / 家電
  • 組み込みセキュリティ：コントロール パネルとアクセス パネル

3 ポートのギガビット イーサネット スイッチには、1 つの内部ポートと 2 つの外部ポートがあり、時間に制約のあるネットワーク機能 (TSN) をサポートしています。デバイスに追加の PRU モジュールが搭載されているため、お客様独自の使用事例でリアルタイム I/O 機能を実現できます。さらに、AM625SIP に搭載されている広範なペリフェラル セットにより、以下のようなシステム レベルのコネクティビティを実現できます。USB、MMC/SD、カメラ インターフェイス、OSPI、CAN-FD、GPMC により、外部 ASIC/FPGA とのパラレル ホスト インターフェイスを実現。AM625SIP デバイスは、内蔵のハードウェア セキュリティ モジュール (HSM) を使用した IP 保護用セキュア ブートもサポートしており、ポータブルおよび消費電力が重要なアプリケーション向けに高度なパワー マネージメント サポートを採用しています

AM625SIP は、ALW パッケージで供給される AM6254 デバイスのシステム イン パッケージ (SIP) 派生品で、LPDDR4 SDRAM が内蔵されています。このドキュメントでは、AM62x Sitara プロセッサ データシート (リビジョン B 以降) に記載された ALW パッケージの AM6254 デバイスとの違いと例外についてのみ説明しています。

LPDDR4 を内蔵した AM625SIP (システム イン パッケージ) Sitara™ MPU は、Linux 開発向けに構築されたアプリケーション プロセッサです。このシステム イン パッケージは、4x Arm® Cortex®-A53 の性能と組み込みの機能を備えた AM6254 デバイスに 512MB の LPDDR4 を統合します。デュアル ディスプレイ サポートや 3D グラフィックス アクセラレーションに加えて、広範なペリフェラルを搭載したシステム イン パッケージは、インテリジェントな機能と最適化された電源アーキテクチャを提供すると同時に、幅広い産業用アプリケーションに適しています。さらに、AM625SIP は、ハードウェア設計の簡素化、堅牢性の向上、サイズ / システム BOM の最適化、消費電力の低減を実現し、ソフトウェアとハードウェアの迅速な開発を可能にします。

アプリケーションの一部を以下に示します。

  • 産業用 HMI
  • 医療用機器、医療用モニタ、ポータブル医療機器
  • スマート ホーム ゲートウェイ / 家電
  • 組み込みセキュリティ：コントロール パネルとアクセス パネル

3 ポートのギガビット イーサネット スイッチには、1 つの内部ポートと 2 つの外部ポートがあり、時間に制約のあるネットワーク機能 (TSN) をサポートしています。デバイスに追加の PRU モジュールが搭載されているため、お客様独自の使用事例でリアルタイム I/O 機能を実現できます。さらに、AM625SIP に搭載されている広範なペリフェラル セットにより、以下のようなシステム レベルのコネクティビティを実現できます。USB、MMC/SD、カメラ インターフェイス、OSPI、CAN-FD、GPMC により、外部 ASIC/FPGA とのパラレル ホスト インターフェイスを実現。AM625SIP デバイスは、内蔵のハードウェア セキュリティ モジュール (HSM) を使用した IP 保護用セキュア ブートもサポートしており、ポータブルおよび消費電力が重要なアプリケーション向けに高度なパワー マネージメント サポートを採用しています
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技術資料

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* データシート AM625SIP – AM6254 Sitara™ プロセッサ、 LPDDR4 SDRAM 内蔵 データシート (Rev. A 翻訳版) PDF | HTML 英語版 (Rev.A) PDF | HTML 2024年 6月 16日
* エラッタ AM62x Sitara Errata (Rev. G) PDF | HTML 2025年 10月 30日
* ユーザー・ガイド AM62x Sitara Processors Technical Reference Manual (Rev. C) PDF | HTML 2025年 12月 29日
アプリケーション・ノート プロセッサの高速パラレルインターフェイスのためのカスタム基板設 計およびシミュレーションのガイドライン (Rev. A 翻訳版) PDF | HTML 英語版 (Rev.A) PDF | HTML 2026年 2月 17日
アプリケーション・ノート Sitara MPU 上で Matter を有効化 (Rev. A 翻訳版) PDF | HTML 英語版 (Rev.A) PDF | HTML 2025年 12月 1日
アプリケーション・ノート Sitara™ プロセッサ電源供給回路：実装と分析 (Rev. H 翻訳版) PDF | HTML 英語版 (Rev.H) PDF | HTML 2025年 11月 12日
ユーザー・ガイド Hardware Design Considerations for Custom Board Using AM625, AM623, AM620-Q1, AM625-Q1, AM625SIP Processor (Rev. E) PDF | HTML 2025年 10月 24日
ユーザー・ガイド AM62x, AM62Ax, AM62D-Q1 and AM62Px Processor Family Schematic, Design Guidelines and Review Checklist (Rev. I) PDF | HTML 2025年 9月 17日
ユーザー・ガイド AM625, AM623, AM620-Q1, AM625-Q1, AM625SIP Processor Family Schematic, Design Guidelines and Review Checklist (Rev. B) PDF | HTML 2025年 9月 16日
アプリケーション・ノート AM62x, AM62Ax, AM62Px, AM62Lx Spread-Spectrum Clocking PDF | HTML 2025年 9月 8日
アプリケーション・ノート Processors Tools Overview PDF | HTML 2025年 6月 16日
ホワイト・ペーパー Arm ベースのアプリケーション プロセ ッサのセキュリティ (Rev. F 翻訳版) PDF | HTML 英語版 (Rev.F) PDF | HTML 2025年 4月 1日
アプリケーション・ノート Minimal Platform Development on AM62x Devices (Rev. A) PDF | HTML 2024年 9月 24日
製品概要 AM625SIP: System In Package Explained PDF | HTML 2024年 2月 22日
アプリケーション・ノート AM62x Power Consumption PDF | HTML 2024年 2月 16日
アプリケーション概要 AM625SIP 處理器如何透過整合 LPDDR4，加快開發速度 (Rev. A) PDF | HTML 2024年 1月 12日
アプリケーション・ノート Powering the AM625SIP With the TPS65219 PMIC PDF | HTML 2023年 12月 20日
アプリケーション概要 AM625SIP 프로세서가 LPDDR4를 통합하여 개발을 가속화하는 방법 (Rev. A) PDF | HTML 2023年 12月 18日
アプリケーション・ノート Using TSN Ethernet Features to Improve Timing in Industrial Ethernet Controllers PDF | HTML 2023年 11月 15日
アプリケーション概要 Keyword Spotting Using AI at the Edge With Sitara Processors PDF | HTML 2023年 9月 28日
ホワイト・ペーパー Time sensitive networking for industrial automation (Rev. C) 2023年 7月 31日
アプリケーション・ノート AM62x SiP PCB Escape Routing PDF | HTML 2023年 7月 21日
アプリケーション・ノート AM62x Maximum Current Ratings PDF | HTML 2023年 4月 18日
アプリケーション・ノート High-Speed Interface Layout Guidelines (Rev. J) PDF | HTML 2023年 2月 24日
アプリケーション概要 LPDDR4 を内蔵した AM625SIP プロセッサを使用して開発を促 進する方法 (Rev. A 翻訳版) PDF | HTML 英語版 (Rev.A) PDF | HTML 2023年 1月 3日

設計と開発

各種電源ソリューション

AM625SIP に関連する、利用可能な電源ソリューションを検索できます。TI は、自社と他社それぞれの SoC (システム オン チップ)、プロセッサ、マイコン、センサ、FPGA (フィールド プログラマブル ゲート アレイ) に適した、各種電源ソリューションを取り揃えています。

ソリューションの閲覧
評価ボード

SK-AM62-SIP — Sitara™ プロセッサ向け、AM62x システム イン パッケージ スタータ キット

SK-AM62-SIP スタータ キット (SK) 評価基板 (EVM) は、512MB の LPDDR4 SDRAM を単一のパッケージに統合した AM6254 システム オン チップ (SoC) を土台として製作した、スタンドアロンのテスト / 開発プラットフォームです。AM625SIP プロセッサは、クワッドコアの 64 ビット Arm®-Cortex®-A53 マイクロプロセッサと、シングルコアの Arm Cortex-M4F マイコンで構成されています。

SK-AM62-SIP は、HS-FS (high-security (...)

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TI.com で取り扱いなし
デバッグ・プローブ

TMDSEMU110-U — XDS110 JTAG デバッグ プローブ

TI ( テキサス・インスツルメンツ) の XDS110 は、TI の各種組込みプロセッサを意図した、新しいクラスのデバッグ プローブ (エミュレータ) です。XDS110 は XDS100 ファミリを置き換える製品であり、同時に、単一製品で幅広い規格 (IEEE1149.1、IEEE1149.7、SWD) をサポートしています。また、すべての XDS デバッグ プローブは、ETB (Embedded Trace Buffer、組込みトレース バッファ) 搭載のすべての Arm® と DSP プロセッサに対し、コア トレースとシステム トレースをサポートしています。  ピンのコア (...)

ユーザー ガイド: PDF
TI.com で取り扱いなし
デバッグ・プローブ

TMDSEMU560V2STM-UE — Spectrum Digital XDS560v2 システム・トレース USB およびイーサネット

The XDS560v2 System Trace is the first model of the XDS560v2 family of high-performance debug probes (emulators) for TI processors. The XDS560v2 is the highest performance of the XDS family of debug probes and supports both the traditional JTAG standard (IEEE1149.1) and cJTAG (IEEE1149.7).

The (...)

TI.com で取り扱いなし
デバッグ・プローブ

LB-3P-TRACE32-ARM — Arm® ベースのマイコンおよびプロセッサ用Lauterbach TRACE32® デバッグおよびトレースシステム

LauterbachのTRACE32® ツールは最先端のハードウェア/ソフトウェアコンポーネントのスイートで、あらゆる種類の Arm® ベースのマイコンとプロセッサの分析、最適化、認証を実行できます。組込みシステムと SoC 向けの世界的に有名なデバッグ/トレースソリューションは、初期のシリコン開発前の段階から製品認証やトラブルシューティングに至る、あらゆる開発段階に最適なソリューションです。Lauterbach (...)

購入先：Lauterbach GmbH
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ソフトウェア開発キット (SDK)

MCU-PLUS-SDK-AM62X — MCU+ SDK for AM62x – RTOS, No-RTOS

The AM62 processor Linux® software development kits (SDKs) are unified software platforms for embedded processors providing easy setup and fast out-of-box access to benchmarks and demonstrations.

All releases of this SDK are consistent across TI's broad portfolio for which they are provided, (...)

サポート対象の製品とハードウェア

サポート対象の製品とハードウェア
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ソフトウェア開発キット (SDK)

PROCESSOR-SDK-LINUX-AM62X — Processor SDK Linux for AM62x

The AM62 processor Linux® software development kits (SDKs) are unified software platforms for embedded processors providing easy setup and fast out-of-box access to benchmarks and demonstrations.

All releases of this SDK are consistent across TI's broad portfolio for which they are provided, (...)

サポート対象の製品とハードウェア

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ソフトウェア開発キット (SDK)

PROCESSOR-SDK-LINUX-RT-AM62X — Processor SDK RT-Linux for AM62x

The AM62 processor Linux® software development kits (SDKs) are unified software platforms for embedded processors providing easy setup and fast out-of-box access to benchmarks and demonstrations.

All releases of this SDK are consistent across TI's broad portfolio for which they are provided, (...)

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ファームウェア

DDR-MARGIN-FW — Firmware and scripts to measure system DDR margin

The DDR margin firmware and supporting scripts allow visualization and measurement of system margin in the DDR interface on board. These tools enable probe-less measurement of critical data signals to understand the integrity and robustness of the interface.
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はじめに

TI-DEVELOPER-ZONE — Start embedded development on your desktop or in the cloud

From evaluation to deployment the TI Developer Zone provides a comprehensive range of software, tools and training to ensure that you have everything you need for each stage of the development process.
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IDE (統合開発環境)、コンパイラ、またはデバッガ

CCSTUDIO — Code Composer Studio 統合開発環境（IDE）

CCStudio™ IDE is part of TI's extensive CCStudio™ development tool ecosystem. It is an integrated development environment (IDE) for TI's microcontrollers, processors, wireless connectivity devices and radar sensors. It is comprised of a rich suite of tools used to build, debug, analyze and optimize (...)

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IDE (統合開発環境)、コンパイラ、またはデバッガ

DDR-CONFIG-AM62 — DDR Configuration Tool

This SysConfig based tool simplifies the process of configuring the DDR Subsystem Controller and PHY to interface to SDRAM devices. Based on the memory device, board design, and topology the tool outputs files to initialize and train the selected memory.
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IDE (統合開発環境)、コンパイラ、またはデバッガ

EDGE-AI-STUDIO — Edge AI Studio

Edge AI Studio is part of the CCStudio™ development tool ecosystem.  Edge AI Studio is a collection of graphical and command line tools designed to accelerate edge AI development on TI processors, microcontrollers, connectivity devices and radar sensors.  It supports both AI-accelerated (...)

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IDE (統合開発環境)、コンパイラ、またはデバッガ

K3-RESOURCE-CONFIGURATION — Resource partitioning tool for multi core SOCs

Also known as the k3-respart-tool, the Resource Configuration tool allows for configuration of various system level parameters and generate the necessary data to be fed into software components
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IDE (統合開発環境)、コンパイラ、またはデバッガ

SYSCONFIG — SysConfigのスタンドアロン・デスクトップ・バージョン

SysConfig is a configuration tool designed to simplify hardware and software configuration challenges to accelerate software development.

SysConfig is available as part of the Code Composer Studio™ integrated development environment as well as a standalone application. Additionally SysConfig (...)

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オンライン・トレーニング

AM62-ACADEMY — AM62x Academy

AM62x Academy is designed to simplify and accelerate custom AM62x development.
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サポート対象の製品とハードウェア
参照
オペレーティング・システム (OS)

GHS-3P-INTEGRITY-RTOS — Green Hills 社の INTEGRITY RTOS

Green Hills Software オペレーティング・システムの主力製品、INTEGRITY RTOS はパーティショニング・アーキテクチャを基盤として構築され、トータルな信頼性、絶対的なセキュリティ、および最大リアルタイム・パフォーマンスを実現する組込みシステムを提供しています。INTEGRITY はさまざまな業界での認定実績により、そのリーダーシップを裏付けられており、オペレーティング・システムのリアルタイムな安全性、セキュリティ、信頼性で高いレベルのソリューションを提供しています。

Green Hills Software の詳細については、www.ghs.com (...)
購入先：Green Hills Software
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オペレーティング・システム (OS)

GHS-3P-UVELOSITY — Green Hills Software u-velOSity Safety RTOS

The µ-velOSity™ Safety RTOS is the smallest of Green Hills Software's real-time operating systems and was designed especially for microcontrollers. It supports a wide range of TI processor families using the Arm® Cortex-M or Cortex-R cores as a main CPU or as a co-processors (...)
購入先：Green Hills Software
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オペレーティング・システム (OS)

WHIS-3P-SAFERTOS — WITTENSTEIN SAFERTOS の事前認証取得済み安全対応 RTOS

SAFERTOS® は、組込みプロセッサに適した独自のリアルタイム オペレーティング システムです。TÜV SÜD から、IEC 61508 SIL3 と ISO 26262 ASIL D の各規格に対する事前認証取得済みです。SAFERTOS® は、WHIS のエキスパート チームが安全性を重視して特化型製作したもので、世界各地の安全重視アプリケーションが採用しています。WHIS とテキサス・インスツルメンツは 10 年以上にわたる協力関係を維持してきました。この間、WHIS は SafeRTOS® を幅広い TI (...)
購入先：WITTENSTEIN High Integrity Systems
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シミュレーション・モデル

AM62xSiP BSDL Model

SPRM841.ZIP (9 KB) - BSDL Model
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シミュレーション・モデル

AM62xSiP IBIS Model (Rev. A)

SPRM842A.ZIP (2149 KB) - IBIS Model
ダウンロード
シミュレーション・モデル

AM62xSiP IBIS-AMI Model

SPRM844.ZIP (80697 KB) - IBIS-AMI Model
ダウンロード
パッケージ ピン数 CAD シンボル、フットプリント、および 3D モデル
FCCSP (AMK) 425 Ultra Librarian
TI の評価基板に関する標準契約約款が適用されます。

購入と品質

記載されている情報：
  • RoHS
  • REACH
  • デバイスのマーキング
  • リード端子の仕上げ / ボールの原材料
  • MSL 定格 / ピーク リフロー
  • MTBF/FIT 推定値
  • 使用材料
  • 認定試験結果
  • 継続的な信頼性モニタ試験結果
記載されている情報：
  • ファブ拠点
  • アセンブリ拠点

推奨製品には、この TI 製品に関連するパラメータ、評価基板、またはリファレンス デザインが存在する可能性があります。

サポートとトレーニング

TI E2E™ フォーラムでは、TI のエンジニアからの技術サポートを提供

投稿されたすべてのフォーラムトピック (英語) を表示

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